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重叠组合法的芯片级三维寄生电容提取及其并行实现
被引量：
1
1
作者
尹航
喻文健
+1 位作者
陆涛涛
王泽毅
《计算机辅助设计与图形学学报》
EI
CSCD
北大核心
2006年第2期238-244,共7页
采用双向区域重叠组合法,基于三维层次式块边界元法实现了芯片级的互连电容提取·该方法将芯片切分为大量小规模区域,用全局场求解器计算各子区域电容矩阵,可方便地组合出整个芯片的电容矩阵;同时分析了其计算量和精度,并进行了并...
采用双向区域重叠组合法,基于三维层次式块边界元法实现了芯片级的互连电容提取·该方法将芯片切分为大量小规模区域,用全局场求解器计算各子区域电容矩阵,可方便地组合出整个芯片的电容矩阵;同时分析了其计算量和精度,并进行了并行计算实验·对实际版图结构的数值实验验证了有关分析结论,表明该方法高效、可靠、并行性能好·
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关键词
边界元法
三维寄生电容
芯片级提取
重叠组合
并行计算
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职称材料
题名
重叠组合法的芯片级三维寄生电容提取及其并行实现
被引量：
1
1
作者
尹航
喻文健
陆涛涛
王泽毅
机构
清华大学计算机科学与技术系
北京华天中汇科技有限公司
出处
《计算机辅助设计与图形学学报》
EI
CSCD
北大核心
2006年第2期238-244,共7页
基金
国家自然科学基金(90407004)
国家"八六三"高技术研究发展计划(2004AA1Z1050)
文摘
采用双向区域重叠组合法,基于三维层次式块边界元法实现了芯片级的互连电容提取·该方法将芯片切分为大量小规模区域,用全局场求解器计算各子区域电容矩阵,可方便地组合出整个芯片的电容矩阵;同时分析了其计算量和精度,并进行了并行计算实验·对实际版图结构的数值实验验证了有关分析结论,表明该方法高效、可靠、并行性能好·
关键词
边界元法
三维寄生电容
芯片级提取
重叠组合
并行计算
Keywords
boundary element method
3D parasitic capacitance
chip-level extraction
overlapcombination
parallel computing
分类号
TN47 [电子电信—微电子学与固体电子学]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
重叠组合法的芯片级三维寄生电容提取及其并行实现
尹航
喻文健
陆涛涛
王泽毅
《计算机辅助设计与图形学学报》
EI
CSCD
北大核心
2006
1
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