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12位100MHz Bicmos流水线模数转换器的设计
被引量：
1
1
作者
王小力
刘云涛
《西安交通大学学报》
EI
CAS
CSCD
北大核心
2008年第10期1204-1208,共5页
为了解决流水线结构模数转换器（ADC）的高速度、高精度和大动态范围兼顾问题，提出了一种改进的2．5b／级与1．5b／级结构相结合的系统设计方案．该系统中，流水线第1级采用2．5b／级结构，2～10级均采用1．5b／级结构，改进后的结构...
为了解决流水线结构模数转换器（ADC）的高速度、高精度和大动态范围兼顾问题，提出了一种改进的2．5b／级与1．5b／级结构相结合的系统设计方案．该系统中，流水线第1级采用2．5b／级结构，2～10级均采用1．5b／级结构，改进后的结构增大了系统的动态范围，同时更加模块化，降低了电路设计的复杂度．设计了2级Bicmos运算放大器，并提出了一种全新的应用于1．5b／级结构的差分比较器．所设计的运算放大器可同时实现高增益、大带宽，电路速度快，不需要额外的补偿电容，可应用于高频环境，并具有较大的输出摆幅．所设计的差分比较器电路简化，节省了元件，不需电阻分压网络产生参考电压，减小了芯片面积．ADC系统采用0．35μm Bicmos工艺技术和3．3V工作电压，经仿真实验，在100MHz的采样频率下，该系统的信噪比为73．7dB，对应的有效位为11．95b，无杂散动态范围为87．4dB，实现了12位高分辨率和100MHz的高采样速度．
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关键词
流水线
结构模数转换器
运算放大器
比较器
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职称材料
基于MATLAB的新型Pipeline ADC的建模和仿真
被引量：
4
2
作者
李萌
张润曦
+3 位作者
陈磊
沈佳铭
陈文斌
赖宗声
《电子器件》
CAS
2008年第3期834-837,共4页
在MATLAB/Simulink的平台上,设计并实现了一种新的10bit Pipeline ADC的系统仿真模型。针对2bit,共9级的结构的精度不足以及4bit首级结构的功耗较大的特点,提出了一种首级3bit,共8级的结构。这种结构可以实现精度和功耗的平衡。经过系...
在MATLAB/Simulink的平台上,设计并实现了一种新的10bit Pipeline ADC的系统仿真模型。针对2bit,共9级的结构的精度不足以及4bit首级结构的功耗较大的特点,提出了一种首级3bit,共8级的结构。这种结构可以实现精度和功耗的平衡。经过系统仿真,在输入信号为10MHz,采样时钟频率为40MHz时,系统最大的SNR=60.6dB,SFDR=82.177dB。创建的系统模型可为ADC系统中的误差和静态特性研究提供借鉴。
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关键词
流水线
结构
的
模数转换器
3bit
结构
增益误差
子ADC误差
子DAC(位数模
转换器
)误差
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职称材料
题名
12位100MHz Bicmos流水线模数转换器的设计
被引量：
1
1
作者
王小力
刘云涛
机构
西安交通大学超大规模集成电路设计研究中心
哈尔滨工程大学信息与通信工程学院
出处
《西安交通大学学报》
EI
CAS
CSCD
北大核心
2008年第10期1204-1208,共5页
基金
教育部科学技术重点研究资助项目(03151)
文摘
为了解决流水线结构模数转换器（ADC）的高速度、高精度和大动态范围兼顾问题，提出了一种改进的2．5b／级与1．5b／级结构相结合的系统设计方案．该系统中，流水线第1级采用2．5b／级结构，2～10级均采用1．5b／级结构，改进后的结构增大了系统的动态范围，同时更加模块化，降低了电路设计的复杂度．设计了2级Bicmos运算放大器，并提出了一种全新的应用于1．5b／级结构的差分比较器．所设计的运算放大器可同时实现高增益、大带宽，电路速度快，不需要额外的补偿电容，可应用于高频环境，并具有较大的输出摆幅．所设计的差分比较器电路简化，节省了元件，不需电阻分压网络产生参考电压，减小了芯片面积．ADC系统采用0．35μm Bicmos工艺技术和3．3V工作电压，经仿真实验，在100MHz的采样频率下，该系统的信噪比为73．7dB，对应的有效位为11．95b，无杂散动态范围为87．4dB，实现了12位高分辨率和100MHz的高采样速度．
关键词
流水线
结构模数转换器
运算放大器
比较器
Keywords
pipeline
analog-to-digital converter
operational amplifier
comparator
分类号
TP335 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
基于MATLAB的新型Pipeline ADC的建模和仿真
被引量：
4
2
作者
李萌
张润曦
陈磊
沈佳铭
陈文斌
赖宗声
机构
华东师范大学微电子电路与系统研究所
出处
《电子器件》
CAS
2008年第3期834-837,共4页
基金
上海市AM基金资助(AM0508)(AM0513)
上海市科委资助(06SA14)
文摘
在MATLAB/Simulink的平台上,设计并实现了一种新的10bit Pipeline ADC的系统仿真模型。针对2bit,共9级的结构的精度不足以及4bit首级结构的功耗较大的特点,提出了一种首级3bit,共8级的结构。这种结构可以实现精度和功耗的平衡。经过系统仿真,在输入信号为10MHz,采样时钟频率为40MHz时,系统最大的SNR=60.6dB,SFDR=82.177dB。创建的系统模型可为ADC系统中的误差和静态特性研究提供借鉴。
关键词
流水线
结构
的
模数转换器
3bit
结构
增益误差
子ADC误差
子DAC(位数模
转换器
)误差
Keywords
pipeline ADC
3 bit architectures gain error
error in sub-ADC
error in sub-DAC
分类号
TN602 [电子电信—电路与系统]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
12位100MHz Bicmos流水线模数转换器的设计
王小力
刘云涛
《西安交通大学学报》
EI
CAS
CSCD
北大核心
2008
1
在线阅读
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职称材料
2
基于MATLAB的新型Pipeline ADC的建模和仿真
李萌
张润曦
陈磊
沈佳铭
陈文斌
赖宗声
《电子器件》
CAS
2008
4
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职称材料
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