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基于FPGA的直接数字合成器的设计 被引量:6
1
作者 华金 姜伟 李存兵 《机电工程》 CAS 2007年第12期38-40,共3页
介绍了直接数字合成器(DDS)的基本组成及工作原理,采用QUARTUSⅡ软件提供的模块和VHDL语言自行设计的寄存器,实现了现场可编程门阵列(FPGA)的相位累加器和波形存储表的设计。通过频谱分析研究了DDS的输出频谱,分析讨论了引起输出杂散的... 介绍了直接数字合成器(DDS)的基本组成及工作原理,采用QUARTUSⅡ软件提供的模块和VHDL语言自行设计的寄存器,实现了现场可编程门阵列(FPGA)的相位累加器和波形存储表的设计。通过频谱分析研究了DDS的输出频谱,分析讨论了引起输出杂散的原因及改善杂散的方法。研究结果表明,该设计具有较高的实际应用价值。 展开更多
关键词 直接数字合成器 现场可编程门阵列 频谱分析
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一种双路正交输出的高精度低杂散直接数字合成器
2
作者 陈丽燕 许惠英 陈亮亮 《厦门大学学报(自然科学版)》 CAS CSCD 北大核心 2019年第1期116-121,共6页
介绍了直接数字合成器(DDS)工作的原理,提出了DDS资源优化的设计方法,并在ISE(integrated software environment)软件环境下使用verilog语言在现场可编程门阵列(FPGA)上设计实现了一种双路正交输出且具有高精度低杂散的DDS.在MATLAB的... 介绍了直接数字合成器(DDS)工作的原理,提出了DDS资源优化的设计方法,并在ISE(integrated software environment)软件环境下使用verilog语言在现场可编程门阵列(FPGA)上设计实现了一种双路正交输出且具有高精度低杂散的DDS.在MATLAB的环境下,对其输出的频谱特性进行了仿真,最后分析了DDS的设计参数和输出信号杂散度之间的关系,为工程应用的实现提供了设计依据. 展开更多
关键词 直接数字合成器 现场可编程门阵列 杂散 高精度 资源优化
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基于改进CORDIC算法实现高速直接数字频率合成器 被引量:22
3
作者 万书芹 陈宛峰 +2 位作者 黄嵩人 季惠才 于宗光 《仪器仪表学报》 EI CAS CSCD 北大核心 2010年第11期2586-2591,共6页
设计实现了一种高速直接数字频率合成器。利用混合CORDIC算法的思想,用混合角度集代替传统正切角度集,并讨论了在二进制格式下的中间值,采用改进的混合差分CORDIC算法实现了相位幅度的转换。在确保算法的迭代精度和收敛区间的前提下,避... 设计实现了一种高速直接数字频率合成器。利用混合CORDIC算法的思想,用混合角度集代替传统正切角度集,并讨论了在二进制格式下的中间值,采用改进的混合差分CORDIC算法实现了相位幅度的转换。在确保算法的迭代精度和收敛区间的前提下,避免了传统算法中旋转方向依赖于上一次迭代的现象,提高了数据的吞吐量;同时消除了常用冗余算法引进额外电路的情况。分析了采用CORDIC算法所带来的误差,综合考虑精度和电路复杂度,确定字长和迭代次数获得14位的输出有效位。经0.18μm6M2P CMOS工艺流片,在1GHz的工作频率下,输出信号在98.6MHz处,SFDR为68.39dB,整个芯片面积为4.19mm×3.17mm。 展开更多
关键词 直接数字频率合成器 CORDIC算法 差分CORDIC 混合角度集
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基于改进混合式CORDIC算法的直接数字频率合成器设计 被引量:17
4
作者 张晓彤 辛茹 +1 位作者 王沁 李涵 《电子学报》 EI CAS CSCD 北大核心 2008年第6期1144-1148,共5页
提出一种新的面积优化的直接数字频率合成器设计方案.采用改进混合式CORDIC算法,通过削减旋转相位判断电路和乘法单元,改进和调整相位旋转误差,并利用简单的移位和加/减电路完成复杂的幅度修正,降低了电路复杂度,缩减了电路规模.结构上... 提出一种新的面积优化的直接数字频率合成器设计方案.采用改进混合式CORDIC算法,通过削减旋转相位判断电路和乘法单元,改进和调整相位旋转误差,并利用简单的移位和加/减电路完成复杂的幅度修正,降低了电路复杂度,缩减了电路规模.结构上采用流水线式多级循环迭代技术,实现移位和加/减电路的高度复用.实验结果表明本方法输出频谱杂散小于-70dB,并在运算速度和资源利用率上具有一定的优势.该设计已成功用于宽带网络SoC芯片的频率调制模块. 展开更多
关键词 直接数字频率合成器 混合式CORDIC 面积优化 多级循环迭代
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基于FPGA的直接数字频率合成器的设计 被引量:21
5
作者 董国伟 李秋明 +2 位作者 赵强 顾德英 汪晋宽 《仪器仪表学报》 EI CAS CSCD 北大核心 2006年第z1期877-879,共3页
本文介绍了直接数字频率合成器(DDS)的基本组成及设计原理,给出了基于FPGA的具体设计方案及编程实现方法。仿真结果表明,该设计简单合理,使用灵活方便,具有良好的性价比。
关键词 直接数字频率合成器(DDS)FPGA 性价比
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基于直接数字频率合成器的新型微波成像系统 被引量:4
6
作者 张慧 洪伟 +2 位作者 陈鹏 陈继新 汤红军 《电波科学学报》 EI CSCD 北大核心 2015年第4期704-709,共6页
研究并实现了一种Ku频段的相控阵被动微波成像系统.该系统使用直接数字频率合成器(Direct Digital Synthesizer,DDS)进行上变频后作为射频通道的本振信号,通过DDS作为等效移相单元来实现相控阵成像系统的移相.对比传统使用数字移相器方... 研究并实现了一种Ku频段的相控阵被动微波成像系统.该系统使用直接数字频率合成器(Direct Digital Synthesizer,DDS)进行上变频后作为射频通道的本振信号,通过DDS作为等效移相单元来实现相控阵成像系统的移相.对比传统使用数字移相器方案,该成像方案可以对视场内的景物进行几乎连续的高密度电扫描,具有扫描时间短、移相精度高、扫描像素高等优点.系统的实测成像结果表明:基于DDS的相控阵微波成像方案具有成像质量高、成像速度快、系统成本较低等优势,是一种有着良好研究前景的新型微波与毫米波成像技术. 展开更多
关键词 微波成像 毫米波成像 直接数字频率合成器 相控阵
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采用直接数字频率合成器混频信号的高频功率源设计 被引量:3
7
作者 李冬 高敏 +2 位作者 胡桐宁 杨军 秦斌 《强激光与粒子束》 EI CAS CSCD 北大核心 2008年第10期1707-1710,共4页
提取直接数字频率合成器芯片AD9850输出的混频信号作为系统的频率源,介绍了高频功率源的结构和原理。系统的工作频率范围为(96±1)MHz,最大输出功率为10 kW。驱动级采用MOSFET晶体管功率放大模块,末级采用高频真空四极管4CW10000B... 提取直接数字频率合成器芯片AD9850输出的混频信号作为系统的频率源,介绍了高频功率源的结构和原理。系统的工作频率范围为(96±1)MHz,最大输出功率为10 kW。驱动级采用MOSFET晶体管功率放大模块,末级采用高频真空四极管4CW10000B。四极管采用阴地电路,工作在甲乙类。高频功率源采用压控可变衰减器进行幅度调制,为满足系统的频率和幅值稳定度要求,功率源采用带温度补偿的晶体振荡器,并让四极管工作在过压状态。在应用Ziegler-Nichols法整定控制器的PID参数时,为实现控制系统的在线自整定,系统采用了继电反馈法,由极限周期和增益得出PID参数。 展开更多
关键词 直接数字频率合成器 四极管 压控可变衰减器 PID参数 继电反馈法
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直接数字频率合成器相位截断杂散谱的精确分析 被引量:7
8
作者 谢仁宏 是湘全 《电子与信息学报》 EI CSCD 北大核心 2004年第3期495-499,共5页
该文在Nicholas采用数论方法得到的相位截断杂散谱的幅度和位置分布结果的基础上,运用 映射和数论工具对杂散谱位置分布进行了分析,提出了一种简化算法,可精确分析相位截断杂散谱的谱线幅 度和杂散位置.
关键词 直接数字频率合成器 相位截断 杂散谱 杂散位置 谱线幅度 映射 数论
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直接数字频率合成器DDS的设计 被引量:7
9
作者 刘玉良 刘国平 俞红杰 《浙江海洋学院学报(自然科学版)》 CAS 2004年第4期320-322,共3页
在分析直接数字频率合成器DDS工作原理及杂散影响的基础上,以8031单片机和CPLD芯片FLEX10K为主要硬件进行设计。设计过程采取了改善杂散的措施,测试表明DDS能产生0~11MHz的正弦输出信号,频率分辨率达到0.1Hz,满足电子系统的一般要求。
关键词 DDS 直接数字频率合成器 杂散 频率分辨率 FLEX10K 电子系统 输出信号 硬件 8031单片机 设计
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直接数字式频率合成器单粒子效应实验研究 被引量:2
10
作者 王园明 阮林波 +5 位作者 罗尹虹 郭红霞 王忠明 姚志斌 张凤祁 王燕萍 《强激光与粒子束》 EI CAS CSCD 北大核心 2016年第10期167-172,共6页
在直接数字式频率合成器(DDS)单粒子效应失效现象的基础上,研制了具备寄存器读写、功耗电流测试和输出效应波形捕获功能的DDS辐射效应在线测试系统,开展了DDS单粒子效应实验研究。结果表明,单粒子效应会导致DDS输出波形扰动,波形功能中... 在直接数字式频率合成器(DDS)单粒子效应失效现象的基础上,研制了具备寄存器读写、功耗电流测试和输出效应波形捕获功能的DDS辐射效应在线测试系统,开展了DDS单粒子效应实验研究。结果表明,单粒子效应会导致DDS输出波形扰动,波形功能中断,功耗电流陡然增大。分析认为:DDS内部PLL模块发生单粒子瞬态和单粒子翻转,是引发波形扰动的主要原因;内置DAC的主要功能寄存器翻转引发了输出波形功能中断;电流增大是单粒子闭锁引起的。本项研究为国产DDS器件的加固和考核提供了一定的参考。 展开更多
关键词 直接数字式频率合成器 单粒子效应 波形扰动 功能中断
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直接数字频率合成器的相位噪声分析 被引量:3
11
作者 孙晓闻 张瑞永 陈国海 《现代雷达》 CSCD 北大核心 2009年第6期89-92,共4页
验证了振幅调制和相位调制是2种等价的时钟噪声模型。基于相位正弦调制(晶振输出)的抖动模型,对直接数字频率合成器的谱函数进行了研究,推导出载频杂散比的精确计算表达式。受Bessel函数衰减的影响,通过忽略高阶杂散的能量,可以得出较... 验证了振幅调制和相位调制是2种等价的时钟噪声模型。基于相位正弦调制(晶振输出)的抖动模型,对直接数字频率合成器的谱函数进行了研究,推导出载频杂散比的精确计算表达式。受Bessel函数衰减的影响,通过忽略高阶杂散的能量,可以得出较简单的信噪比计算方法,同时指出提高数据恢复的采样率可显著的改善输出信噪比。仿真结果验证了载频杂散比和信噪比算法的有效性。 展开更多
关键词 直接数字频率合成器 相位噪声 载频杂散比 信噪比
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基于直接数字频率合成器的微生物电旋转仪设计 被引量:1
12
作者 谢建军 林剑辉 《实验室研究与探索》 CAS 2005年第12期31-32,52,共3页
提出了一种基于DDS和微分器的微生物电旋转仪的设计。具有稳定性高、频带宽、控制精确、易于操作等优点。
关键词 微生物 电旋转仪 直接数字频率合成器 微分器
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用VHDL设计直接数字频率合成器 被引量:3
13
作者 井新宇 《现代电子技术》 2004年第22期97-99,共3页
应用 EDA技术 ,以 FPGA/ CPL D器件为核心 ,用 VHDL语言设计直接数字频率合成器。本文给出了他的工作原理、设计方法和主要的程序代码。采用 FPGA设计的直接数字合成器不仅可方便地实现各种比较复杂的调频、调相和调幅功能 ,而且具有良... 应用 EDA技术 ,以 FPGA/ CPL D器件为核心 ,用 VHDL语言设计直接数字频率合成器。本文给出了他的工作原理、设计方法和主要的程序代码。采用 FPGA设计的直接数字合成器不仅可方便地实现各种比较复杂的调频、调相和调幅功能 ,而且具有良好的实用性。 展开更多
关键词 直接数字频率合成器(DDFS) FPGA VHDL EDA
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一种高效实用的直接数字频率合成器的设计和实现 被引量:2
14
作者 吉训生 《现代电子技术》 2003年第15期99-101,共3页
在介绍 DDS原理和特点的基础上 ,充分利用正弦函数的对称性 ,给出了 DDS的一种实现方案 ,详细阐述了用 FPGA实现该方案的方法 。
关键词 直接数字频率合成器 DDS 正弦函数 FPGA 频率控制
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软件无线电卫星便携地面站中的直接数字频率合成器
15
作者 漆庄平 李国通 杨根庆 《应用科学学报》 CAS CSCD 2004年第4期463-466,共4页
理想的软件无线电需要高效且高速的数字下变频器.通常数字下变频采用查找表方法实现,即输入信号的采样乘上一个预先存储在ROM中的正弦余弦函数值.为了得到高精度,这种方法需要很大的查找表,这就意味着占用芯片面积大、功耗大、工作速度... 理想的软件无线电需要高效且高速的数字下变频器.通常数字下变频采用查找表方法实现,即输入信号的采样乘上一个预先存储在ROM中的正弦余弦函数值.为了得到高精度,这种方法需要很大的查找表,这就意味着占用芯片面积大、功耗大、工作速度低和增加成本.文中描述了一个基于CORDIC算法的直接数字频率合成器.它能大幅度地减少查找表的大小,从而达到高精度的要求. 展开更多
关键词 查找表 直接数字频率合成器 软件无线电 数字下变频器 CORDIC算法 地面站 功耗 ROM 输入信号 芯片
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改进的CORDIC模块实现的直接数字频率合成器 被引量:7
16
作者 陈立功 宋学瑞 王鑫 《计算机工程与应用》 CSCD 北大核心 2010年第17期57-59,共3页
在传统的定点数流水线型CORDIC算法基础上,就减少迭代次数上提出一种改进算法,实现并行处理时的符号预测。改进算法大大减少了流水线迭代次数,节省了FPGA的Slice Flip Flops数量。最后利用改进算法在Xilinx公司的Virtex-II平台上实现了... 在传统的定点数流水线型CORDIC算法基础上,就减少迭代次数上提出一种改进算法,实现并行处理时的符号预测。改进算法大大减少了流水线迭代次数,节省了FPGA的Slice Flip Flops数量。最后利用改进算法在Xilinx公司的Virtex-II平台上实现了直接数字频率合成器(DDS)。 展开更多
关键词 坐标旋转数字计算算法(CORDIC) 现场可编程门阵列(FPGA) 符号预测 直接数字频率合成器(DDS)
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基于直接数字频率合成器及正交锁相技术的交直流微型电场传感器电路 被引量:2
17
作者 任东宇 彭春荣 夏善红 《电子与信息学报》 EI CSCD 北大核心 2013年第12期3030-3036,共7页
为了实现AC(工频)和DC电场同时检测,该文基于MEMS电场传感器,采用直接数字频率合成器(DDS)激励及正交锁相技术研制出一种高性能微型电场传感器电路。该系统结合低噪声模拟电路和数字控制方式,采用DDS产生精准的传感器激励信号和双路正... 为了实现AC(工频)和DC电场同时检测,该文基于MEMS电场传感器,采用直接数字频率合成器(DDS)激励及正交锁相技术研制出一种高性能微型电场传感器电路。该系统结合低噪声模拟电路和数字控制方式,采用DDS产生精准的传感器激励信号和双路正交参考信号,保证了激励信号及正交参考信号的频率、幅值稳定性以及双路正交参考信号之间准确的相位差。采用相关解调芯片及高速滤波器构建正交锁相放大电路,结合Advanced RISC Machines(ARM)微控制器,解决了单片机数字信号处理响应速度慢、资源不足等问题,成功实现AC(工频)及DC电场加载情况下传感器弱信号高精度提取。 展开更多
关键词 微型电场传感器 静电场及工频电场 直接数字频率合成器(DDS) 正交锁相放大器 分辨力
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时钟3.2GHz直接数字频率合成器的研制 被引量:1
18
作者 李保雪 张冰 +1 位作者 费元春 赵琦 《现代雷达》 CSCD 北大核心 2010年第5期72-75,共4页
阐述了时钟频率高达3.2GHz的新型直接数字频率合成器的设计方案,由该方案设计的直接数字频率合成器最高输出频率可达1500MHz,并且可以产生线性调频、脉冲步进、调频步进等多种调制信号。通过对该直接数字频率合成器与DDS芯片AD9858进行... 阐述了时钟频率高达3.2GHz的新型直接数字频率合成器的设计方案,由该方案设计的直接数字频率合成器最高输出频率可达1500MHz,并且可以产生线性调频、脉冲步进、调频步进等多种调制信号。通过对该直接数字频率合成器与DDS芯片AD9858进行相位噪声以及杂散进行对比分析,时钟为3.2GHz的直接数字频率合成器不仅输出带宽得以扩展,其相位噪声在所测试点比AD9858要优10dB,窄带杂散也较AD9858有很大提高。 展开更多
关键词 直接数字频率合成器 相位噪声 杂散
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基于分段多项式的直接数字频率合成器设计 被引量:1
19
作者 宋学良 郭裕顺 《机电工程》 CAS 2011年第9期1113-1116,共4页
为提高直接数字频率合成器(DDS)系统的性能,将分段多项式逼近算法应用于优化相幅转换电路中,实现了基于此结构的直接数字频率合成器设计。提出了适合在流行的现场可编程门阵列(FPGA)平台上实现的电路结构方案,进行了硬件实验,给出了在Al... 为提高直接数字频率合成器(DDS)系统的性能,将分段多项式逼近算法应用于优化相幅转换电路中,实现了基于此结构的直接数字频率合成器设计。提出了适合在流行的现场可编程门阵列(FPGA)平台上实现的电路结构方案,进行了硬件实验,给出了在Altera Cyclone II器件中的实现结果,并在性能和资源消耗方面与基于ROM查找表的方案作了比较。研究结果表明,由于避免了庞大的查找表,这一方案大大减小了电路面积,提高了系统性能。 展开更多
关键词 直接数字频率合成器 相幅转换 分段多项式逼近 现场可编程门阵列
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基于直接数字频率合成器的高性能数字电视调谐器本振设计
20
作者 郑宝辉 张文军 +1 位作者 张宏科 孙金荣 《上海交通大学学报》 EI CAS CSCD 北大核心 2005年第9期1526-1529,共4页
讨论了数字电视调谐器本振相位噪声,在分析直接数字频率合成器(DDS)的原理及特点的基础上,提出了一种DDS与锁相环(PLL)混合电路用于调谐器本振的方法.应用该方法可使其在所用频率点上无相位截断噪声,从而使调谐器本振的相位噪声大大改善... 讨论了数字电视调谐器本振相位噪声,在分析直接数字频率合成器(DDS)的原理及特点的基础上,提出了一种DDS与锁相环(PLL)混合电路用于调谐器本振的方法.应用该方法可使其在所用频率点上无相位截断噪声,从而使调谐器本振的相位噪声大大改善.实验证明,该方法是有效的. 展开更多
关键词 直接数字频率合成器 锁相环路 电视调谐器 相位噪声 本地振荡器
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