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高抗电源噪声的低时钟抖动VCO设计
1
作者
蔡敏
王冬春
《华南理工大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2009年第9期67-70,81,共5页
设计了一种基于电流舵逻辑(CSL)架构的环型压控振荡器(VCO),对传统的共源共栅结构偏置电路作了进一步的改善,增加了一个电压增益较大的放大器构成有源负反馈,以提高抗电源噪声的能力.采用和舰0.18μm双阱CMOS工艺对传统结构VCO和改进后...
设计了一种基于电流舵逻辑(CSL)架构的环型压控振荡器(VCO),对传统的共源共栅结构偏置电路作了进一步的改善,增加了一个电压增益较大的放大器构成有源负反馈,以提高抗电源噪声的能力.采用和舰0.18μm双阱CMOS工艺对传统结构VCO和改进后的VCO进行对比仿真,在频率为20MHz、峰-峰值为200mV的高频电源噪声下,传统结构VCO的峰-峰抖动和均方根抖动分别为54.135 ps和19.454 ps,而改进结构VCO的相应值分别为27.442 ps和9.196 ps,抗抖动性能大大提高.改进结构VCO的输出频率为650MHz,占空比约为52%,中心控制电压0.9V对应的增益为962.16MHz/V,线性度良好,在1.8V的直流电源下功耗仅为0.7mW左右.
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关键词
电流舵逻辑
压控振荡器
负反馈
抖动
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职称材料
题名
高抗电源噪声的低时钟抖动VCO设计
1
作者
蔡敏
王冬春
机构
华南理工大学电子与信息学院
出处
《华南理工大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2009年第9期67-70,81,共5页
文摘
设计了一种基于电流舵逻辑(CSL)架构的环型压控振荡器(VCO),对传统的共源共栅结构偏置电路作了进一步的改善,增加了一个电压增益较大的放大器构成有源负反馈,以提高抗电源噪声的能力.采用和舰0.18μm双阱CMOS工艺对传统结构VCO和改进后的VCO进行对比仿真,在频率为20MHz、峰-峰值为200mV的高频电源噪声下,传统结构VCO的峰-峰抖动和均方根抖动分别为54.135 ps和19.454 ps,而改进结构VCO的相应值分别为27.442 ps和9.196 ps,抗抖动性能大大提高.改进结构VCO的输出频率为650MHz,占空比约为52%,中心控制电压0.9V对应的增益为962.16MHz/V,线性度良好,在1.8V的直流电源下功耗仅为0.7mW左右.
关键词
电流舵逻辑
压控振荡器
负反馈
抖动
Keywords
current steering logic
voltage-controlled oscillator
negative feedback
jitter
分类号
TN432 [电子电信—微电子学与固体电子学]
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职称材料
题名
作者
出处
发文年
被引量
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1
高抗电源噪声的低时钟抖动VCO设计
蔡敏
王冬春
《华南理工大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2009
0
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职称材料
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