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基于蚁群优化算法的虚拟现场可编程门阵列部署策略 被引量:1
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作者 许英鑫 孙磊 +1 位作者 赵建成 郭松辉 《计算机应用》 CSCD 北大核心 2020年第3期747-752,共6页
针对可重构密码资源池中,如何在最少的现场可编程门阵列(FPGA)上部署虚拟FPGA(vFPGA)的问题,结合FPGA的工作特点和应用场景的需求,在传统蚁群算法的基础上进行了优化,提出了一个基于蚁群优化(ACO)算法的vFPGA部署策略。首先,通过赋予蚂... 针对可重构密码资源池中,如何在最少的现场可编程门阵列(FPGA)上部署虚拟FPGA(vFPGA)的问题,结合FPGA的工作特点和应用场景的需求,在传统蚁群算法的基础上进行了优化,提出了一个基于蚁群优化(ACO)算法的vFPGA部署策略。首先,通过赋予蚂蚁资源状态感知的能力实现各个FPGA之间的负载均衡,同时避免频繁的vFPGA迁移;其次,设计预留空间,有效减少因为租户需求动态变化带来的服务等级协议(SLA)冲突;最后,对CloudSim进行功能扩展,使用合成的工作流进行仿真实验,对该策略性能进行评估。实验结果表明,所提策略可以在保证系统服务质量的前提下,提高FPGA资源利用率,减少FPGA使用量。 展开更多
关键词 云计算 现场可编程门阵列虚拟化 虚拟现场可编程门阵列部署 优化算法 局部可重构
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基于现场可编程门阵列的新型可编程逻辑控制器在线调试技术
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作者 罗奎 严义 《计算机应用》 CSCD 北大核心 2014年第9期2738-2741,共4页
针对基于现场可编程门阵列(FPGA)的新型可编程逻辑控制器(FPGA based PLC)的在线监控问题,提出了泛化的基于FPGA技术对嵌入式片上系统(SoC)进行在线监控的方法。该方法设计了一个FPGA片上通信系统,系统内部固化基于UART的ModBus通信协议... 针对基于现场可编程门阵列(FPGA)的新型可编程逻辑控制器(FPGA based PLC)的在线监控问题,提出了泛化的基于FPGA技术对嵌入式片上系统(SoC)进行在线监控的方法。该方法设计了一个FPGA片上通信系统,系统内部固化基于UART的ModBus通信协议栈,通过串口与计算机上位机进行通信;采用双口RAM(DRAM)作为与监控对象间共享的数据缓存区,通过中断机制实现缓存数据的同步交换。性能分析结果表明,该方法将SoC处理监控通信的时间百分比降低至0.002%,确保了监控数据传送的实时性,且使SoC能够获得更佳控制性能。在Altera的cycloneⅡ系列芯片开发板上验证了方案的可行性。 展开更多
关键词 现场可编程门阵列 可编程逻辑控制器 嵌入式片上系统 双口RAM MODBUS协议
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基于现场可编程门阵列的RISC处理器设计 被引量:1
3
作者 东野长磊 《计算机工程》 CAS CSCD 北大核心 2011年第11期242-244,共3页
基于现场可编程门阵列(FPGA)平台,设计嵌入式精简指令集计算机(RISC)中央处理器(CPU)。参考无内部互锁流水级微处理器(MIPS)指令集制定原则设计CPU指令集,通过分析指令处理过程构建嵌入式CPU的5级流水线,结合数据前推技术和软件编译方... 基于现场可编程门阵列(FPGA)平台,设计嵌入式精简指令集计算机(RISC)中央处理器(CPU)。参考无内部互锁流水级微处理器(MIPS)指令集制定原则设计CPU指令集,通过分析指令处理过程构建嵌入式CPU的5级流水线,结合数据前推技术和软件编译方法解决流水线相关性问题,并实现CPU的算术逻辑单元、控制单元、指令cache等关键模块设计。验证结果表明,该嵌入式RISC CPU的速度和稳定性均达到设计要求。 展开更多
关键词 现场可编程门阵列 精简指令计算机处理器 流水线相关性 算术逻辑单元
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基于现场可编程门阵列与Labview的脉冲电源控制系统设计 被引量:7
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作者 李家强 黄懿赟 +2 位作者 冯虎林 潘圣民 王邓辉 《核聚变与等离子体物理》 CAS CSCD 北大核心 2019年第2期139-143,共5页
介绍了基于现场可编程门阵列(FPGA)的等离子体磁约束脉冲电源控制系统的设计与实现。该控制系统采用了虚拟仪器技术、嵌入式控制技术、串行通信技术、光电隔离技术等,提高了系统抗干扰性能以及可编程性,实现了多个脉冲电源模块开关器件... 介绍了基于现场可编程门阵列(FPGA)的等离子体磁约束脉冲电源控制系统的设计与实现。该控制系统采用了虚拟仪器技术、嵌入式控制技术、串行通信技术、光电隔离技术等,提高了系统抗干扰性能以及可编程性,实现了多个脉冲电源模块开关器件间的逻辑互锁、参数设置以及远程监控等功能。控制系统具体由实验室虚拟仪器集成环境(Labview)编写的上位机界面、由硬件语言Verilog HDL 编写的下位机以及专用的光电隔离转换电路组成,用于实现多个脉冲电源充放电的时序控制。实验证明了系统在复杂电磁环境下,运行稳定,性能良好。 展开更多
关键词 现场可编程门阵列 实验室虚拟仪器成环境 脉冲电源 逻辑互锁 光电隔离
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FPGA/CPLD可编程逻辑器件的在系统配置方法 被引量:9
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作者 何伟 唐仁圣 张玲 《重庆大学学报(自然科学版)》 EI CAS CSCD 北大核心 2003年第5期125-128,共4页
讨论了基于SRAM技术的CPLD/FPGA可编程逻辑器件的编程方法 ,并以ALTERA公司FLEX10系列器件为例 ,提出了一种利用微处理器对可编程逻辑器件进行在系统多方案配置的实用方法。该方法成本低廉、简单易行 ,能在系统复位或上电时自动对器件编... 讨论了基于SRAM技术的CPLD/FPGA可编程逻辑器件的编程方法 ,并以ALTERA公司FLEX10系列器件为例 ,提出了一种利用微处理器对可编程逻辑器件进行在系统多方案配置的实用方法。该方法成本低廉、简单易行 ,能在系统复位或上电时自动对器件编程 ,不仅有效的解决了基于SRAM的CPLD/FPGA器件掉电易失性的问题 ,而且使单一芯片可以具有多种逻辑功能 ,实现了该类器件逻辑功能的在系统多方案的灵活配置。 展开更多
关键词 复杂可编程逻辑器件 现场可编程门阵列 被动串行配置PS 静态存贮器 电子设计自动化 在系统配置
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系统级可编程芯片(SOPC)设计思想与开发策略 被引量:7
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作者 刘达 龚建荣 《现代电子技术》 2002年第11期1-4,共4页
针对 SOPC全新的设计流程 ,提出了基于 IP的 SOPC设计集成平台概念及设计思想与开发策略 ,并介绍了基于 FPGA/CPL D的
关键词 系统级可编程芯片 知识产权 电子设计自动化 系统级 现场可编程门阵列 复杂可编程逻辑器件
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数字集群逻辑控制器测试仪CPLD设计 被引量:1
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作者 赵毅 牟同升 刘庆江 《半导体技术》 CAS CSCD 北大核心 2002年第7期36-38,48,共4页
简要介绍了集群逻辑控制器的功能,并详细阐述了集群逻辑控制器测试系统的重要部分,可编程逻辑器件(CPLD)的设计。设计好的可编程逻辑器件具备同步串口通信的功能,从而使测试系统能够与串行外围接口通信。
关键词 数字逻辑控制器 测试仪 CPLD 同步串口通信 可编程逻辑器件 串行外围接口
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可编程器件应用中应注意的问题 被引量:2
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作者 朱智强 张友森 《航空兵器》 2004年第2期45-48,共4页
随着可编程器件生产和应用技术的发展 ,可编程器件在专用嵌入式计算机系统中得到越来越广泛的应用 ,可编程器件因其自身的特点 ,在提高系统的可靠性和系统的保密性 ,简化系统设计并缩短研制周期等方面正在发挥更大的作用 ,但是因可编程... 随着可编程器件生产和应用技术的发展 ,可编程器件在专用嵌入式计算机系统中得到越来越广泛的应用 ,可编程器件因其自身的特点 ,在提高系统的可靠性和系统的保密性 ,简化系统设计并缩短研制周期等方面正在发挥更大的作用 ,但是因可编程器件与以往的标准逻辑芯片相比有其特殊之处 ,如果没有注意到这些不同点 ,则会给系统的调试和验证工作带来不必要的麻烦。本文结合自己的工作经验 。 展开更多
关键词 通用逻辑阵列 可编程逻辑器件 现场可编程通用门阵列 专用成电路
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基于FPGA集群的脉冲神经网络仿真器设计 被引量:4
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作者 李康 张鲁飞 +4 位作者 张新伟 郁龚健 刘家航 吴东 柴志雷 《计算机工程》 CAS CSCD 北大核心 2020年第10期201-209,共9页
针对类脑计算系统中NEST脉冲神经网络仿真器运行速度慢和功耗高的问题,设计一种基于现场可编程逻辑门阵列(FPGA)集群的NEST脉冲神经网络仿真器。在改进NEST仿真器结构的基础上,提出漏电流整合放电神经元计算模块的流水线并行架构,实现... 针对类脑计算系统中NEST脉冲神经网络仿真器运行速度慢和功耗高的问题,设计一种基于现场可编程逻辑门阵列(FPGA)集群的NEST脉冲神经网络仿真器。在改进NEST仿真器结构的基础上,提出漏电流整合放电神经元计算模块的流水线并行架构,实现支持双核双线程和多节点多进程的FPGA集群设计。在皮质层视觉仿真模型上的实验结果表明,与基于Xeon E5-2620和ARM A9平台的NEST仿真器相比,基于FPGA集群的NEST仿真器计算能效和速度分别提升43.93倍、23.54倍和12.36倍、208倍,能为大规模类脑计算系统实现提供技术支持。 展开更多
关键词 类脑计算系统 脉冲神经网络仿真器 现场可编程逻辑门阵列集群 硬件实现 皮质层视觉仿真模型
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基于FPGA的永磁同步电机零计算延迟扩张控制集模型预测电流控制 被引量:2
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作者 杨辰宇 刘凯 +1 位作者 胡铭觐 花为 《中国电机工程学报》 EI CSCD 北大核心 2024年第S01期264-273,共10页
该文基于现场可编程门阵列(field-programmable gate array,FPGA),为永磁同步电机驱动提出一种扩张控制集模型预测电流控制策略(model predictive current control,MPCC)。由于在每个控制周期内只有8个基本电压矢量可供选择,传统有限控... 该文基于现场可编程门阵列(field-programmable gate array,FPGA),为永磁同步电机驱动提出一种扩张控制集模型预测电流控制策略(model predictive current control,MPCC)。由于在每个控制周期内只有8个基本电压矢量可供选择,传统有限控制集模型预测电流控制(finite control set MPCC,FCS-MPCC)稳态性能较低。为此,文中采用具有818个可选矢量的ECS来实现更精细的电压输出。为减轻因电压矢量大幅增加而带来的计算负担,设计一种简化的最优矢量搜索策略,且可推广用于其他多目标成本函数。基于算法固有并行性,将所提ECS-MPCC方法在FPGA中进行实现,使电流环总控制时间缩短至0.59μs,从而可以消除计算延迟,提高电流环动态性能。最后,通过仿真和实验,验证所提ECS-MPCC策略的有效性。实验结果表明,与传统FCS-MPCC相比,ECS-MPCC的相电流总谐波失真降低77%。 展开更多
关键词 模型预测控制 扩张控制 零计算延迟 现场可编程门阵列实施 永磁同步电机
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改进Camshift算法实时目标跟踪实现
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作者 严飞 徐龙 +2 位作者 陈佳宇 姜栋 刘佳 《计算机工程与设计》 北大核心 2025年第1期314-320,F0003,共8页
为解决Camshift目标跟踪算法在跟踪目标遮挡时陷入局部最大值、跟踪目标快速移动导致跟踪丢失以及光照变化影响跟踪精度一系列问题,提出一种改进Camshift目标跟踪算法。利用自适应权重与H通道特征提取模板,融合Kalman滤波算法并引入巴... 为解决Camshift目标跟踪算法在跟踪目标遮挡时陷入局部最大值、跟踪目标快速移动导致跟踪丢失以及光照变化影响跟踪精度一系列问题,提出一种改进Camshift目标跟踪算法。利用自适应权重与H通道特征提取模板,融合Kalman滤波算法并引入巴氏距离遮挡判别法。非遮挡时,使用Kalman预测调整跟踪搜索区域;遮挡时,使用Kalman预测跟踪。实验结果表明,将改进后算法部署于FPGA硬件平台能够准确地跟踪快速运动、遮挡干扰目标,在1920×1080分辨率下理论跟踪帧率为98.17帧/s,对1080p@60 Hz以及多种分辨率视频输入下平均跟踪重叠率达到84.68%。 展开更多
关键词 目标跟踪 实时 图像处理 硬件加速 卡尔曼滤波 直方图 现场可编程逻辑门阵列
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逻辑控制器设计与离散事件系统监控理论 被引量:8
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作者 罗继亮 邵辉 +1 位作者 吴维敏 苏宏业 《控制理论与应用》 EI CAS CSCD 北大核心 2018年第1期86-91,共6页
物联网等通信技术将越来越多的控制元件集成起来,导致系统规模快速增长,逻辑控制规范也日益复杂,任何逻辑错误都可能造成重大事故和人身灾难,再加上"维数灾"问题,安全可靠的逻辑控制程序的设计和调试面临巨大的计算复杂性难题... 物联网等通信技术将越来越多的控制元件集成起来,导致系统规模快速增长,逻辑控制规范也日益复杂,任何逻辑错误都可能造成重大事故和人身灾难,再加上"维数灾"问题,安全可靠的逻辑控制程序的设计和调试面临巨大的计算复杂性难题.而离散事件系统监控理论旨在研究复杂控制规范的设计和实现问题,将连锁、互斥、字符串语言等复杂控制逻辑描述为自动机或Petri网,然后转换为可编程逻辑控制器或现场可编程门阵列上执行的程序代码.本文综述了现有的逻辑控制器的形式化设计方法,主要涉及如何利用监控理论(自动机或Petri网)来缩短程序开发周期、提高程序可重用性和确保程序可靠性和安全性等问题. 展开更多
关键词 可编程逻辑控制器 离散事件系统 现场可编程门阵列 监控理论
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嵌入式逻辑分析技术及其在FPGA系统开发中的应用 被引量:8
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作者 吕国亮 赵曙光 赵俊 《液晶与显示》 CAS CSCD 北大核心 2007年第2期227-229,共3页
介绍了嵌入式逻辑分析仪,特别是SignalTapⅡ的功能和特点。利用Chip EditorViews、Technology Map Viewer等工具,简要分析了SignalTapⅡ的内部结构和工作原理。结合实例,说明了如何使用SignalTapⅡ调试基于FPGA的数字系统。
关键词 显示控制器 现场可编程门阵列 嵌入式逻辑分析仪 SignalTap
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VHDL在数字集成电路设计中的应用 被引量:11
14
作者 韩进 程勇 齐现英 《山东科技大学学报(自然科学版)》 CAS 2003年第4期74-77,共4页
概述了数字集成电路设计的发展趋势;分析了VHDL的特点;结合实例介绍了VHDL在数字集 成电路设计中的应用方法。
关键词 VHDL 数字成电路 电路设计 硬件描述语言 现场可编程门阵列 FPGA 现场可编程逻辑器件 FPLD
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基于PC的个人逻辑分析仪设计 被引量:6
15
作者 任爱锋 孙肖子 郭万有 《数据采集与处理》 CSCD 2003年第4期479-482,共4页
随着数字系统和计算技术的发展 ,逻辑分析仪在高速硬件逻辑测试和软件状态分析中显得尤其重要。由于目前台式逻辑分析仪的价格比较昂贵 ,使得它不能普遍应用于教学和科研实践中。本文介绍一种基于 PC机增强型并行口的个人逻辑分析仪设... 随着数字系统和计算技术的发展 ,逻辑分析仪在高速硬件逻辑测试和软件状态分析中显得尤其重要。由于目前台式逻辑分析仪的价格比较昂贵 ,使得它不能普遍应用于教学和科研实践中。本文介绍一种基于 PC机增强型并行口的个人逻辑分析仪设计技术。该技术充分利用 PC机的丰富资源 ,通过增强型并行口 ,采用现场可编程门阵列的在系统可重构技术和面向对象的软件设计方法 ,实现数字域的逻辑分析功能 ,其特点灵活、便携。此仪器可广泛应用于电子对抗、雷达。 展开更多
关键词 个人逻辑分析仪 设计 PC机 现场可编程门阵列
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电力谐波检测FFT数字逻辑的设计与实现 被引量:4
16
作者 龚仁喜 刘丰 张海南 《电力系统及其自动化学报》 CSCD 北大核心 2009年第2期57-60,66,共5页
为实现运算高速、强数据吞吐能力的快速傅里叶变换FFT(fast Fourier transform)运算处理器,探讨了基于现场可编程阵列的电力谐波检测FFT数字逻辑的设计方法。该逻辑设计采取了层次化自顶向下的设计模式,对蝶形运算、地址发生、工作存储... 为实现运算高速、强数据吞吐能力的快速傅里叶变换FFT(fast Fourier transform)运算处理器,探讨了基于现场可编程阵列的电力谐波检测FFT数字逻辑的设计方法。该逻辑设计采取了层次化自顶向下的设计模式,对蝶形运算、地址发生、工作存储单元等各模块进行了硬件语言描述,并通过采用复用逻辑及流水线技术,平衡了面积与速度的要求。在电力谐波检测仪原型应用的测试表明,该FFT运算逻辑可稳定运行在60MHz,单帧数据的处理时间为38μs,流水线操作延迟为116 ns,取得了良好的应用效果。 展开更多
关键词 电力谐波检测 快速傅里叶变换 现场可编程门阵列 复用逻辑 流水线
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FPGA动态可重构逻辑设计初探 被引量:8
17
作者 朱明程 黄强 《半导体技术》 CAS CSCD 北大核心 2000年第4期18-21,共4页
介绍了FPGA动态可重构技术的原理,提出一种采用常规SRAM编程FPGA来实现的动态可重构数字逻辑系统设计的新构想,并以小型时序信号发生器为例讨论了这种系统区别于传统数字逻辑系统的设计特点和应用前景。
关键词 现场可编程门阵列 动态可重构 逻辑设计
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多电平通用空间矢量调制集成电路及其FPGA实现 被引量:7
18
作者 宋强 刘文华 《中国电机工程学报》 EI CSCD 北大核心 2008年第12期95-100,共6页
提出一种多电平变流器空间矢量控制(space vector modulation,SVM)集成电路(integrated circuit,IC)的设计方法。所提出的多电平SVMIC是建立在参考电压分解的通用多电平SVM算法的基础上,适用于任何电平数目的多电平变流器。采用可编程... 提出一种多电平变流器空间矢量控制(space vector modulation,SVM)集成电路(integrated circuit,IC)的设计方法。所提出的多电平SVMIC是建立在参考电压分解的通用多电平SVM算法的基础上,适用于任何电平数目的多电平变流器。采用可编程逻辑门阵列(field-programmable gate array,FPGA)实现所提出的多电平SVM IC。基于FPGA的多电平SVM IC具有高速的处理能力,在数字控制器中专门用于脉冲信号的发生,可解决多电平SVM算法占用数字信号处理器(digital signal processor,DSP)计算资源过多的问题,并可实现较高的开关频率。并且采用所提出的多电平SVM IC可大大加速产品的开发周期。通过在1台9电平级联式变流器上的试验结果对所提出的多电平SVM IC进行验证。 展开更多
关键词 现场可编程逻辑门阵列 空间矢量调制 脉冲宽度 调制成电路 数字控制器
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基于FPGA阵列的超大规模SoC验证平台 被引量:3
19
作者 凌翔 胡剑浩 王剑 《系统仿真学报》 EI CAS CSCD 北大核心 2007年第9期1967-1970,共4页
介绍了超大规模片上系统(SoC)验证平台的设计与实现。该验证平台采用多片现场可编程逻辑门阵列(FPGA)构成超大规模FPGA阵列,针对SoC的典型特点设计了平台拓扑结构和组成单元。该验证平台仿真规模大、互连资源丰富、工作频率高、扩展灵... 介绍了超大规模片上系统(SoC)验证平台的设计与实现。该验证平台采用多片现场可编程逻辑门阵列(FPGA)构成超大规模FPGA阵列,针对SoC的典型特点设计了平台拓扑结构和组成单元。该验证平台仿真规模大、互连资源丰富、工作频率高、扩展灵活。应用实例表明该平台具有良好的实用价值。 展开更多
关键词 片上系统 验证平台 仿真 现场可编程逻辑门阵列 原型验证 软硬件协同仿真
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基于BIST的FPGA逻辑单元测试方法 被引量:5
20
作者 吴继娟 孙媛媛 刘桂艳 《哈尔滨工业大学学报》 EI CAS CSCD 北大核心 2004年第8期1074-1076,共3页
给出了一种基于内建自测(BIST)的测试现场可编程门阵列(FPGA)逻辑单元的方法,讨论了测试的配置结构、故障覆盖率和测试中出现的问题及解决办法.实验表明,该测试方法具有所需测试向量少、故障覆盖率高、简便适用等优点.
关键词 BIST FPGA 逻辑单元 现场可编程门阵列 内建自测 响应检验电路 故障覆盖率
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