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一种合并状态度量计算的高效并行Turbo码译码器结构设计及FPGA实现
被引量：
1
1
作者
张茜
詹明
+3 位作者
章坚武
王富龙
冯云开
唐浩
《电信科学》
2022年第2期47-58,共12页
为满足无线通信中高吞吐、低功耗的要求,并行译码器的结构设计得到了广泛的关注。基于并行Turbo码译码算法,研究了前后向度量计算中的对称性,提出了一种基于前后向合并计算的高效并行Turbo码译码器结构设计方案,并进行现场可编程门阵列(...
为满足无线通信中高吞吐、低功耗的要求,并行译码器的结构设计得到了广泛的关注。基于并行Turbo码译码算法,研究了前后向度量计算中的对称性,提出了一种基于前后向合并计算的高效并行Turbo码译码器结构设计方案,并进行现场可编程门阵列(field-programmable gate array,FPGA)实现。结果表明,与已有的并行Turbo码译码器结构相比,本文提出的设计结构使状态度量计算模块的逻辑资源降低50%左右,动态功耗在125 MHz频率下降低5.26%,同时译码性能与并行算法的译码性能接近。
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关键词
状态度量合并计算
TURBO码
FPGA实现
并行算法
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题名
一种合并状态度量计算的高效并行Turbo码译码器结构设计及FPGA实现
被引量：
1
1
作者
张茜
詹明
章坚武
王富龙
冯云开
唐浩
机构
西南大学
杭州电子科技大学
出处
《电信科学》
2022年第2期47-58,共12页
基金
国家自然科学基金资助项目(No.61671390)。
文摘
为满足无线通信中高吞吐、低功耗的要求,并行译码器的结构设计得到了广泛的关注。基于并行Turbo码译码算法,研究了前后向度量计算中的对称性,提出了一种基于前后向合并计算的高效并行Turbo码译码器结构设计方案,并进行现场可编程门阵列(field-programmable gate array,FPGA)实现。结果表明,与已有的并行Turbo码译码器结构相比,本文提出的设计结构使状态度量计算模块的逻辑资源降低50%左右,动态功耗在125 MHz频率下降低5.26%,同时译码性能与并行算法的译码性能接近。
关键词
状态度量合并计算
TURBO码
FPGA实现
并行算法
Keywords
state measure merge calculation
Turbo code
FPGA implementation
parallel algorithm
分类号
TN929 [电子电信—通信与信息系统]
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题名
作者
出处
发文年
被引量
操作
1
一种合并状态度量计算的高效并行Turbo码译码器结构设计及FPGA实现
张茜
詹明
章坚武
王富龙
冯云开
唐浩
《电信科学》
2022
1
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