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基于MRV原理的锁相环抖动BIST电路优化与实现
被引量：
1
1
作者
蔡志匡
徐亮
+2 位作者
任力争
许浩博
时龙兴
《东南大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2014年第3期482-486,共5页
为解决传统基于游标原理锁相环片上抖动测量电路的问题,提出了一种基于多精度游标(MRV)原理的锁相环抖动内建自测试技术.该原理不仅能够大幅降低测量电路面积,同时能够有效保证测量精度,减少锁相环(PVT)的影响.将MRV原理运用在游标延时...
为解决传统基于游标原理锁相环片上抖动测量电路的问题,提出了一种基于多精度游标(MRV)原理的锁相环抖动内建自测试技术.该原理不仅能够大幅降低测量电路面积,同时能够有效保证测量精度,减少锁相环(PVT)的影响.将MRV原理运用在游标延时链(VDL)和游标振荡器(VRO)2种典型技术上.在VDL方案中,由单级延时链改进为两级延时链,分别采用粗细2种不同分辨率的延时单元;在VRO方案中,根据待测信号的范围,通过改变振荡器的控制信号,测量电路动态选择相应的分辨率.在TSMC 130 nm工艺下,分别对2种改进方案进行电路实现,并从分辨率、面积、测量范围、测量误差等方面进行对比分析.
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关键词
锁相环
内建自测试
多精度
游标
抖动
游标延时链
游标
振荡器
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职称材料
一种自参考的可变分辨率片上抖动测量系统
2
作者
解俊杰
杨雅娟
+3 位作者
刘飞
杨海钢
韦援丰
王峰
《微电子学与计算机》
CSCD
北大核心
2015年第11期33-39,45,共8页
提出了一种基于游标延时链结构的可变分辨率片上时钟抖动测量系统.为消除外部参考时钟引入的误差,利用单周期延时模块实现了自参考抖动测量设计.游标延时链由数字可控延时单元构成,测量分辨率可通过选择信号进行设置.数据读出部分采用...
提出了一种基于游标延时链结构的可变分辨率片上时钟抖动测量系统.为消除外部参考时钟引入的误差,利用单周期延时模块实现了自参考抖动测量设计.游标延时链由数字可控延时单元构成,测量分辨率可通过选择信号进行设置.数据读出部分采用真单相时钟D触发器,实现了高速时钟测量.与传统方法相比,此方法无需参考时钟,测量频率范围大,测量分辨率高且可以灵活设置.系统采用0.13μm CMOS工艺设计,电源电压为1.5V.后仿结果表明该系统可测量时钟频率范围为100～800 MHz,最高分辨率可达5.71ps,最大测量量程可达1.4ns.
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关键词
自参考结构
游标延时链
数字可控
延
时
单元
真单相
时
钟
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职称材料
题名
基于MRV原理的锁相环抖动BIST电路优化与实现
被引量：
1
1
作者
蔡志匡
徐亮
任力争
许浩博
时龙兴
机构
东南大学国家专用集成电路系统工程技术研究中心
出处
《东南大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2014年第3期482-486,共5页
基金
国家科技重大专项资助项目(2009ZX01031)
国家高技术研究发展计划(863计划)资助项目(2009AA011701)
国家自然科学基金资助项目(61006029)
文摘
为解决传统基于游标原理锁相环片上抖动测量电路的问题,提出了一种基于多精度游标(MRV)原理的锁相环抖动内建自测试技术.该原理不仅能够大幅降低测量电路面积,同时能够有效保证测量精度,减少锁相环(PVT)的影响.将MRV原理运用在游标延时链(VDL)和游标振荡器(VRO)2种典型技术上.在VDL方案中,由单级延时链改进为两级延时链,分别采用粗细2种不同分辨率的延时单元;在VRO方案中,根据待测信号的范围,通过改变振荡器的控制信号,测量电路动态选择相应的分辨率.在TSMC 130 nm工艺下,分别对2种改进方案进行电路实现,并从分辨率、面积、测量范围、测量误差等方面进行对比分析.
关键词
锁相环
内建自测试
多精度
游标
抖动
游标延时链
游标
振荡器
Keywords
phase-locked loop （PLL）
built-in self-test （BIST）
multi-resolution vernier （MRV）
jitter
vernier delay line （VDL）
vernier ring oscillator （VRO）
分类号
TN47 [电子电信—微电子学与固体电子学]
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职称材料
题名
一种自参考的可变分辨率片上抖动测量系统
2
作者
解俊杰
杨雅娟
刘飞
杨海钢
韦援丰
王峰
机构
中国科学院电子学研究所
中国科学院大学
龙芯中科技术有限公司
出处
《微电子学与计算机》
CSCD
北大核心
2015年第11期33-39,45,共8页
基金
国家自然科学基金(61271149)
文摘
提出了一种基于游标延时链结构的可变分辨率片上时钟抖动测量系统.为消除外部参考时钟引入的误差,利用单周期延时模块实现了自参考抖动测量设计.游标延时链由数字可控延时单元构成,测量分辨率可通过选择信号进行设置.数据读出部分采用真单相时钟D触发器,实现了高速时钟测量.与传统方法相比,此方法无需参考时钟,测量频率范围大,测量分辨率高且可以灵活设置.系统采用0.13μm CMOS工艺设计,电源电压为1.5V.后仿结果表明该系统可测量时钟频率范围为100～800 MHz,最高分辨率可达5.71ps,最大测量量程可达1.4ns.
关键词
自参考结构
游标延时链
数字可控
延
时
单元
真单相
时
钟
Keywords
self-referred architecture
vernier delay line
digitally controlled delay element
true single phase clock
分类号
TN4 [电子电信—微电子学与固体电子学]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于MRV原理的锁相环抖动BIST电路优化与实现
蔡志匡
徐亮
任力争
许浩博
时龙兴
《东南大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2014
1
在线阅读
下载PDF
职称材料
2
一种自参考的可变分辨率片上抖动测量系统
解俊杰
杨雅娟
刘飞
杨海钢
韦援丰
王峰
《微电子学与计算机》
CSCD
北大核心
2015
0
在线阅读
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职称材料
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