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一种高效通用的QC-LDPC译码器架构
被引量：
1
1
作者
刘斌彬
白栋
梅顺良
《计算机工程与科学》
CSCD
2008年第2期119-122,共4页
基于软、硬件结合的方法,本文提出了一种高效通用的QC-LDPC译码器架构。该架构可以对不同码长、码率和校验矩阵结构的规则或非规则QC-LDPC码进行译码,支持Min-Sum近似及其改进译码算法,而且可以实现多种消息传递调度策略。通过将部分复...
基于软、硬件结合的方法,本文提出了一种高效通用的QC-LDPC译码器架构。该架构可以对不同码长、码率和校验矩阵结构的规则或非规则QC-LDPC码进行译码,支持Min-Sum近似及其改进译码算法,而且可以实现多种消息传递调度策略。通过将部分复杂的信息更新交由硬件加速器来完成,提高了译码吞吐量。针对QC-LDPC码校验矩阵准循环的结构,以块为单位对信息进行存储和处理。该架构还可以实现信息的并行处理,而译码器复杂度只有略微增加。
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关键词
译码器架构
QC-LDPC码
Min-Sum近似
消息传递调度
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题名
一种高效通用的QC-LDPC译码器架构
被引量：
1
1
作者
刘斌彬
白栋
梅顺良
机构
清华大学电子工程系
北京大学电子学系
出处
《计算机工程与科学》
CSCD
2008年第2期119-122,共4页
基金
国家航天支撑技术基金资助项目(J04-2005040)
文摘
基于软、硬件结合的方法,本文提出了一种高效通用的QC-LDPC译码器架构。该架构可以对不同码长、码率和校验矩阵结构的规则或非规则QC-LDPC码进行译码,支持Min-Sum近似及其改进译码算法,而且可以实现多种消息传递调度策略。通过将部分复杂的信息更新交由硬件加速器来完成,提高了译码吞吐量。针对QC-LDPC码校验矩阵准循环的结构,以块为单位对信息进行存储和处理。该架构还可以实现信息的并行处理,而译码器复杂度只有略微增加。
关键词
译码器架构
QC-LDPC码
Min-Sum近似
消息传递调度
Keywords
decoder architecture
quasi-cyclic LDPC codes
Min-Sum approximation
message passing scheduling
分类号
TN911.22 [电子电信—通信与信息系统]
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作者
出处
发文年
被引量
操作
1
一种高效通用的QC-LDPC译码器架构
刘斌彬
白栋
梅顺良
《计算机工程与科学》
CSCD
2008
1
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