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大型加速器控制中模式管理器的开发及应用
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作者 甘泉 王春红 +1 位作者 P.CHU 唐靖宇 《原子能科学技术》 EI CAS CSCD 北大核心 2010年第10期1262-1265,共4页
本工作从加速器控制系统的软件设计角度提出并开发了一种管理加速器运行模式和数据的方法,即加速器模式管理器(model manager)。该软件利用Oracle数据库作为加速器运行模式及数据的存储平台,能够绘制和比较加速器各种模式的多种函数曲线... 本工作从加速器控制系统的软件设计角度提出并开发了一种管理加速器运行模式和数据的方法,即加速器模式管理器(model manager)。该软件利用Oracle数据库作为加速器运行模式及数据的存储平台,能够绘制和比较加速器各种模式的多种函数曲线,且提供在线模拟运行加速器的功能,为大型加速器的调试提供方便。该系统已成功用于LCLS加速器。 展开更多
关键词 加速器模式管理器 加速器软件 加速器模式
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软件过程管理预警及异常模式设计与应用
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作者 杜祝平 于磊 +1 位作者 李志博 郭毅 《信息工程大学学报》 2013年第5期629-633,共5页
设计了一种统一的、用于描述软件过程管理预警及异常情形的特征模式,阐述了模式的构成、含义及用法。在此基础上,提出了一种基于软件过程管理信息库及特征模式集的预警及异常监控方法,介绍了该方法的软件结构以及特征模式的定制、预处... 设计了一种统一的、用于描述软件过程管理预警及异常情形的特征模式,阐述了模式的构成、含义及用法。在此基础上,提出了一种基于软件过程管理信息库及特征模式集的预警及异常监控方法,介绍了该方法的软件结构以及特征模式的定制、预处理、解析和信息生成方法等技术细节,从而实现了预警及异常信息一站式获取服务。 展开更多
关键词 软件过程管理 特征模式 预警 异常监控 模式管理器
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基于FPGA的多路高速数据传输同步时延测量系统 被引量:3
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作者 逄锦昊 苏涛 +1 位作者 杨涛 熊梓成 《电子器件》 CAS 北大核心 2015年第2期447-451,共5页
为了测量多路高速数据传输的同步时延,设计了一种同步时延测量系统,采用FPGA的输入输出延迟单元(IODELAYE)和混合模式时钟管理器(MMCM)移动采样点位置,得到不同采样点位置的采样数据,通过计算机分析采样数据,找到传输不稳定的采样点位置... 为了测量多路高速数据传输的同步时延,设计了一种同步时延测量系统,采用FPGA的输入输出延迟单元(IODELAYE)和混合模式时钟管理器(MMCM)移动采样点位置,得到不同采样点位置的采样数据,通过计算机分析采样数据,找到传输不稳定的采样点位置,并计算出同步时延。IODELAYE保证了系统的高精度,通过与MMCM的结合,使系统具有宽量程的特点。测试结果表明,该系统性能稳定,测量误差小于0.2 ns,适用于多路高速数据传输场合。 展开更多
关键词 高速数据传输 同步时延 现场可编程门阵列 输入输出延迟单元 混合模式时钟管理器
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基于FPGA的高分辨率数字时间转换器
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作者 王伟 张瑞峰 《强激光与粒子束》 CAS CSCD 北大核心 2023年第3期155-163,共9页
针对全固态直线变压器驱动源(LTD)中大规模开关同步触发的需求,基于游标法和预相移技术设计了一种全新的双通道同步高分辨率数字时间转换器(DTC)。在原有游标DTC的基础上提前计算不同生成脉冲相位重合位置的关系,通过相位移动和相位检... 针对全固态直线变压器驱动源(LTD)中大规模开关同步触发的需求,基于游标法和预相移技术设计了一种全新的双通道同步高分辨率数字时间转换器(DTC)。在原有游标DTC的基础上提前计算不同生成脉冲相位重合位置的关系,通过相位移动和相位检测使时钟信号提前满足相位关系,以实现同时触发多个不同宽度脉冲信号的目的。详细阐述了DTC的实现原理和电路设计模块,并对其进行了仿真和现场可编程门阵列(FPGA)实现,同时对实现结果进行测试、分析和讨论。在Xilinx ARTIX-7 FPGA开发板上实现了第一个脉冲信号的分辨率为0.85 ps,微分非线性(DNL)和积分非线性(INL)分别为-1.255~1.166 LSB和-7.33~7.05 LSB。第二个脉冲信号分辨率为17.1131 ps,DNL和INL分别为-0.0987~0.105 LSB和-0.717~0.735 LSB,且在0~80℃的环境温度中依旧可以保证DTC的性能。结果表明此DTC具有实现简单、成本低,性能高效等优点。 展开更多
关键词 数字时间转换器 游标法 预相移 模式时钟管理器 同步触发
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