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基于CPLD的曼彻斯特码高速传输系统设计 被引量:5
1
作者 鞠晓东 李会银 《石油大学学报(自然科学版)》 CSCD 北大核心 2003年第4期37-39,43,共4页
介绍了一种基于复杂可编程逻辑器件 (CPLD)的曼彻斯特码高速数据传输系统设计方案。其特点是 :①将曼彻斯特编码、解码及其相关的控制逻辑集成于CPLD中 ,减小了传输系统的规模 ;②工作方式由微处理器 (MPU)编程控制 ,可以根据传输信道... 介绍了一种基于复杂可编程逻辑器件 (CPLD)的曼彻斯特码高速数据传输系统设计方案。其特点是 :①将曼彻斯特编码、解码及其相关的控制逻辑集成于CPLD中 ,减小了传输系统的规模 ;②工作方式由微处理器 (MPU)编程控制 ,可以根据传输信道的特性选择不同的数据格式及传输速率 ,通用性强 ;③输入、输出采用并行方式与先进先出缓冲存储器接口 ,传输过程中无须干预 ,降低了传输系统对MPU的负载 ,有利于系统总体性能的提高。该方案特别适用于实时多任务下的高速数据采集与传输系统。 展开更多
关键词 CPLD 曼彻斯特码 高速传输系统 设计 复杂可编程逻辑器件 数据采集系统 微处理器 传输速率 测井电缆数据传输系统
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基于曼彻斯特码的通信协议设计及实现 被引量:9
2
作者 周青山 王珏 谭辉 《计算机应用》 CSCD 北大核心 2011年第8期2065-2067,2086,共4页
为了在强干扰环境下进行数据的准确传输,设计了一种基于曼彻斯特码的通信协议。协议分为发送模块和接收模块:在发送端,采用了数据打包传输;在接收端,采用了"错位码+计数器"的方法进行时钟同步。协议能有效解决数据边界识别问... 为了在强干扰环境下进行数据的准确传输,设计了一种基于曼彻斯特码的通信协议。协议分为发送模块和接收模块:在发送端,采用了数据打包传输;在接收端,采用了"错位码+计数器"的方法进行时钟同步。协议能有效解决数据边界识别问题和时钟累积误差造成的相位偏差问题。利用设计和制作的硬件实验平台,在模拟的干扰环境中,进行了40 Mbps数据的传输测试。结果表明,该通信协议能够进行数据的准确传输。 展开更多
关键词 曼彻斯特码 通信协议 错位 时钟 相位偏差
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应用曼彻斯特码的海岛间自由空间光通信系统 被引量:3
3
作者 杨杰 邵宇丰 +6 位作者 王安蓉 王壮 胡钦政 伊林芳 田青 于妮 杨骐铭 《光通信研究》 2022年第3期61-64,78,共5页
针对海岛间通信系统存在建设成本高和传输信号需要中继放大等问题,文章采用曼彻斯特编解码设计了一种新型自由空间光(FSO)通信系统,支持100 km海底光缆(采用G.654普通单模光纤)级联1 km FSO无线链路实现10 Gbit/s光信号的收发和传输。... 针对海岛间通信系统存在建设成本高和传输信号需要中继放大等问题,文章采用曼彻斯特编解码设计了一种新型自由空间光(FSO)通信系统,支持100 km海底光缆(采用G.654普通单模光纤)级联1 km FSO无线链路实现10 Gbit/s光信号的收发和传输。文章采用仿真实验测试了无线光信号在晴天、雨天和雾天中传输前后的时域波形、光谱、眼图和误码率(BER)等指标。研究结果表明,光信号接收机灵敏度在背对背系统中为-18.92 dBm;光信号接收机在晴天、雨天和雾天,经100 km海底光缆级联1 km FSO信道传输信号时的灵敏度分别为-17.72、-16.66和-11.16 dBm。相关结果证明,应用曼彻斯特码的海岛间FSO通信系统在未来海域信息传输领域具有重要的潜在应用价值。 展开更多
关键词 自由空间光通信 曼彻斯特码 海岛 光谱
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曼彻斯特码编码与解码硬件实现 被引量:1
4
作者 沈睿 李驿华 《电子测量技术》 2002年第6期1-2,共2页
针对曼彻斯特码传统编码和解码过程中出现的相位模糊问题,通过对曼彻斯特码和信息帧的特点进行分析,给出了一种曼彻斯特码编码与解码的硬件实现新思路,解决了相位模糊的问题,并在工程实践中得到了应用与验证。
关键词 曼彻斯特码 相位模糊 信息帧
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基于FPGA技术的曼彻斯特编码器设计 被引量:14
5
作者 付林 任志平 刘承杰 《现代电子技术》 2007年第17期55-56,59,共3页
曼彻斯特码是一种性能优良的数字基带信号传输码,具有消除直流成分,隐含时钟等特性,使得他在石油勘探测井中有着广泛的应用。从曼彻斯特码的帧结构出发,在阐明曼彻斯特码基本工作原理的基础上,应用FPGA技术,利用硬件描述语言VHDL设计完... 曼彻斯特码是一种性能优良的数字基带信号传输码,具有消除直流成分,隐含时钟等特性,使得他在石油勘探测井中有着广泛的应用。从曼彻斯特码的帧结构出发,在阐明曼彻斯特码基本工作原理的基础上,应用FPGA技术,利用硬件描述语言VHDL设计完成曼彻斯特编码器,所设计的系统包含使能、复位、同步字的产生以及奇校验等功能,所编写的VHDL源程序经Altera公司的软件Max+PlusⅡ进行调试、优化及仿真,仿真结果与理论分析完全吻合。 展开更多
关键词 VHDL FPGA 曼彻斯特码
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1553B总线中曼彻斯特编解码器的设计 被引量:8
6
作者 武鹏 毕君懿 《现代电子技术》 2011年第4期61-64,共4页
曼彻斯特编解码器是1553B总线协议的重要组成部分,其性能的好坏直接影响整个系统的通信质量。通过分析MIL-STD-1553B协议和GJB5186测试标准,制定出编解码器的设计规范。采用硬件描述语言(Verilog)设计电路,VCS对设计进行仿真,并利用Synp... 曼彻斯特编解码器是1553B总线协议的重要组成部分,其性能的好坏直接影响整个系统的通信质量。通过分析MIL-STD-1553B协议和GJB5186测试标准,制定出编解码器的设计规范。采用硬件描述语言(Verilog)设计电路,VCS对设计进行仿真,并利用Synplify Pro及ISE完成综合和布局布线的工作,最后载入Xilinx FPGA进行测试。在深入分析曼彻斯特码型特点的基础上,对编解码器的工作过程及逻辑电路结构进行详细介绍。提出的时钟分离电路比超前滞后数字锁相环更为简单有效。 展开更多
关键词 曼彻斯特码 MIL-STD-1553B总线 时钟分离 FPGA
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基于FPGA的1553B总线曼彻斯特编解码器设计与实现 被引量:18
7
作者 潘亮 司斌 +1 位作者 张从霞 张鹏 《航空兵器》 北大核心 2018年第2期83-88,共6页
曼彻斯特码作为一种数字编码技术,具有自带时钟、无直流分量等优点,在数字通信系统中具有广泛的应用。本文在分析曼彻斯特编解码原理和1553B总线协议以及收发器HI-1573工作时序的基础上,利用ISE14.7开发环境,采用VHDL语言,基于Xilinx公... 曼彻斯特码作为一种数字编码技术,具有自带时钟、无直流分量等优点,在数字通信系统中具有广泛的应用。本文在分析曼彻斯特编解码原理和1553B总线协议以及收发器HI-1573工作时序的基础上,利用ISE14.7开发环境,采用VHDL语言,基于Xilinx公司Spartan6型FPGA实现通用型和可定制的曼彻斯特Ⅱ型编解码器设计,并通过ISE Simulator和XST进行时序仿真和综合优化,仿真结果验证了设计方案的逻辑功能。最后搭建UART硬件测试平台,验证了设计方案的硬件可实现性。 展开更多
关键词 曼彻斯特码 编解原理 1553B总线 VHDL FPGA
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一种基于DSP的曼彻斯特Ⅱ码解析系统 被引量:1
8
作者 陈超波 张鹏 +1 位作者 何宁 李永兴 《兵工自动化》 2011年第9期65-67,80,共4页
为提高曼彻斯特Ⅱ码解析系统的灵活性和准确性,降低系统的硬件成本,设计一种基于DSP的曼彻斯特Ⅱ码解析系统。在深入分析曼彻斯特Ⅱ码信号特点的基础上,将经测井电缆传输后曼彻斯特Ⅱ码信号经过调理电路、限幅放大电路和整形及正负分离... 为提高曼彻斯特Ⅱ码解析系统的灵活性和准确性,降低系统的硬件成本,设计一种基于DSP的曼彻斯特Ⅱ码解析系统。在深入分析曼彻斯特Ⅱ码信号特点的基础上,将经测井电缆传输后曼彻斯特Ⅱ码信号经过调理电路、限幅放大电路和整形及正负分离电路的处理后,送至DSP内部的脉冲捕获单元,最后由软件算法进行解析。实验结果表明:曼彻斯特Ⅱ码解析系统设计合理,满足生产测井过程中常规测井作业的需求。 展开更多
关键词 曼彻斯特 解析 整形 限幅 脉冲捕获
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Manchester解码器的锁相环实现 被引量:5
9
作者 周益 高爽 +1 位作者 颜廷洋 杨德伟 《仪器仪表学报》 EI CAS CSCD 北大核心 2007年第S1期142-145,共4页
本文提出了一种应用于油井测斜遥传系统的Manchester码信道解码方式的实现方案。Manchester码是串行数据传输的一种重要的编码方式,具有丰富的时钟信息。本方案通过FPGA平台和由硬件语言Verilog实现的超前—滞后型全数字锁相环(LL-DPLL... 本文提出了一种应用于油井测斜遥传系统的Manchester码信道解码方式的实现方案。Manchester码是串行数据传输的一种重要的编码方式,具有丰富的时钟信息。本方案通过FPGA平台和由硬件语言Verilog实现的超前—滞后型全数字锁相环(LL-DPLL)实现了Manchester码解码器的设计,它解决了接收端解调时的时钟同步问题,可以动态跟踪时钟,为遥测系统中数据传输准确性的提高提供了可靠的保证。实验结果表明:此解码器能很好地提取时钟,在数据传输上误码率也小于10-5,满足设计要求。跟模拟电路设计相比,该设计更易于与原有系统集成、实现方便、性能稳定;同时比同步脉冲法等其他数字方法的抗干扰性能上也有明显的提高。 展开更多
关键词 曼彻斯特码 数字锁相环 VERILOGHDL
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基于IEC60044-8标准的电子式电流互感器数字输出编码模块的FPGA实现 被引量:5
10
作者 朱雷 盛春波 郑绳楦 《电力自动化设备》 EI CSCD 北大核心 2006年第8期67-70,共4页
介绍了电子式电流互感器国际电工委员会标准IEC60044-8的链路层规则,设计了数据组帧编码模块。针对帧格式中的循环冗余校验(CRC)校验码,通过详细的计算推导,设计出8位并行CRC逻辑电路并应用于现场可编程门阵列(FPGA),在MAX+PlusⅡ环境... 介绍了电子式电流互感器国际电工委员会标准IEC60044-8的链路层规则,设计了数据组帧编码模块。针对帧格式中的循环冗余校验(CRC)校验码,通过详细的计算推导,设计出8位并行CRC逻辑电路并应用于现场可编程门阵列(FPGA),在MAX+PlusⅡ环境下进行了仿真,与串行CRC相比,并行CRC的编码速度大为提高。在物理层,将完整的数据帧进行曼彻斯特编码后通过光纤传输至间隔层。实践证明,该方案实时性强、准确度高,具有广泛的应用价值。 展开更多
关键词 电子式电流互感器 循环冗余校验 现场可编程门阵列 曼彻斯特码
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高速曼码解码器及其I^2C接口的FPGA实现 被引量:1
11
作者 亓成宇 史晓锋 《电子测量技术》 2011年第10期53-56,95,共5页
针对测井系统中高波特率的数据传输要求,提出了1种曼彻斯特码解码器及其I2 C接口的FPGA实现方案,利用Altera Cyclone II系列的EP2C8T144C8N芯片完成硬件解码功能,以取代低波特率下的单片机软件解码,提高了系统传输速率和稳定性。文中具... 针对测井系统中高波特率的数据传输要求,提出了1种曼彻斯特码解码器及其I2 C接口的FPGA实现方案,利用Altera Cyclone II系列的EP2C8T144C8N芯片完成硬件解码功能,以取代低波特率下的单片机软件解码,提高了系统传输速率和稳定性。文中具体讨论了该系统的解码电路、FIFO缓存,以及与后级处理器之间的I2 C接口在FPGA中的VHDL描述方法。着重分析了基于电平宽度检测的曼码解码原理和I2 C接口的单进程状态机设计思想。经过软件综合仿真及硬件电路调试,该解码系统可在大于12.5kBps的波特率下稳定可靠地工作。 展开更多
关键词 曼彻斯特码 I2C接口 状态机 FPGA
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WDM-PON中基于码型动态切换的组播实现方案
12
作者 葛凌志 肖石林 +4 位作者 刘智鑫 朱敏 蔡磊 丁道梓 肖涛 《光通信技术》 CSCD 北大核心 2010年第4期6-8,共3页
提出了一种利用码型动态切换的机制来实现波分复用无源光网络中组播业务的传输。组播业务采用DPSK调制格式,下行单播业务采用动态切换的Manchester/NRZ调制格式。其中Manchester调制格式是由下行单播数据和同频的时钟信号通过电逻辑异... 提出了一种利用码型动态切换的机制来实现波分复用无源光网络中组播业务的传输。组播业务采用DPSK调制格式,下行单播业务采用动态切换的Manchester/NRZ调制格式。其中Manchester调制格式是由下行单播数据和同频的时钟信号通过电逻辑异或门产生。实验验证了同时传输5Gb/s下行点对点信号和1.25Gb/s组播信号的WDM-PON组播传输方案的可行性。 展开更多
关键词 无源光网络 组播 波分复用 曼彻斯特码 马赫曾德干涉仪
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电子式互感器合并单元(MU)的研究与设计 被引量:29
13
作者 刘琨 周有庆 +1 位作者 彭红海 吴桂清 《电力自动化设备》 EI CSCD 北大核心 2006年第4期67-71,共5页
合并单元是电子式互感器与二次保护控制设备接口的重要组成部分。简要介绍了电子式互感器合并单元的基本定义及相关国际标准,同时对合并单元的主要功能和实现方法进行了研究,提出了一种基于现场可编程门阵列(FPGA)和数字信号处理(DSP)... 合并单元是电子式互感器与二次保护控制设备接口的重要组成部分。简要介绍了电子式互感器合并单元的基本定义及相关国际标准,同时对合并单元的主要功能和实现方法进行了研究,提出了一种基于现场可编程门阵列(FPGA)和数字信号处理(DSP)技术的合并单元实现方案。方案将合并单元分成3个功能模块,并对每个模块所需实现的功能进行了详细阐述和具体分析。试验结果证明该方案能够很好地解决合并单元同时处理任务多、通信信息流量大及通信速度快等一系列问题,具有较高的可靠性和较强的实时性。 展开更多
关键词 电子式互感器 ROGOWSKI线圈 合并单元 现场可编程门阵列 曼彻斯特码 中心采样
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动态二进制树搜索算法的改进 被引量:12
14
作者 向垂益 何怡刚 +1 位作者 李兵 方葛丰 《计算机工程》 CAS CSCD 北大核心 2010年第2期260-262,265,共4页
在RFID系统中,为了解决多个标签同时与阅读器交换数据引起的碰撞问题,改进基于退避思想的动态二进制树搜索算法。在ISO14443标准TYPEA卡的基础上,采用现场可编程门阵列设计并实现,使用VHDL语言进行编程。仿真结果表明改进算法具有更高... 在RFID系统中,为了解决多个标签同时与阅读器交换数据引起的碰撞问题,改进基于退避思想的动态二进制树搜索算法。在ISO14443标准TYPEA卡的基础上,采用现场可编程门阵列设计并实现,使用VHDL语言进行编程。仿真结果表明改进算法具有更高的数据采用频率和数据传送准确率。 展开更多
关键词 射频识别 现场可编程门阵列 防碰撞算法 曼彻斯特码
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采用激光供能方法的光纤电流互感器 被引量:5
15
作者 刘丰 卢启柱 +1 位作者 毕卫红 郑绳楦 《仪表技术与传感器》 CSCD 北大核心 2007年第5期5-6,17,共3页
研制了一种新型的电流互感器,高压端采用Rogowski线圈作为电流传感头。传感头输出信号经A/D转换器变成数字量后编码成曼彻斯特码,由塑料光纤发送到低压端,用激光供能的方法为高压端的电子器件提供能源。低压端用D/A转换器恢复母线电流... 研制了一种新型的电流互感器,高压端采用Rogowski线圈作为电流传感头。传感头输出信号经A/D转换器变成数字量后编码成曼彻斯特码,由塑料光纤发送到低压端,用激光供能的方法为高压端的电子器件提供能源。低压端用D/A转换器恢复母线电流信号。该方法克服了传统电磁式电流互感器的固有缺点,也解决了直接从电力母线获得高压端电子器件工作能量的方法所带来的死区问题,加快了电子式电流互感器的实用化进程。 展开更多
关键词 光供能 电流互感器 ROGOWSKI线圈 曼彻斯特码
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一种功率变换器分布式主从通信控制结构 被引量:5
16
作者 任强 孙驰 +1 位作者 肖飞 艾胜 《海军工程大学学报》 CAS 北大核心 2017年第2期51-56,共6页
针对现有分布式控制结构中的一些不足,首先基于曼彻斯特码,将整个系统控制功能分为主从两级,主控制器执行顶层运算功能,从控制器执行底层控制功能,从而有效地降低了单个控制器的设计难度和控制任务;然后,分析了主从式控制结构的同步网... 针对现有分布式控制结构中的一些不足,首先基于曼彻斯特码,将整个系统控制功能分为主从两级,主控制器执行顶层运算功能,从控制器执行底层控制功能,从而有效地降低了单个控制器的设计难度和控制任务;然后,分析了主从式控制结构的同步网络、故障网络、数据网络的基本原理和实现方法,并提出了一种基于曼彻斯特码的数据通信方式,其通信速率高达40 Mb/s,可较好地满足绝大多数10kHz级开关频率的中大功率电力电子系统应用;最后,针对实验样机,对所提出的主从式通信控制结构的同步误差、故障处理以及数据通信进行了实验验证,结果表明了该种控制结构的正确性和可行性。 展开更多
关键词 功率变换器 分布式主从结构 曼彻斯特码 通信控制结构
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陀螺测斜仪地面测控系统 被引量:2
17
作者 宗艳波 林国钧 史晓锋 《电子测量技术》 2006年第2期133-135,共3页
文中介绍了基于DSP的陀螺测斜仪地面测控系统,用软件实现曼彻斯特码的编码/解码,系统软硬件设计相对简单,测试结果在LCD上显示。
关键词 数字信号处理器 曼彻斯特码 测控系统
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基于DSP的测井信号采集处理系统
18
作者 高嵩 郭伟 +1 位作者 潘泉 何宁 《电子测量技术》 2007年第12期154-157,共4页
测井技术的发展要求地面仪能够兼容多种传输方式,提高用户选择井下仪的灵活性;本文介绍一种基于TMS320F241的测井信号采集处理板的软硬件设计,以曼彻斯特码为例介绍用数字信号处理的方法实现信号的采集和处理的过程.数字信号处理器(DSP... 测井技术的发展要求地面仪能够兼容多种传输方式,提高用户选择井下仪的灵活性;本文介绍一种基于TMS320F241的测井信号采集处理板的软硬件设计,以曼彻斯特码为例介绍用数字信号处理的方法实现信号的采集和处理的过程.数字信号处理器(DSP)通过软件完成测井信号的实时采集和处理,能够配接多种传输方式的井下仪器.基于所设计的系统,通过对几种测井信号进行实验测试的结果表明,本系统所采用的数字信号处理算法能够很好地实现相应信号的处理。 展开更多
关键词 信号采集 测井信号 曼彻斯特码 数字信号处理器
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FPGA在非接触IC卡读卡器中应用
19
作者 孙宏军 姜印平 王超 《电子测量技术》 2002年第6期28-29,共2页
文中提出基于FPGA的非接触IC卡读卡器解决方案,本系统利用FPGA实现曼彻斯特码的解码、处理和发送功能。与单片机方案比较,具有处理速度快、抗干扰能力强、识别率高等优点。
关键词 FPGA 非接触IC卡 读卡器 曼彻斯特码 可编程逻辑器件
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基于FPGA的提取位同步时钟DPLL设计 被引量:7
20
作者 叶怀胜 谭南林 +1 位作者 苏树强 李国正 《现代电子技术》 2009年第23期43-46,共4页
提出一种基于FPGA的用于提取位同步时钟的片内全数字锁相环电路设计方案。该方案具有同步速度快,结构简洁,失锁后自我调节性能好,即使码元消失或是码元相位出现抖动时,提取的同步时钟也不会有较大变化,仍可以稳定输出。此外,该方案可以... 提出一种基于FPGA的用于提取位同步时钟的片内全数字锁相环电路设计方案。该方案具有同步速度快,结构简洁,失锁后自我调节性能好,即使码元消失或是码元相位出现抖动时,提取的同步时钟也不会有较大变化,仍可以稳定输出。此外,该方案可以稳定地从曼彻斯特码中提取出位时钟,指导编解码器可靠工作。采用Verilog HDL语言描述电路,给出了仿真结果,并对其稳定性和稳态误差进行了理论分析,以实际测验验证了仿真的正确性。 展开更多
关键词 全数字锁相环 曼彻斯特码 VERILOG硬件描述语言 位同步
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