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基于SystemC的SoC行为级软硬件协同设计
被引量：
9
1
作者
张奇
曹阳
+1 位作者
李栋娜
马秦生
《计算机工程》
EI
CAS
CSCD
北大核心
2005年第19期217-219,共3页
针对目前SoC设计中存在的软硬件协同验证的时间瓶颈问题,提出了一种使用系统建模语言SystemC对SoC进行总线周期精确行为级建模的方法,采用该方法构建SoC芯片总线周期精确行为级模型进行前期验证。该模型基于32位RISC构建,并可配置其它...
针对目前SoC设计中存在的软硬件协同验证的时间瓶颈问题,提出了一种使用系统建模语言SystemC对SoC进行总线周期精确行为级建模的方法,采用该方法构建SoC芯片总线周期精确行为级模型进行前期验证。该模型基于32位RISC构建,并可配置其它硬件模块。实验结果表明:模型完全仿真实际硬件电路,所有的接口信号在系统时钟的任一时刻被监测和分析,很大程度地提高了仿真速度,并且可以在前期作系统的软硬件协同仿真和验证,有效地缩短了目前SoC芯片设计中在RTL级作软硬件协同仿真验证时的时间开销。
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关键词
SYSTEMC
总线周期精确行为级
片上系统
精简指令集处理器
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职称材料
题名
基于SystemC的SoC行为级软硬件协同设计
被引量：
9
1
作者
张奇
曹阳
李栋娜
马秦生
机构
武汉大学电子信息学院
出处
《计算机工程》
EI
CAS
CSCD
北大核心
2005年第19期217-219,共3页
基金
国家"863"计划基金资助项目(2002AA1Z1490)
文摘
针对目前SoC设计中存在的软硬件协同验证的时间瓶颈问题,提出了一种使用系统建模语言SystemC对SoC进行总线周期精确行为级建模的方法,采用该方法构建SoC芯片总线周期精确行为级模型进行前期验证。该模型基于32位RISC构建,并可配置其它硬件模块。实验结果表明:模型完全仿真实际硬件电路,所有的接口信号在系统时钟的任一时刻被监测和分析,很大程度地提高了仿真速度,并且可以在前期作系统的软硬件协同仿真和验证,有效地缩短了目前SoC芯片设计中在RTL级作软硬件协同仿真验证时的时间开销。
关键词
SYSTEMC
总线周期精确行为级
片上系统
精简指令集处理器
Keywords
SystemC
Bus-cycle-accurate reference level
System on chip（SoC）
Reduced instruction set computer （RISC）
分类号
TP311 [自动化与计算机技术—计算机软件与理论]
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题名
作者
出处
发文年
被引量
操作
1
基于SystemC的SoC行为级软硬件协同设计
张奇
曹阳
李栋娜
马秦生
《计算机工程》
EI
CAS
CSCD
北大核心
2005
9
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