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阵列探测器L1触发系统加法电路优化设计
1
作者
张晰
千奕
+3 位作者
王晓辉
李良辉
杨振雷
苏弘
《核电子学与探测技术》
CAS
北大核心
2015年第12期1212-1215,共4页
针对兰州重离子加速器外靶终端硅微条阵列探测器L1触发系统,设计了一个基于Xilinx7系列FPGA芯片的改进加法逻辑电路,利用快速进位链结构,对加法电路模块进行优化。对优化后加法电路结构和同类传统加法电路比较,并对逻辑时延进行和结构...
针对兰州重离子加速器外靶终端硅微条阵列探测器L1触发系统,设计了一个基于Xilinx7系列FPGA芯片的改进加法逻辑电路,利用快速进位链结构,对加法电路模块进行优化。对优化后加法电路结构和同类传统加法电路比较,并对逻辑时延进行和结构性能建模分析。仿真和测试结果表明:优化后模块逻辑时延3 ns左右,相比传统加法逻辑,系统死时间低,有效采集事例率高,能够满足L1触发系统的要求。
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关键词
硅微条阵列探测器
死时间
现场可编程逻辑门阵列
L1触发
快速进位加法器
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职称材料
题名
阵列探测器L1触发系统加法电路优化设计
1
作者
张晰
千奕
王晓辉
李良辉
杨振雷
苏弘
机构
中国科学院近代物理研究所
中国科学院大学
出处
《核电子学与探测技术》
CAS
北大核心
2015年第12期1212-1215,共4页
基金
国家自然科学基金(11475233
11305233)资助
文摘
针对兰州重离子加速器外靶终端硅微条阵列探测器L1触发系统,设计了一个基于Xilinx7系列FPGA芯片的改进加法逻辑电路,利用快速进位链结构,对加法电路模块进行优化。对优化后加法电路结构和同类传统加法电路比较,并对逻辑时延进行和结构性能建模分析。仿真和测试结果表明:优化后模块逻辑时延3 ns左右,相比传统加法逻辑,系统死时间低,有效采集事例率高,能够满足L1触发系统的要求。
关键词
硅微条阵列探测器
死时间
现场可编程逻辑门阵列
L1触发
快速进位加法器
Keywords
silicon micro-strip array detector
dead time
FPGA
L1 sub-trigger system
fast carry logic adder
分类号
TL8 [核科学技术—核技术及应用]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
阵列探测器L1触发系统加法电路优化设计
张晰
千奕
王晓辉
李良辉
杨振雷
苏弘
《核电子学与探测技术》
CAS
北大核心
2015
0
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