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DSP专用高速乘法器的设计
1
作者
李磊
何春
曾波
《微电子学与计算机》
CSCD
北大核心
2008年第6期57-59,62,共4页
介绍了一种DSP专用高速乘法器的设计方法.该乘法器采用了最优化Booth编码算法,降低了部分乘积的数目,采用Wallace Tree最优化的演算法和快速超前进位加法器来进一步提高电路的运算速度.该乘法器在一个时钟周期内可以完成16位有符号/无...
介绍了一种DSP专用高速乘法器的设计方法.该乘法器采用了最优化Booth编码算法,降低了部分乘积的数目,采用Wallace Tree最优化的演算法和快速超前进位加法器来进一步提高电路的运算速度.该乘法器在一个时钟周期内可以完成16位有符号/无符号二进制数乘法运算和复乘运算,在slow corner下最高频率可达220MHz以上.本乘法器是一DSP内核的专用乘法单元,整个设计简单高效.
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关键词
乘
法器
Booth编码算法
Wallace树形结构
快速超前进位加法器
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职称材料
题名
DSP专用高速乘法器的设计
1
作者
李磊
何春
曾波
机构
电子科技大学电科院
出处
《微电子学与计算机》
CSCD
北大核心
2008年第6期57-59,62,共4页
文摘
介绍了一种DSP专用高速乘法器的设计方法.该乘法器采用了最优化Booth编码算法,降低了部分乘积的数目,采用Wallace Tree最优化的演算法和快速超前进位加法器来进一步提高电路的运算速度.该乘法器在一个时钟周期内可以完成16位有符号/无符号二进制数乘法运算和复乘运算,在slow corner下最高频率可达220MHz以上.本乘法器是一DSP内核的专用乘法单元,整个设计简单高效.
关键词
乘
法器
Booth编码算法
Wallace树形结构
快速超前进位加法器
Keywords
multiplier
optimal Booth coder
optimal Wallace Tree
FCLA
分类号
TN4 [电子电信—微电子学与固体电子学]
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作者
出处
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1
DSP专用高速乘法器的设计
李磊
何春
曾波
《微电子学与计算机》
CSCD
北大核心
2008
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