基于ADSP21160的并行信号处理技术 被引量：5

1

作者 孙靖国 牛文生 邹会荣 《计算机工程》 CAS CSCD 北大核心 2002年第9期241-243,共3页

介绍了高端信号处理应用领域中对并行处理技术的需求,讨论了选用ADSP-21160作为并行信号处理机的处理器时并行结构的选择与实现。

关键词 ADSP21160 并行信号处理 数字信号处理 数字信号处理器 共享存储器 分布存储器

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基于TMS320C6701高速并行信号处理平台的设计 被引量：5

2

作者 刘宇 王岩飞 杨汝良 《现代雷达》 CSCD 北大核心 2003年第3期18-20,共3页

80年代初 ,数字信号处理器 (DSP)在合成孔径雷达 (Synthetic Aperture Radar,简称 SAR)实时成像处理中得到了应用。随着 SAR技术的发展 ,对实时成像处理器的数据处理能力提出更高要求。本文介绍了如何设计出高速并行信号处理平台来满足 ... 80年代初 ,数字信号处理器 (DSP)在合成孔径雷达 (Synthetic Aperture Radar,简称 SAR)实时成像处理中得到了应用。随着 SAR技术的发展 ,对实时成像处理器的数据处理能力提出更高要求。本文介绍了如何设计出高速并行信号处理平台来满足 SAR系统对实时成像处理器的要求 。 展开更多

关键词 TMS320C6701 合成孔径雷达 实时成像 并行信号处理 脉冲压缩 DSP

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基于并行信号处理的手持式夜视系统设计与实现

3

作者 孙斌 张俊举 +2 位作者 常本康 杨锋 韩博 《红外与激光工程》 EI CSCD 北大核心 2014年第4期1338-1343,共6页

针对国内夜视技术落后于国外的现状,研制了一种手持式夜视系统,该系统具有红外单通道显示、可见光单通道显示和融合显示三个工作模式。采用了基于双DSP+FPGA结构的并行信号处理技术,解决了红外与可见光拉普拉斯融合算法在传统硬件平台... 针对国内夜视技术落后于国外的现状,研制了一种手持式夜视系统,该系统具有红外单通道显示、可见光单通道显示和融合显示三个工作模式。采用了基于双DSP+FPGA结构的并行信号处理技术,解决了红外与可见光拉普拉斯融合算法在传统硬件平台上无法实时运行的问题。针对系统在每次上电时出现的图像混乱现象,提出了一种基于FPGA的自适应图像拼接方法,实现了并行系统清晰完整的图像显示。实验结果表明,系统运行速度快,输出图像效果好,实用性强。 展开更多

关键词 并行信号处理 夜视系统 红外成像 图像融合

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用于实孔径成像制导雷达的并行信号处理结构

4

作者 周智敏 常文革 梁甸农 《系统工程与电子技术》 EI CSCD 1996年第7期1-8,共8页

本文研究了一种用于小型实孔径成像制导雷达的并行信号处理结构，采用并行加流水的处理方式解决了成像算法的复杂性与实时性之间的矛盾。研制了基于并行处理结构的原理性信号处理样机，取得了满意的实验结果。

关键词 成像雷达 制导雷达 并行信号处理 雷达

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基于双核DSP的科氏质量流量计并行信号处理 被引量：1

5

作者 胡国栋 冯正平 毕安元 《舰船科学技术》 北大核心 2020年第5期97-101,共5页

科里奥利质量流量计可直接测量介质质量流量与密度,因而被广泛应用于海洋石油领域。针对单处理器难以保证CMF信号处理实时性要求的问题,基于双核DSP设计了多任务分布的CMF并行信号处理方法。完成数据采集与数字滤波计算任务的预处理进... 科里奥利质量流量计可直接测量介质质量流量与密度,因而被广泛应用于海洋石油领域。针对单处理器难以保证CMF信号处理实时性要求的问题,基于双核DSP设计了多任务分布的CMF并行信号处理方法。完成数据采集与数字滤波计算任务的预处理进程与完成频率检测与相位差检测任务的后处理进程以并行方式分布在双核DSP中,2个进程之间通过核间中断进行同步。为了验证相位差检测实时性与精度,构建了CMF信号处理验证平台。实验结果表明,基于双核DSP的CMF并行信号处理方法具有更高的精度与实时性。 展开更多

关键词 科里奥利质量流量计 相位差检测 并行信号处理 进程同步 实验平台

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高性能通用并行信号处理模块的设计与实现 被引量：12

6

作者 胡善清 刘峰 龙腾 《计算机工程》 CAS CSCD 北大核心 2007年第5期252-254,257,共4页

为满足信号处理领域不断增长的任务需求并适应不同的应用场合,设计高性能通用并行信号处理模块,进而构建各类信号处理系统是一种趋势。基于对共享总线和分布式两种并行结构的理论分析,结合信号处理系统的特点,设计了一种高性能通用并行... 为满足信号处理领域不断增长的任务需求并适应不同的应用场合,设计高性能通用并行信号处理模块,进而构建各类信号处理系统是一种趋势。基于对共享总线和分布式两种并行结构的理论分析,结合信号处理系统的特点,设计了一种高性能通用并行信号处理模块,它具有标准化、模块化、可扩展、可重构、混合并行模式、多层次互联的特性,通过构建典型信号处理系统验证了这些特性。 展开更多

关键词 信号处理:并行处理 TS201 FPGA

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超声相控阵控制、采集与全并行处理系统设计 被引量：5

7

作者 孔超 冀映辉 +4 位作者 蔡炜 谢时根 师芳芳 陈铭 蔡慧智 《应用声学》 CSCD 北大核心 2011年第2期105-111,共7页

针对超声相控阵检测系统工作环境较为恶劣、延时发射电路复杂、多路信号的采集难以单板实现以及多路信号处理实时性差等问题,提出了一种基于CPCI总线和FPGA的超声相控阵控制、采集与全并行处理系统的设计。本设计采用CPCI总线架构,可以... 针对超声相控阵检测系统工作环境较为恶劣、延时发射电路复杂、多路信号的采集难以单板实现以及多路信号处理实时性差等问题,提出了一种基于CPCI总线和FPGA的超声相控阵控制、采集与全并行处理系统的设计。本设计采用CPCI总线架构,可以在高尘、高冲击负荷等恶劣环境下工作,采用带高速串行LVDS接口的ADS445与XC5VSX95T相组合的方式来实现单板16路信号的高速信号采集和全并行处理,采用XC5VSX95T中的高速计数器来实现2ns的高精度延时发射,还提供了功能强大的主控软件便于用户操作。分析结果表明,多路AD+FPGA的硬件结构特别适合相控阵系统。实测结果表明,本系统可以较好地对钢管的缺陷进行实时检测和A扫与B扫成像。 展开更多

关键词 CPCI总线 FPGA 超声相控阵 AD 并行信号处理

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光学相干探测系统多信号处理性能的研究

8

作者 邓德迎 何宁 廖欣 《激光技术》 CAS CSCD 北大核心 2011年第2期249-251,共3页

针对复杂而密集的电磁环境下多信号共存与传输的特点,为解决光学相干接收系统多信号的同时处理能力,基于声光偏转原理,设计了采用声光偏转技术和光纤相干光探测相结合的测频系统,对不同频率信号的声光互作用和光束偏转进行分析,通过对... 针对复杂而密集的电磁环境下多信号共存与传输的特点,为解决光学相干接收系统多信号的同时处理能力,基于声光偏转原理,设计了采用声光偏转技术和光纤相干光探测相结合的测频系统,对不同频率信号的声光互作用和光束偏转进行分析,通过对多频互调的数值仿真,给出了减小多信号互作用下互调现象的解决方案。构建了实验平台,将空间光注入到光纤进行信号复用和传输处理。结果表明,系统对信号的实时捕获能力强,在系统带宽内实现了多信号载频的同时测量,经测试频率分辨率优于0.1MHz,截获率为100%。 展开更多

关键词 激光技术 并行信号处理 相干探测 声光偏转

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一种距离高分辨力雷达实时信号处理机的设计与实现

9

作者 张永杰 范晓波 +1 位作者 王俊 李少洪 《信号处理》 CSCD 北大核心 2007年第5期672-675,共4页

现代高性能的雷达系统对雷达信号处理系统的计算能力、存储能力以及传输能力等提出了更高的要求。以多片高性能的数字信号处理器(DSP)为运算核心,通过高速数据连接网络构成的并行信号处理系统能够满足系统的高速复杂的运算以及大的数据... 现代高性能的雷达系统对雷达信号处理系统的计算能力、存储能力以及传输能力等提出了更高的要求。以多片高性能的数字信号处理器(DSP)为运算核心,通过高速数据连接网络构成的并行信号处理系统能够满足系统的高速复杂的运算以及大的数据吞吐量的要求。本文在详细分析某型距离高分辨力雷达信号处理机的需求的基础上,提出了适合该雷达信号处理机的系统结构,并采用8片ADI的超高性能浮点DSP芯片—ADSP-TS201S为核心设计并实现了一种高速实时并行信号处理机。该处理机的设计充分考虑了雷达实时信号处理的特点,遵循可编程、可扩展、可重构的原则,为系统性能的提升提供了较大的空间,并可用来构造多种不同需求的雷达信号处理系统。目前,该信号处理机已经调试成功并通过了外场试验。 展开更多

关键词 实时信号处理 ADSP-TS201S 高分辨力雷达 并行信号处理

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宽带并行处理技术的应用研究 被引量：1

10

作者 朱然刚 钟子发 +1 位作者 许阳明 张云峰 《现代防御技术》 北大核心 2009年第2期91-94,123,共5页

从无线电监测测向设备的发展需求出发,研究了并行多通道高速数据采集、并行DSP处理的工程实践问题。测试并分析了自主研发超短波无线电监测系统终端处理设备的处理速度、采样有效位数、实际信噪比、传输速度等核心技术指标,实验证明系... 从无线电监测测向设备的发展需求出发,研究了并行多通道高速数据采集、并行DSP处理的工程实践问题。测试并分析了自主研发超短波无线电监测系统终端处理设备的处理速度、采样有效位数、实际信噪比、传输速度等核心技术指标,实验证明系统性能稳定可靠。 展开更多

关键词 同步采集 并行数字信号处理 海量存储 SOPC

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光纤水听器阵列信号实时解调系统设计与实现 被引量：1

11

作者 江磊 王海斌 +1 位作者 黄晓砥 陈德胜 《压电与声光》 CSCD 北大核心 2011年第3期353-356,377,共5页

随着现代高性能光纤水听器阵列技术发展,对信号实时解调系统的计算能力、存储能力及传输能力等提出了更高的要求。该文在分析干涉型光纤水听器相位载波(PGC)解调方案的基础上,提出了适合该算法的实时解调系统结构,并采用多片数字信号处... 随着现代高性能光纤水听器阵列技术发展,对信号实时解调系统的计算能力、存储能力及传输能力等提出了更高的要求。该文在分析干涉型光纤水听器相位载波(PGC)解调方案的基础上,提出了适合该算法的实时解调系统结构,并采用多片数字信号处理器(DSP)为核心设计实现了一种高速实时解调系统。该实时解调系统的设计充分考虑了PGC信号处理的特点,遵循可编程、可扩展、可重构的原则,为系统性能的提升提供了较大的空间。目前,该实时解调系统已调试成功并通过了外场试验。 展开更多

关键词 光纤水听器阵列 相位载波(PGC)算法 并行信号处理

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软件无线电体系结构中的总线瓶颈及其解决方案 被引量：3

12

作者 张玉良 吴伟陵 《电讯技术》 北大核心 2002年第5期20-23,共4页

软件无线电系统中的模块化、数字式通用硬件平台是进行实时信息处理的并行处理系统 ,其总体性能取决于系统中信号处理、信息传递和存储能力的优化设计。

关键词 软件无线电 体系结构 总线 并行信号处理 SWR

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基于RDMA的RapidIO用户态通信接口实现

13

作者 冀映辉 张建东 +1 位作者 蔡炜 蔡惠智 《计算机科学》 CSCD 北大核心 2010年第6期293-296,共4页

作为一款高性能的嵌入式互联协议,RapidIO支持RDMA操作以获得高性能。目前,针对RapidIO通信接口只有以太网模拟器,这种实现机制限制了RapidIO通信性能的发挥。参考国内外基于RDMA的通信协议实现方法,并结合RapidIO互联协议的特点,提出... 作为一款高性能的嵌入式互联协议,RapidIO支持RDMA操作以获得高性能。目前,针对RapidIO通信接口只有以太网模拟器,这种实现机制限制了RapidIO通信性能的发挥。参考国内外基于RDMA的通信协议实现方法,并结合RapidIO互联协议的特点,提出了一套基于RDMA技术的RapidIO用户态通信接口实现方法。在此基础上,验证了通信接口的性能并对实现方案进行了多种优化。经比较,实现的RapidIO通信接口数据吞吐量是目前所有已知的RapidIO通信接口中最高的。 展开更多

关键词 RAPIDIO 远程直接内存存取 用户态通信接口 并行信号处理系统

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基于FPGA的AIS中频收发信机设计及实现 被引量：1

14

作者 郑力 钟杰 《电讯技术》 北大核心 2010年第8期129-133,共5页

针对海事自动识别系统(Automatic Identification System,AIS)收发信机的信号处理主要采用专用芯片实现的现状,提出了一种中频数字化的替代方案,采用FPGA完成AIS中频收发信机的信号处理。重点研究了突发GMSK中频信号的调制、差分解调、... 针对海事自动识别系统(Automatic Identification System,AIS)收发信机的信号处理主要采用专用芯片实现的现状,提出了一种中频数字化的替代方案,采用FPGA完成AIS中频收发信机的信号处理。重点研究了突发GMSK中频信号的调制、差分解调、位同步和帧同步的设计方法及实现过程。测试结果表明,采用并行化的数字信号处理,增强了设备的灵活性和可靠性,并提高了设备的性能。 展开更多

关键词 自动识别系统 收发信机 中频数字化 并行数字信号处理

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基于FPGA的阵列雷达矩阵算法研究

15

作者 杨露 张得礼 +2 位作者 王苑 张文奇 杨永常 《现代雷达》 CSCD 北大核心 2023年第7期1-8,共8页

针阵列雷达矩阵运算中的两种最具有代表性的矩阵求逆与线性方程组求解进行详细分析与方法实现。针对复杂的大数据量的矩阵运算,采用传统中央处理器(CPU)串行计算方式会大量引起的消耗大量CPU资源与时间的问题,提出了一种采用CPU+现场可... 针阵列雷达矩阵运算中的两种最具有代表性的矩阵求逆与线性方程组求解进行详细分析与方法实现。针对复杂的大数据量的矩阵运算,采用传统中央处理器(CPU)串行计算方式会大量引起的消耗大量CPU资源与时间的问题,提出了一种采用CPU+现场可编程门阵列(FPGA)硬件加速实现异构计算的方法。该方法为算法移植到FPGA芯片实现,针对循环迭代的串行计算,利用FPGA丰富的逻辑资源实现并行执行,利用FPGA内置的寄存器与随机存取存储器(RAM)资源实现大量的中间变量的缓存,利用FPGA内置的硬核数字信号处理器(DSP)资源实现数学计算加速,从而达到节约计算时间,节省CPU资源消耗的目的。开展基于FPGA硬件实现的高性能矩阵并行计算技术的研究,以满足高性能矩阵计算的高维、实时性和高精度等技术指标。实验结果表明采用基于CPU+FPGA硬件芯片的异构计算的时间小于原本单纯采用CPU计算的时间,且随着矩阵维度的增加即计算的复杂性与计算量的增加差异越明显。 展开更多

关键词 并行信号处理 可编程门阵列 异构计算 矩阵计算

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