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一种抗噪声折叠宽范围低杂散小数分频锁相环
1
作者
蔡剑茹
尹勇生
+2 位作者
滕海林
杨文杰
孟煦
《合肥工业大学学报（自然科学版）》
CAS
北大核心
2023年第12期1666-1670,1693,共6页
由于电荷泵的电流失配,小数分频锁相环反馈路径上经整形的量化噪声会被折叠回低频偏处,恶化带内相位噪声的性能。文章提出一种自适应的抗噪声折叠技术,根据工作频率产生合适脉宽的电流以线性化环路,在全频带内避免噪声折叠的同时不恶化...
由于电荷泵的电流失配,小数分频锁相环反馈路径上经整形的量化噪声会被折叠回低频偏处,恶化带内相位噪声的性能。文章提出一种自适应的抗噪声折叠技术,根据工作频率产生合适脉宽的电流以线性化环路,在全频带内避免噪声折叠的同时不恶化参考杂散性能;设计基于TSMC 130 nm CMOS工艺,锁相环覆盖的输出频率范围为0.6~2.7 GHz。仿真结果显示:当输出频率为2.0 GHz时,环路功耗为16 mW,积分抖动为1.98 ps,品质因数为-222 dB;在电荷泵中引入8%的失配后,提出的技术改善带内相位噪声达到7 dB。
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关键词
小数分频锁相环
噪声
折叠
带内相位噪声
参考杂散
低抖动
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职称材料
题名
一种抗噪声折叠宽范围低杂散小数分频锁相环
1
作者
蔡剑茹
尹勇生
滕海林
杨文杰
孟煦
机构
合肥工业大学微电子设计研究所
合肥工业大学教育部IC设计网上合作研究中心
出处
《合肥工业大学学报（自然科学版）》
CAS
北大核心
2023年第12期1666-1670,1693,共6页
基金
国家自然科学基金资助项目(61704043)。
文摘
由于电荷泵的电流失配,小数分频锁相环反馈路径上经整形的量化噪声会被折叠回低频偏处,恶化带内相位噪声的性能。文章提出一种自适应的抗噪声折叠技术,根据工作频率产生合适脉宽的电流以线性化环路,在全频带内避免噪声折叠的同时不恶化参考杂散性能;设计基于TSMC 130 nm CMOS工艺,锁相环覆盖的输出频率范围为0.6~2.7 GHz。仿真结果显示:当输出频率为2.0 GHz时,环路功耗为16 mW,积分抖动为1.98 ps,品质因数为-222 dB;在电荷泵中引入8%的失配后,提出的技术改善带内相位噪声达到7 dB。
关键词
小数分频锁相环
噪声
折叠
带内相位噪声
参考杂散
低抖动
Keywords
fractional-N phase locked loop(PLL)
noise folding
in-band phase noise
reference spur
low jitter
分类号
TN911.8 [电子电信—通信与信息系统]
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题名
作者
出处
发文年
被引量
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1
一种抗噪声折叠宽范围低杂散小数分频锁相环
蔡剑茹
尹勇生
滕海林
杨文杰
孟煦
《合肥工业大学学报（自然科学版）》
CAS
北大核心
2023
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