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基于伪布尔可满足性的纳米CMOS电路单元配置 被引量:4
1
作者 王先建 王伦耀 +1 位作者 储著飞 夏银水 《电子与信息学报》 EI CSCD 北大核心 2012年第10期2508-2513,共6页
针对传统布尔可满足性(SAT)法在处理纳米CMOS电路(CMOL)单元配置时,存在合取范式(CNF)表示的约束子句个数过多、中间处理文件过大的问题,该文提出了利用伪布尔可满足性(PBS)来解决CMOL电路的单元配置问题。实验结果显示,相对于传统的SAT... 针对传统布尔可满足性(SAT)法在处理纳米CMOS电路(CMOL)单元配置时,存在合取范式(CNF)表示的约束子句个数过多、中间处理文件过大的问题,该文提出了利用伪布尔可满足性(PBS)来解决CMOL电路的单元配置问题。实验结果显示,相对于传统的SAT法,PBS法在不增加额外的布尔变量集个数的条件下,通过降低编码过程中的约束个数,能有效减少中间处理文件大小,达到提高算法效率和提高处理大电路的能力。 展开更多
关键词 纳米CMOS电路 单元配置 布尔可满足性 布尔可满足性
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基于布尔可满足性的层次化通路时延故障测试 被引量:3
2
作者 杨德才 谢永乐 陈光 《电子测量与仪器学报》 CSCD 2008年第3期6-10,共5页
针对现代VLSI电路趋向于层次化的设计,本文提出了基于布尔可满足性的层次化通路时延故障测试方法,采用面向模块级的增量布尔可满足性合取范式的提取,从高到低层次化实现了关键通路的判别及子式生成。利用电路的时延测试条件蕴涵并转化... 针对现代VLSI电路趋向于层次化的设计,本文提出了基于布尔可满足性的层次化通路时延故障测试方法,采用面向模块级的增量布尔可满足性合取范式的提取,从高到低层次化实现了关键通路的判别及子式生成。利用电路的时延测试条件蕴涵并转化为相应的约束子句,有利于将冲突尽早提前,以减少搜索空间。通过将已有的判别模块储存起来,作为学习子句,避免重复判别,极大的加快了子式的提取且降低了求解的规模和难度。仿真结果表明本文方案具有测试时间短、效率高,特别适合于具有模块化、规则化结构的层次化设计电路。 展开更多
关键词 布尔可满足性 时延故障测试 层次化电路
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基于布尔可满足性的精确逻辑综合综述 被引量:3
3
作者 储著飞 潘鸿洋 《电子与信息学报》 EI CSCD 北大核心 2023年第1期14-23,共10页
逻辑综合是电子设计自动化(EDA)的重要步骤,随着算力逐渐提升和新的计算范式不断涌现,传统基于全局启发式算法的逻辑综合面临新的挑战。启发式算法面临的主要问题是得到一个次优解,随着算力的提升,逻辑优化越来越追求精确解而不满足于... 逻辑综合是电子设计自动化(EDA)的重要步骤,随着算力逐渐提升和新的计算范式不断涌现,传统基于全局启发式算法的逻辑综合面临新的挑战。启发式算法面临的主要问题是得到一个次优解,随着算力的提升,逻辑优化越来越追求精确解而不满足于次优解。该文首先简述逻辑函数表达方法和布尔可满足性(SAT)问题;其次针对精确综合的算法、编码等方面介绍了在布尔逻辑网络的面积优化和深度优化方面的精确综合研究进展;最后对精确综合的未来发展趋势进行讨论。 展开更多
关键词 逻辑综合 精确综合 布尔可满足性 多数逻辑门
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结合逻辑模拟和布尔可满足性的设计错误诊断方法
4
作者 曾松伟 李光辉 《现代电子技术》 2010年第6期22-25,37,共5页
在集成电路设计验证与调试过程中,逻辑错误诊断工具通常会给出一定数量的候选错误区域,然后通过特定的算法尽可能多地减少候选区域,以方便错误的准确定位。在此提出一种结合模拟与布尔可满足性(SAT)的错误诊断方法,用于提高错误诊断准... 在集成电路设计验证与调试过程中,逻辑错误诊断工具通常会给出一定数量的候选错误区域,然后通过特定的算法尽可能多地减少候选区域,以方便错误的准确定位。在此提出一种结合模拟与布尔可满足性(SAT)的错误诊断方法,用于提高错误诊断准确性。该方法首先使用模拟方法对候选的错误区域逐一进行判断,对于不能由模拟方法判别的候选区域,使用基于SAT的形式化方法进一步判断。针对ISCAS′85电路的实验结果表明,该方法具有较高的错误诊断准确性和效率。 展开更多
关键词 设计验证 错误诊断 布尔可满足性 逻辑模拟
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基于布尔可满足性的组合电路ATPG算法 被引量:1
5
作者 邓雨春 杨士元 邢建辉 《计算机工程与应用》 CSCD 北大核心 2003年第7期78-80,84,共4页
布尔可满足性被深入研究并广泛应用于电子设计自动化等领域。该文提出了一种基于布尔可满足性的组合电路ATPG改进算法。在采用当前最新布尔可满足性求解程序加速策略的基础上,比如冲突驱动训练、冲突导向回跳和重启动技术等,引入电路结... 布尔可满足性被深入研究并广泛应用于电子设计自动化等领域。该文提出了一种基于布尔可满足性的组合电路ATPG改进算法。在采用当前最新布尔可满足性求解程序加速策略的基础上,比如冲突驱动训练、冲突导向回跳和重启动技术等,引入电路结构信息来实现基于结构的分支决策。通过新增的电路结构信息层,布尔可满足性求解程序只需稍加修改,就能利用和及时更新此信息。最后给出的实验结果表明了算法的可行性和有效性。 展开更多
关键词 布尔可满足性 ATPG算法 组合电路 数字电路 电子设计自动化 电路结构
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基于布尔可满足性的电路设计错误诊断算法 被引量:2
6
作者 吴洋 唐璞山 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2006年第9期1383-1390,共8页
提出了一种组合电路设计错误诊断算法,该算法结合传统基于模拟的方法和可满足性问题求解技术,在不依赖于故障模型的条件下实现对电路逻辑错误的诊断定位.提出了基于布尔可满足性的增量式电路诊断方法,通过对可满足解依据电路结构信息筛... 提出了一种组合电路设计错误诊断算法,该算法结合传统基于模拟的方法和可满足性问题求解技术,在不依赖于故障模型的条件下实现对电路逻辑错误的诊断定位.提出了基于布尔可满足性的增量式电路诊断方法,通过对可满足解依据电路结构信息筛选分级,提高了多错误诊断定位的分辨率和准确性;并提出多项启发式方法,避免了大量不必要的操作,使算法在时间和内存上保持有效性.实验结果表明,利用形式验证的技术来导向模拟的过程,抓住了高复杂度的多错误定位问题的特征,提高了电路错误诊断的效率. 展开更多
关键词 设计错误诊断 布尔可满足性 电子设计自动化
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基于消息传递关系网络的布尔可满足性预测 被引量:1
7
作者 包冬庆 葛宁 +1 位作者 翟树茂 张莉 《软件学报》 EI CSCD 北大核心 2022年第8期2839-2850,共12页
布尔可满足性求解能够验证的问题规模通常受限,因此,如何高精度地预测其可满足性既是重要的研究问题,也是一项具有挑战性的工作.相关研究工作一般使用由文字节点和子句节点组成的图来表示布尔可满足性问题的结构,但是这种表征方法缺少... 布尔可满足性求解能够验证的问题规模通常受限,因此,如何高精度地预测其可满足性既是重要的研究问题,也是一项具有挑战性的工作.相关研究工作一般使用由文字节点和子句节点组成的图来表示布尔可满足性问题的结构,但是这种表征方法缺少了变量、子句之间的重要关系信息.在所提方法中,通过将原始布尔可满足性问题实例表征为多关系异构图的方式来表达变量和句子之间的关系,并设计使用消息传递关系网络模型来捕获实例的关系信息,提取了更多的结构特征.结果表明:该模型在预测精度、泛化能力和资源需求等方面均优于现有模型,对所选数据集的平均预测精度为81%.该模型在小规模问题(变量数为100)上训练,在大规模数据集上预测的平均预测精度达到了80.8%.同时,该模型对随机生成的非均匀随机问题的预测精度达到99%,这意味着它学习了预测可满足性的重要特征.此外,模型预测所花费的时间随着问题规模的增大也只是成线性增长.总结而言,基于关系消息传递网络提出了一个预测精度更高、泛化能力更好的布尔可满足性预测方法. 展开更多
关键词 布尔可满足性问题 消息传递网络 结构特征 满足预测 多关系异构图
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在形式验证和ATPG中的布尔可满足性问题
8
作者 邓雨春 杨士元 +1 位作者 王红 薛月菊 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2003年第10期1207-1212,共6页
介绍布尔可满足性 (SAT)求解程序在测试向量自动生成、符号模型检查、组合等价性检查和RTL电路设计验证等电子设计自动化领域中的应用 着重阐述如何在算法中有机地结合电路拓扑结构及其与特定应用相关的信息 ,以便提高问题求解效率
关键词 数字电路 电路设计自动化 形式验证 ATPG 布尔可满足性
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基于布尔可满足性的伪码捕获方法
9
作者 王景 易波 《计算机应用研究》 CSCD 北大核心 2011年第8期3100-3102,共3页
为了提高扩频通信系统中伪码序列的检测概率,同时降低捕获时间,提出了一种基于布尔可满足性(SAT)的伪码捕获算法,首先将扩频通信中的捕获算法通过面向模块级的布尔可满足性合取范式进行建模,然后利用先进的SAT求解技术对模型进行求解,... 为了提高扩频通信系统中伪码序列的检测概率,同时降低捕获时间,提出了一种基于布尔可满足性(SAT)的伪码捕获算法,首先将扩频通信中的捕获算法通过面向模块级的布尔可满足性合取范式进行建模,然后利用先进的SAT求解技术对模型进行求解,从而达到对伪码序列捕获的目的。理论方法和仿真结果表明,该方法能够有效提高捕获过程的检测概率,并降低捕获时间。 展开更多
关键词 伪码捕获 伪码相位同步 有序二叉判决图 布尔可满足性
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用于神经布尔可满足性问题求解器的新型消息传递网络
10
作者 梁永濠 李金龙 《计算机应用》 2025年第9期2934-2940,共7页
为优化端到端神经布尔可满足性问题(SAT)求解器的消息传递神经网络(MPNN)结构、减少求解过程中的迭代次数并提升求解器性能,提出一种更多更深的消息传递网络(MDMPN)。该网络通过引入整体消息传递模块,在每次消息传递迭代中实现从文字节... 为优化端到端神经布尔可满足性问题(SAT)求解器的消息传递神经网络(MPNN)结构、减少求解过程中的迭代次数并提升求解器性能,提出一种更多更深的消息传递网络(MDMPN)。该网络通过引入整体消息传递模块,在每次消息传递迭代中实现从文字节点到子句节点的额外的整体消息传递,从而传递更多的消息。同时,引入消息跳跃模块,实现从文字节点到它的二阶邻居的消息传递,从而传递更深的消息。为了评估MDMPN的性能与泛化能力,将它应用于目前先进的神经SAT求解器QuerySAT和基础神经SAT求解器NeuroSAT。实验结果表明,在困难随机的3-SAT数据集上,应用MDMPN的QuerySAT的求解性能优于标准的QuerySAT,在求解包含600个变量迭代次数上限为212的困难3-SAT问题上的准确率提高了46.12个百分点;应用MDMPN的NeuroSAT的求解性能也优于标准的NeuroSAT,在求解包含600个变量迭代次数上限为212的困难3-SAT问题上的准确率提高了35.69个百分点。 展开更多
关键词 布尔可满足性问题 消息传递神经网络 图神经网络 机器学习 人工智能
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加强约束的布尔可满足硬件求解器 被引量:1
11
作者 马柯帆 肖立权 +2 位作者 张建民 黎铁军 周善祥 《国防科技大学学报》 EI CAS CSCD 北大核心 2018年第6期105-111,共7页
利用现场可编程门阵列固有的并行性和灵活性,提出在硬件可编程平台上基于随机局部搜索算法的布尔可满足性求解器,用于求解大规模的布尔可满足性问题。相对其他求解器,该求解器的预处理技术能极大提高求解效率;其变元加强策略避免了同一... 利用现场可编程门阵列固有的并行性和灵活性,提出在硬件可编程平台上基于随机局部搜索算法的布尔可满足性求解器,用于求解大规模的布尔可满足性问题。相对其他求解器,该求解器的预处理技术能极大提高求解效率;其变元加强策略避免了同一变元被反复连续翻转,降低了搜索陷入局部最优的可能。评估结果表明,求解器最多能处理32 000个变元/128 000个子句的实例。相比当前同类型的求解器,其求解效率明显提高。 展开更多
关键词 现场可编程门阵列 布尔可满足性 加强约束 不完全算法
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基于几何规划的布尔可满足问题求解方法
12
作者 何安平 吴尽昭 +2 位作者 梁艺 熊玲芳 吴昊 《计算机工程与科学》 CSCD 北大核心 2013年第9期122-126,共5页
布尔可满足问题是计算机科学中诸多领域的重要问题,它的快速求解具有十分重要的意义。将具有实际物理背景的Solar算法中的拟物算法与几何规划相结合,提出并实现了一种布尔可满足性问题的连续求解方法。经实验验证,这种算法对布尔可满足... 布尔可满足问题是计算机科学中诸多领域的重要问题,它的快速求解具有十分重要的意义。将具有实际物理背景的Solar算法中的拟物算法与几何规划相结合,提出并实现了一种布尔可满足性问题的连续求解方法。经实验验证,这种算法对布尔可满足性问题的求解具有一定的实用价值。 展开更多
关键词 布尔可满足性 拟物拟人算法(Solar) 几何规划
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EDA领域中可满足性问题求解方法研究
13
作者 王秀芹 王昊 马光胜 《计算机科学》 CSCD 北大核心 2009年第9期17-20,31,共5页
可满足性问题是理论计算机和人工智能中的著名问题,很多问题都可以通过可满足性求解方法解决。对EDA领域中可满足性问题的求解技术进行了研究。总结了目前主要的求解方法,并对不同的方法进行了详细的分类和比较。讨论了该领域研究中存... 可满足性问题是理论计算机和人工智能中的著名问题,很多问题都可以通过可满足性求解方法解决。对EDA领域中可满足性问题的求解技术进行了研究。总结了目前主要的求解方法,并对不同的方法进行了详细的分类和比较。讨论了该领域研究中存在的问题,并指出了近期研究热点和未来发展趋势。 展开更多
关键词 布尔可满足性 电子设计自动化 求解方法
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基于SAT问题实例特性的端到端SAT求解模型
14
作者 龙峥嵘 李金龙 梁永濠 《计算机应用研究》 CSCD 北大核心 2024年第11期3376-3381,共6页
当前基于神经网络的端到端SAT求解模型在各类SAT问题求解上展现了巨大潜力。然而SAT问题难以容忍误差存在,神经网络模型无法保证不产生预测误差。为利用SAT问题实例特性来减少模型预测误差,提出了错误偏好变量嵌入架构(architecture of ... 当前基于神经网络的端到端SAT求解模型在各类SAT问题求解上展现了巨大潜力。然而SAT问题难以容忍误差存在,神经网络模型无法保证不产生预测误差。为利用SAT问题实例特性来减少模型预测误差,提出了错误偏好变量嵌入架构(architecture of embedding error-preference variables, AEEV)。该架构包含错误偏好变量嵌入调整算法和动态部分标签训练模式。首先,为利用参与越多未满足子句的变量越可能被错误分类这一特性,提出了错误偏好变量嵌入调整算法,在消息传递过程中根据变量参与的未满足子句个数来调整其嵌入。此外,提出了动态部分标签监督训练模式,该模式利用了SAT问题实例的变量赋值之间存在复杂依赖关系这一特性,避免为全部变量提供标签,仅为错误偏好变量提供一组来自真实解的标签,保持其他变量标签为预测值不变,以在训练过程管理一个更小的搜索空间。最后,在3-SAT、k-SAT、k-Coloring、3-Clique、SHA-1原像攻击以及收集的SAT竞赛数据集上进行了实验验证。结果表明,相较于目前较先进的基于神经网络的端到端求解模型QuerySAT,AEEV在包含600个变量的k-SAT数据集上准确率提升了45.81%。 展开更多
关键词 布尔可满足性问题 消息传递网络 机器学习
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基于两次量子搜索的K子集和问题求解
15
作者 叶天语 吴恒 甘志刚 《通信学报》 北大核心 2025年第7期182-190,共9页
针对K子集和问题,提出了一种基于两次量子搜索的高效量子算法。第一次量子搜索通过变异Grover算子生成包含所有元素个数为K的子集的量子叠加态;具体地,首先通过Oracle算子进行相位翻转标记所有含K个元素的子集,然后通过扩散算子放大标... 针对K子集和问题,提出了一种基于两次量子搜索的高效量子算法。第一次量子搜索通过变异Grover算子生成包含所有元素个数为K的子集的量子叠加态;具体地,首先通过Oracle算子进行相位翻转标记所有含K个元素的子集,然后通过扩散算子放大标记的目标子集的概率幅值。第二次量子搜索则通过另一个变异Grover算子从所有元素个数为K的子集中找到K个元素和等于目标值的子集;具体地,首先通过特定的和校验Oracle算子标记所有的元素和等于目标值且只含K个元素的子集,然后通过扩散算子放大标记子集的概率幅值。仿真实验结果表明,所提方法准确率大于或等于89%,较现有方法准确率更高。 展开更多
关键词 K子集和问题 GROVER量子搜索算法 布尔可满足性问题 量子线路
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电路宽度制导的布尔推理 被引量:3
16
作者 李光辉 邵明 李晓维 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2004年第11期1568-1574,共7页
在基于逻辑电路的布尔推理过程中 ,经常用到二叉判决图 (BDD)与布尔可满足性 (SAT)相结合的算法 由于电路宽度能很好地反映电路的复杂性 ,提出了一种基于电路宽度的启发式策略 ,根据电路宽度来实现SAT算法与BDD算法的交替 充分发挥两... 在基于逻辑电路的布尔推理过程中 ,经常用到二叉判决图 (BDD)与布尔可满足性 (SAT)相结合的算法 由于电路宽度能很好地反映电路的复杂性 ,提出了一种基于电路宽度的启发式策略 ,根据电路宽度来实现SAT算法与BDD算法的交替 充分发挥两者的优势 ,不仅可以防止因构造BDD可能导致的内存爆炸 ,而且还能避免SAT算法可能遇到的超时现象 与以往同类策略相比 ,该启发式策略更节省计算资源 ,提高算法性能 针对组合电路的测试产生实验 。 展开更多
关键词 电路宽度 布尔推理 二叉判决图 布尔可满足性 测试产生
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基于SAT的安全协议惰性形式化分析方法 被引量:2
17
作者 顾纯祥 王焕孝 +2 位作者 郑永辉 辛丹 刘楠 《通信学报》 EI CSCD 北大核心 2014年第11期117-125,共9页
提出了一种基于布尔可满足性问题的安全协议形式化分析方法 SAT-LMC,通过引入惰性分析的思想优化初始状态与转换规则,提高了安全性的检测效率。另一方面,通过在消息类型上定义偏序关系,SAT-LMC能够检测出更丰富的类型缺陷攻击。基于此... 提出了一种基于布尔可满足性问题的安全协议形式化分析方法 SAT-LMC,通过引入惰性分析的思想优化初始状态与转换规则,提高了安全性的检测效率。另一方面,通过在消息类型上定义偏序关系,SAT-LMC能够检测出更丰富的类型缺陷攻击。基于此方法实现了一个安全协议分析工具,针对Otway-Rees协议检测出了一种类型缺陷攻击;针对OAuth2.0协议,检测结果显示对现实中存在的一些应用场景,存在一种利用授权码截取的中间人攻击。 展开更多
关键词 安全协议 形式化分析 布尔可满足性 分析 类型缺陷攻击
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结合变量决策层和全局学习率的启发式优化算法
18
作者 何飞 王晓峰 +3 位作者 唐傲 华盈盈 彭庆媛 王军霞 《计算机应用研究》 北大核心 2025年第2期441-447,共7页
冲突驱动子句学习(conflict-driven clause learning,CDCL)是现代SAT求解器的主流框架,而基于变量活性的分支算法是其高效求解的关键因素之一。将全局学习率(global learning rate,GLR)和变量决策层结合分析,得到两个有关CDCL搜索行为... 冲突驱动子句学习(conflict-driven clause learning,CDCL)是现代SAT求解器的主流框架,而基于变量活性的分支算法是其高效求解的关键因素之一。将全局学习率(global learning rate,GLR)和变量决策层结合分析,得到两个有关CDCL搜索行为的重要推论:在GLR较高时,增加低决策层变量的碰撞分数可以降低搜索成本;而在GLR较低时,增加高决策层变量的碰撞分数可以充分探索解空间。通过实验数据分析,验证了两个推论的正确性。依据推论,提出一种结合GLR和变量决策层的Gdb启发式策略来优化现有分支算法,Gdb使用变量决策层设计两个权重w_(1)和w_(2),分别用于较高和较低GLR情况下的变量活性。此外,还分析了EVSIDS和LRB两个分支算法的搜索行为,并针对LRB进行再次加权。实验结果表明,Gdb分支策略有效提升了CDCL求解器的效率。 展开更多
关键词 布尔可满足性问题 CDCL 分支策略 GLR 变量决策层
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不可满足子式在谓词抽象中的应用与分析
19
作者 张建民 黎铁军 +2 位作者 张峻 庞征斌 李思昆 《计算机应用》 CSCD 北大核心 2014年第A01期273-276,共4页
随着软硬件设计的规模越来越大,功能越来越复杂,往往导致形式化验证出现"组合爆炸"问题,而谓词抽象方法是解决状态空间"组合爆炸"问题的重要技术之一。面向硬件的谓词抽象方法是不可满足子式的典型应用,通过求解不... 随着软硬件设计的规模越来越大,功能越来越复杂,往往导致形式化验证出现"组合爆炸"问题,而谓词抽象方法是解决状态空间"组合爆炸"问题的重要技术之一。面向硬件的谓词抽象方法是不可满足子式的典型应用,通过求解不可满足子式,能够减少谓词抽象过程中精化迭代的次数,从而提高形式化验证效率。针对微处理器的指令Cache部件,将两种最小不可满足子式的求解算法进行了比较,结果表明贪心遗传算法在运行效率方面优于分支-限界算法。并且深入分析了不可满足子式在硬件谓词抽象中的作用,以及如何加速芯片的形式化验证过程。 展开更多
关键词 功能验证 形式化方法 谓词抽象 布尔可满足性 最小不可满足子式
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一种加速FPGA布线的不可满足子式求解算法
20
作者 张建民 黎铁军 +1 位作者 马柯帆 肖立权 《电子学报》 EI CAS CSCD 北大核心 2021年第6期1210-1216,共7页
随着VLSI(Very Large Scale Integrated)芯片设计的规模越来越大,功能越来越复杂,在FPGA(Field Programmable Gate Array)上实现或进行原型验证时,往往会出现布线拥塞或无法布通的情况.而不可满足子式能够迅速诊断FPGA无法布通的原因,... 随着VLSI(Very Large Scale Integrated)芯片设计的规模越来越大,功能越来越复杂,在FPGA(Field Programmable Gate Array)上实现或进行原型验证时,往往会出现布线拥塞或无法布通的情况.而不可满足子式能够迅速诊断FPGA无法布通的原因,并且精确定位关键线网.针对如何加速FPGA详细布线过程,提出了一种基于消解否证的启发式局部搜索算法,能够快速从布尔公式中提取不可满足子式.基于典型的FPGA布线测试集,与两种求解最小不可满足子式效率最高的算法进行了比较,结果表明局部搜索算法在运行效率方面显著优于分支限界算法与贪心遗传算法,而局部搜索算法也能得到最小不可满足子式;并且深入分析了不可满足子式在FPGA详细布线中的作用,能够加速芯片的设计与验证过程. 展开更多
关键词 FPGA布线 布线约束 布尔可满足性 不可满足子式 局部搜索 消解否证
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