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面向嵌入式微处理器的高性能视频编解码算法 被引量:2
1
作者 李青燕 田军 《现代电子技术》 北大核心 2024年第10期34-38,共5页
针对高清和超高清视频,嵌入式微处理器在进行视频编解码时常常会受到资源的限制,导致输出的视频画面出现模糊的情况。为此,提出一种面向嵌入式微处理器的高性能视频编解码算法。利用最小平均绝对值误差作为匹配准则指标,预判断高性能视... 针对高清和超高清视频,嵌入式微处理器在进行视频编解码时常常会受到资源的限制,导致输出的视频画面出现模糊的情况。为此,提出一种面向嵌入式微处理器的高性能视频编解码算法。利用最小平均绝对值误差作为匹配准则指标,预判断高性能视频的失真率损耗,计算图像中最大交流系数总能量,获取高细节分块,感知运动视频;利用空时域条件下的边缘图获取视频编码的相邻像素权重,通过像素间距离获取超像素为前景区域的概率,对目标前景区域编码;采用最小化范数优化编码视频约束条件,利用拉格朗日乘子等价转换编码视频,根据训练冗余字典计算视频解码校正因子,完成最终的视频编解码。经实验证明,所提方法能有效地完成高性能视频编解码,保证视频质量,视频的编码率一直处于31.3 dB,相对稳定。 展开更多
关键词 嵌入式微处理器 视频编码 视频解码 边缘信息 交流系数 冗余字典 超像素
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一种基于JTAG的嵌入式微处理器片上可调试系统 被引量:18
2
作者 张伟 李兆麟 +1 位作者 张闯 汪东升 《计算机工程与应用》 CSCD 北大核心 2004年第12期1-4,51,共5页
文章提出了一种基于JTAG的嵌入式微处理器片上的可调试系统。该系统在JTAG工业标准的基础上,能够以较少的硬件开销支持指令/数据断点设置、单步执行、寄存器内容查看和设置、内存内容查看和设置、在线编程以及微处理器运行现场设置等调... 文章提出了一种基于JTAG的嵌入式微处理器片上的可调试系统。该系统在JTAG工业标准的基础上,能够以较少的硬件开销支持指令/数据断点设置、单步执行、寄存器内容查看和设置、内存内容查看和设置、在线编程以及微处理器运行现场设置等调试功能。文章首先介绍了嵌入式微处理器可调试设计的原理,其次介绍了嵌入式微处理器的调试系统设计,最后给出调试实例分析。 展开更多
关键词 嵌入式微处理器 片上可调试系统 JTAG
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可自适应变频嵌入式微处理器核的设计 被引量:4
3
作者 李侠 周晓方 +1 位作者 张海清 章倩苓 《小型微型计算机系统》 CSCD 北大核心 2006年第2期335-338,共4页
变频技术是一种非常实用的低功耗设计技术.本文设计了与MIPS32-4Kec指令兼容的嵌入式微处理器核SRISC-I,并内嵌锁相环(PLL)作为时钟发生电路,该微处理器核在软件控制下可自适应地改变工作频率.除正常的工作模式外,SRISC-I还支持空闲、... 变频技术是一种非常实用的低功耗设计技术.本文设计了与MIPS32-4Kec指令兼容的嵌入式微处理器核SRISC-I,并内嵌锁相环(PLL)作为时钟发生电路,该微处理器核在软件控制下可自适应地改变工作频率.除正常的工作模式外,SRISC-I还支持空闲、休眠模式,可停止整个系统时钟及PLL的运行,有效地降低了功耗.仿真结果表明,在0.18umCMOS工艺下,SRISC-I最高频率达到250MHz,在PLL的控制下其工作频率可以以10MHz的步长改变.同时,给出了SRISC-I在不同频率下运行Dhrystone2.1程序的功耗,250MHz时为82.466mWatt,而在休眠模式下仅为28uWatt. 展开更多
关键词 变频技术 功耗管理技术 低功耗设计 嵌入式微处理器
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一种高性能的嵌入式微处理器:银河TS-1 被引量:2
4
作者 陆洪毅 沈立 +3 位作者 赵学秘 王蕾 戴葵 王志英 《电子学报》 EI CAS CSCD 北大核心 2002年第11期1668-1671,共4页
银河TS 1嵌入式微处理器是国防科学技术大学计算机学院设计的 32位嵌入式微处理器 ,完全正向设计 ,具有自主版权 .在体系结构上采用RISC内核 ,六级流水线 ,具有独立的数据Cache和指令Cache .特别的 ,TS 1具有两个取指部件的动态指令调... 银河TS 1嵌入式微处理器是国防科学技术大学计算机学院设计的 32位嵌入式微处理器 ,完全正向设计 ,具有自主版权 .在体系结构上采用RISC内核 ,六级流水线 ,具有独立的数据Cache和指令Cache .特别的 ,TS 1具有两个取指部件的动态指令调度机制 ,拥有面向嵌入式应用的向量处理机制 ,采用基于内容复制 /交换的寄存器窗口技术的中断处理机制 ,支持WISHBONEIP核互连接口规范 ,具有良好的扩展性 .本文主要介绍TS 1的RISC核心设计思想和关键实现技术 ,最后给出性能评测结果 .TS 1设计已经在Altera的FPGAEP2 0K4 0 0EBC上面得到了验证 ,主频可以达到 36 .7MHz. 展开更多
关键词 银河TS-1 嵌入式微处理器 体系结构 向量化 流水线 RISC
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嵌入式微处理器的系统验证平台设计 被引量:9
5
作者 庄伟 樊晓桠 《计算机应用研究》 CSCD 北大核心 2007年第10期240-242,共3页
基于FPGA和嵌入式操作系统VxWorks的优点,设计了"龙腾R2"微处理器的系统验证平台。在该验证平台上成功调试了VxWorks操作系统以及该验证平台支持的所有tShell和wShell命令及大量的测试程序。实践表明,该验证平台的调试和错误... 基于FPGA和嵌入式操作系统VxWorks的优点,设计了"龙腾R2"微处理器的系统验证平台。在该验证平台上成功调试了VxWorks操作系统以及该验证平台支持的所有tShell和wShell命令及大量的测试程序。实践表明,该验证平台的调试和错误定位方法快捷有效,提高了验证效率,缩短了设计周期。 展开更多
关键词 嵌入式微处理器 现场可编程逻辑 VXWORKS 系统验证平台
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基于嵌入式微处理器的VxWorks系统移植 被引量:7
6
作者 屈文新 樊晓桠 《计算机应用研究》 CSCD 北大核心 2007年第6期262-264,267,共4页
提出一种以嵌入式微处理器为核心,移植VxWorks操作系统的方法。通过对VxWorks输入/输出系统的分析以及中断处理和异常处理过程的研究,设计了相应的外围器件,成功实现了VxWorks操作系统的移植。
关键词 VXWORKS 嵌入式微处理器 实时
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嵌入式微处理器的可测性设计技术研究 被引量:2
7
作者 高树静 沈胜宇 +1 位作者 李思昆 潘振宽 《计算机工程与应用》 CSCD 北大核心 2002年第16期218-222,共5页
文章介绍了一个嵌入式微处理器的可测性设计技术。根据嵌入式微处理器各个组成部件逻辑功能的特点,分别采用了内置自测试(BIST)、部分扫描(PartialScan)、边界扫描(BoundaryScan)等方法完成各个部件的可测性设计,并将符合IEEE1149.1的TA... 文章介绍了一个嵌入式微处理器的可测性设计技术。根据嵌入式微处理器各个组成部件逻辑功能的特点,分别采用了内置自测试(BIST)、部分扫描(PartialScan)、边界扫描(BoundaryScan)等方法完成各个部件的可测性设计,并将符合IEEE1149.1的TAP控制器作为整个微处理器的测试控制器,达到了较优的可测性设计结果。 展开更多
关键词 嵌入式微处理器 可测性设计 边界扫描 逻辑电路
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嵌入式微处理器接口总线控制器的CPLD设计 被引量:2
8
作者 吴朝晖 郑学仁 胡鹏 《半导体技术》 CAS CSCD 北大核心 2001年第4期46-49,共4页
介绍了用复杂可编程逻辑器件(CPLD)来实现嵌入式微处理器(MCU)和DSP处理器之间端口数据总线逻辑控制电路的设计,给出了接口数据总线逻辑的设计电路和部分仿真结果。证明本文采用的系统结构具有设计灵活、设计开发周期短... 介绍了用复杂可编程逻辑器件(CPLD)来实现嵌入式微处理器(MCU)和DSP处理器之间端口数据总线逻辑控制电路的设计,给出了接口数据总线逻辑的设计电路和部分仿真结果。证明本文采用的系统结构具有设计灵活、设计开发周期短的优点。 展开更多
关键词 可编程逻辑器件 总线控制器 设计 接口 嵌入式微处理器
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嵌入式微处理器分支预测的设计与实现 被引量:2
9
作者 陈海民 李峥 王瑞蛟 《计算机应用》 CSCD 北大核心 2011年第7期2004-2007,共4页
针对五级流水线嵌入式微处理器的特定应用环境,对分支预测技术进行了深入研究,提出了一种新的分支预测方案。该方案兼容带缓存设计,通过扩展指令总线,在取指段提前对分支指令跳转方向和目标地址进行预测,保存可能执行而未执行的指令和... 针对五级流水线嵌入式微处理器的特定应用环境,对分支预测技术进行了深入研究,提出了一种新的分支预测方案。该方案兼容带缓存设计,通过扩展指令总线,在取指段提前对分支指令跳转方向和目标地址进行预测,保存可能执行而未执行的指令和地址指针以备分支预测失效时得以恢复,减少了预测失效的代价,同时保证了指令流的正确执行。研究表明,该方案硬件开销小,预测效率高,预测失效代价低。 展开更多
关键词 嵌入式微处理器 流水线 ARM指令集 分支预测 失效代价
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嵌入式微处理器的多层次可配置仿真工具 被引量:1
10
作者 张鲁峰 赵文辉 李思昆 《国防科技大学学报》 EI CAS CSCD 北大核心 2002年第4期53-56,共4页
为了适应嵌入式定制微处理器的开发的需要 ,克服现有微处理器仿真工具的某些不足 ,文中介绍了微处理器的仿真验证工具———VCPU的设计和实现方法。同其它微处理器仿真工具相比 ,该工具具有多层次 ,可配置 ,功能全面的特点。利用该工具 ... 为了适应嵌入式定制微处理器的开发的需要 ,克服现有微处理器仿真工具的某些不足 ,文中介绍了微处理器的仿真验证工具———VCPU的设计和实现方法。同其它微处理器仿真工具相比 ,该工具具有多层次 ,可配置 ,功能全面的特点。利用该工具 ,设计者可在设计早期进行系统集成验证 ,缩短设计周期并减少设计错误。 展开更多
关键词 多层次 可配置 协同设计 嵌入式微处理器 仿真工具 VCPU 软件设计 硬件设计
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嵌入式微处理器中断控制单元的设计 被引量:1
11
作者 朱霞 高德远 +1 位作者 张盛兵 樊晓桠 《计算机工程与应用》 CSCD 北大核心 2001年第17期48-50,共3页
文章详细分析了嵌入式微处理器中的中断控制机制。对于可以设置是沿有效或电平有效的中断请求的接收提出了三种方案并比较了它们的优缺点。然后根据该处理器的要求给出了产生到微程序控制器的中断请求的算法,最后给出了键保护模式下中... 文章详细分析了嵌入式微处理器中的中断控制机制。对于可以设置是沿有效或电平有效的中断请求的接收提出了三种方案并比较了它们的优缺点。然后根据该处理器的要求给出了产生到微程序控制器的中断请求的算法,最后给出了键保护模式下中断响应中硬件处理流程。 展开更多
关键词 嵌入式微处理器 中断控制单元 接口 设计
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基于嵌入式微处理器的GPS跟踪报警系统设计 被引量:8
12
作者 朱斌 《电讯技术》 北大核心 2010年第4期88-91,共4页
为实现对地面移动目标的远程跟踪,以嵌入式微处理器ARM Cortex-M3之LM3S1138为主控制器,结合全球定位系统(GPS)和移动通信(GSM)技术,设计了一款GPS跟踪报警系统,实现了对地面移动目标的跟踪报警功能。介绍了GPS跟踪报警系统的结构及工... 为实现对地面移动目标的远程跟踪,以嵌入式微处理器ARM Cortex-M3之LM3S1138为主控制器,结合全球定位系统(GPS)和移动通信(GSM)技术,设计了一款GPS跟踪报警系统,实现了对地面移动目标的跟踪报警功能。介绍了GPS跟踪报警系统的结构及工作原理,阐述了硬件设计和软件系统实现方法。该系统具有安装简单、功能强大、极具实用性等特点。 展开更多
关键词 地面移动目标 跟踪报警系统 嵌入式微处理器 全球定位系统 移动通信
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嵌入式微处理器片上调试系统的设计和验证 被引量:1
13
作者 龚令侃 卢景芬 《计算机工程》 CAS CSCD 北大核心 2008年第B09期131-133,共3页
为了尽可能保持芯片原有体系结构,综合基于软件监控和基于JTAG的2种方法,提出扩展嵌入式处理器片上调试系统的完整解决方案。该系统包括PC端的开发环境IDE、命令转发与控制子系统Probe和支持JTAG标准的目标CPU等部分。通过软硬件协同设... 为了尽可能保持芯片原有体系结构,综合基于软件监控和基于JTAG的2种方法,提出扩展嵌入式处理器片上调试系统的完整解决方案。该系统包括PC端的开发环境IDE、命令转发与控制子系统Probe和支持JTAG标准的目标CPU等部分。通过软硬件协同设计和验证,确保系统划分正确,子系统协调工作,并缩短了调试系统的开发周期。 展开更多
关键词 嵌入式微处理器 片上调试系统 软硬件协同设计和验证
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基于STM32嵌入式微处理器的舰船网络通信系统设计 被引量:6
14
作者 余鹏 《舰船科学技术》 北大核心 2020年第24期133-135,共3页
针对舰船通信系统容易出现通信指令不完整而导致通信周期长的问题,提出了基于STM32嵌入式微处理器的舰船网络通信系统设计。系统硬件设计中,以STM32嵌入式微处理器为控制核心,使用Cortex-M3芯片向DMA控制器发送或接收数据,设置信令通道... 针对舰船通信系统容易出现通信指令不完整而导致通信周期长的问题,提出了基于STM32嵌入式微处理器的舰船网络通信系统设计。系统硬件设计中,以STM32嵌入式微处理器为控制核心,使用Cortex-M3芯片向DMA控制器发送或接收数据,设置信令通道控制机、数据信道控制机,简化通道,降低通信电流,保护电路。系统软件设计中,将硬件接收到的指令传送到扫描器中,扫描通信指令,实现发送命令有效控制,确定通信周期,保证系统在短期内完成系统通信。由实验结果可知,该系统能够完整传输指令,实际通信周期为16 ms,具有良好通信效果。 展开更多
关键词 STM32嵌入式微处理器 舰船网络 通信系统 通信指令
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嵌入式微处理器NCS的微程序设计
15
作者 王党辉 高德远 +1 位作者 杨波 朱霞 《计算机工程与应用》 CSCD 北大核心 2001年第9期15-16,38,共3页
设计拥有我国自主版权微处理器对国防及民用有着重大意义。微程序设计技术是实现微处理器指令系统的重要技术,但是许多设计者却感到这项工作复杂、难于掌握。文章结合16位嵌入式微处理器NCS的微程序设计探讨了微指令格式的确定以... 设计拥有我国自主版权微处理器对国防及民用有着重大意义。微程序设计技术是实现微处理器指令系统的重要技术,但是许多设计者却感到这项工作复杂、难于掌握。文章结合16位嵌入式微处理器NCS的微程序设计探讨了微指令格式的确定以及微程序的填写等技术,期望能对广大设计者的工作有所帮助。 展开更多
关键词 嵌入式微处理器 NCS 微程序设计 指令系统 微指令
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32位浮点RISC嵌入式微处理器LS-C编译程序寄存器分配实现
16
作者 孙满囤 胡宝成 《计算机工程与应用》 CSCD 北大核心 2003年第2期131-132,共2页
寄存器的合理利用是提高编译程序目标代码效率的关键因素。论文提出变量使用频度最低思想并详细阐述了其在32位浮点RISC嵌入式微处理器LS-C编译程序寄存器分配方案中的具体实现。
关键词 32位浮点RISC嵌入式微处理器 LS-C 编译程序 寄存器分配
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嵌入式微处理器MPC855T在局域网分析仪中的硬件实现
17
作者 王冬青 周宏志 贾玉兰 《现代电子技术》 2003年第17期12-15,共4页
分析 Motorola MPC85 5 T嵌入式微处理器的性能及特征 ,重点介绍 MPC85 5 T在局域网测试中的应用 ,突出了 MPC85 5 T嵌入式微处理器的通信处理能力。
关键词 嵌入式微处理器 MPC855T 局域网 以太网 分析仪
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一种嵌入式微处理器cache存储体系结构设计
18
作者 鲍东星 李晓明 《电测与仪表》 北大核心 2007年第8期37-40,52,共5页
本文介绍了一种基于32位整数单元的片上cache存储体系结构设计的方案。作为SOC平台的核心部件,本设计中所有模块均自行设计,采用自顶向下的设计方法,应用Verilog HDL硬件描述语言进行设计,总线接口符合AMBATM总线规范(Rev 2.0)。为了对... 本文介绍了一种基于32位整数单元的片上cache存储体系结构设计的方案。作为SOC平台的核心部件,本设计中所有模块均自行设计,采用自顶向下的设计方法,应用Verilog HDL硬件描述语言进行设计,总线接口符合AMBATM总线规范(Rev 2.0)。为了对设计功能的有效性进行验证,还设计了一个基于AMBATM总线协议的通用SOC的系统虚拟验证平台,利用该平台对相关模型进行了调试和仿真。仿真结果表明,设计达到预期的功能要求。 展开更多
关键词 CACHE 嵌入式微处理器 功能验证
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基于嵌入式微处理器的水轮发电机组单元监控系统——评《中国水利水电工程》
19
作者 胡应坤 《水利水电技术》 北大核心 2020年第9期I0003-I0003,共1页
随着电子信息技术的发展,水利水电设备与系统的自动化、信息化水平不断提高,作为水利水电工程的核心设备,水轮发电机组单元在水利水电工程中起到能量转换的重要作用。为此,研究人员通过监控系统实时掌握水轮发电机组单元的工作状态,如... 随着电子信息技术的发展,水利水电设备与系统的自动化、信息化水平不断提高,作为水利水电工程的核心设备,水轮发电机组单元在水利水电工程中起到能量转换的重要作用。为此,研究人员通过监控系统实时掌握水轮发电机组单元的工作状态,如基于嵌入式微处理器的水轮发电机组单元监控系统。《中国水利水电工程》(陆家远,四川大学出版社2012版)是以中国水利水电工程发展为脉络,帮助水利水电工程专业学生详细了解水利水电工程,全书共分为26章。第一章对古代著名水利工程进行介绍;第二章从整体上对中国水资源及其综合利用进行分析;第三章对水利枢纽极其水工建筑物进行系统性的概述;第四章以防洪排涝工程与灌溉供水工程为主要内容;第五章则对水电站与水能利用情况加以分析;第六、七、八、九、十、十一章分别介绍了中国淮河、海河、黄河、长江、珠江的治理与水能利用情况;第十二、十三章对南水北调和西电东送两个现代水利水电工程进行详细介绍;第十四至二十三章就我国不同地区的水电建设与水能开发利用情况加以分析;第二十四、二十三章分别讨论了潮汐电站与抽水蓄能电站的具体工作原理与特点;第二十五章对水利水电工程电力系统进行了全面分析。 展开更多
关键词 水利水电工程 水电建设 嵌入式微处理器 水能利用 水轮发电机组 监控系统 潮汐电站 电子信息技术
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基于嵌入式微处理器的GPS手持终端系统设计 被引量:6
20
作者 庞恩林 郑建生 +1 位作者 蒋海丽 甘朝华 《电讯技术》 2005年第2期53-57,共5页
本文阐述了采用ARM7TMDI微处理器设计了一个基于电子地图的GPS智能手持终端系统,实现对移动目标位置、状态的显示、存储与管理,以及GPS手持终端之间的互动和与控制中心的互动。
关键词 GPS接收机 GIS 电子地图 嵌入式微处理器 手持终端
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