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一种简化的对数最大后验概率译码算法 被引量:2
1
作者 张琳 余顺争 《西安交通大学学报》 EI CAS CSCD 北大核心 2005年第8期867-870,共4页
提出了一种简化的对数最大后验概率译码算法.该简化算法基于逼近理论,用最佳平方逼近多项式近似计算校正函数,近似多项式的系数根据特征定理确定.与原算法相比,简化算法具有低复杂度、译码延时少的优点.仿真结果表明:计算复杂度比原算... 提出了一种简化的对数最大后验概率译码算法.该简化算法基于逼近理论,用最佳平方逼近多项式近似计算校正函数,近似多项式的系数根据特征定理确定.与原算法相比,简化算法具有低复杂度、译码延时少的优点.仿真结果表明:计算复杂度比原算法降低约30%;在加性白高斯噪声信道和平坦慢衰落瑞利信道上,其编码增益比求最大值对数最大后验概率译码算法高出0.3~0.5 dB,与原算法相近.因此,简化算法可替代对数最大后验概率译码算法在Turbo码译码器中使用. 展开更多
关键词 对数最大后验概率译码 TURBO码 简化
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适用于实际系统的改进Turbo码最大后验概率译码 被引量:3
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作者 魏莹 阎鸿森 王霞 《西安交通大学学报》 EI CAS CSCD 北大核心 2003年第2期155-158,共4页
采用分块译码算法来解决Turbo码最大后验概率(MAP)译码存储量大、时延大的问题.分块译码将长帧分成若干较短的子帧进行处理,边接收边译码,因而缩短了译码时延.由于每次仅需存储若干个相邻子帧的前后向矩阵值,从而减小了存储量.根据一种... 采用分块译码算法来解决Turbo码最大后验概率(MAP)译码存储量大、时延大的问题.分块译码将长帧分成若干较短的子帧进行处理,边接收边译码,因而缩短了译码时延.由于每次仅需存储若干个相邻子帧的前后向矩阵值,从而减小了存储量.根据一种通用的正反向处理器配合方案,计算出此方法相对于传统算法存储和时延减少量的一般表达式,并在对数域详细推导出算法流程.仿真表明,在一定范围内,分块译码算法性能随训练长度的增加而提高.采用此算法后,时延大大减小,存储量减小为传统对数成最大后验概率译码(LOG MAP)算法的2/n,便于实际应用. 展开更多
关键词 TURBO码 对数最大后验概率译码算法 分块译码算法 并行级联卷积码 译码时延 移动通信系统
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低密度奇偶校验码加权大数逻辑译码研究 被引量:8
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作者 张立军 刘明华 卢萌 《西安交通大学学报》 EI CAS CSCD 北大核心 2013年第4期35-38,50,共5页
针对低密度奇偶校验(LDPC)码加权大数逻辑(WMLG)译码物理意义问题,提出了一种基于最大对数最大后验概率(max-log MAP)译码的推导方法。该方法利用幂求和的对数近似表达式给出信息位的对数似然比(LLR),理论证明了WMLG译码与max-log MAP... 针对低密度奇偶校验(LDPC)码加权大数逻辑(WMLG)译码物理意义问题,提出了一种基于最大对数最大后验概率(max-log MAP)译码的推导方法。该方法利用幂求和的对数近似表达式给出信息位的对数似然比(LLR),理论证明了WMLG译码与max-log MAP译码的等价性。仿真结果也进一步表明,与MAP译码相比,max-log MAP译码的复杂度大为降低,而译码性能的损失微乎其微。WMLG译码与max-log MAP译码的等价关系表明,基于WMLG译码的混合译码算法都可看作max-log MAP算法的改进,这对于设计LDPC码的新型混合译码算法有较好的指导作用。 展开更多
关键词 低密度奇偶校 加权大数逻辑 最大对数最大后验概率
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LDPC码加权比特翻转译码算法研究 被引量:7
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作者 张高远 周亮 文红 《电子与信息学报》 EI CSCD 北大核心 2014年第9期2093-2097,共5页
近年来,基于置信传播(BP),最小和(MS)和归一化最小和(NMS)算法,已经提出3种相对应的LDPC码加权比特翻转(WBF)译码算法。但这3种WBF算法所代表的物理意义和内在的紧密联系问题目前仍未有所研究。该文依据一种全新的理解方式,对3种WBF算... 近年来,基于置信传播(BP),最小和(MS)和归一化最小和(NMS)算法,已经提出3种相对应的LDPC码加权比特翻转(WBF)译码算法。但这3种WBF算法所代表的物理意义和内在的紧密联系问题目前仍未有所研究。该文依据一种全新的理解方式,对3种WBF算法进行理论推导,并阐述3种算法内在的紧密联系,最后通过仿真验证所得结论的合理性和正确性。这对于设计新的改进型WBF算法具有一定的指导意义。 展开更多
关键词 低密度奇偶校 加权比特翻转 可靠度后验信息 对数最大后验概率
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Turbo译码器基于组合逻辑电路的低复杂度Log-MAP算法 被引量:1
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作者 王东 李秀朋 《无线电通信技术》 2018年第3期263-267,共5页
自Turbo编码问世以来,为了实现较低复杂度和优良比特误码率(BER)性能的Turbo译码器,已经有多种简化的对数最大后验概率(Log-MAP)算法被提出。针对Log-MAP算法,提出了一种基于组合逻辑电路(CLC)的复杂度很低的硬件实现架构。该CLC架构可... 自Turbo编码问世以来,为了实现较低复杂度和优良比特误码率(BER)性能的Turbo译码器,已经有多种简化的对数最大后验概率(Log-MAP)算法被提出。针对Log-MAP算法,提出了一种基于组合逻辑电路(CLC)的复杂度很低的硬件实现架构。该CLC架构可以应用于所有现有的简化Log-MAP算法,只需将其中用于计算fc的算术模块替换为逻辑电路。通过仿真及FPGA实现验证了在相同BER性能下,使用提出的架构可以节约多达30%的硬件资源。此外,该CLC架构无需关注fc是否能用一个简单的函数描述即可硬件实现Log-MAP算法。 展开更多
关键词 组合逻辑电路(CLC) 对数最大后验概率(Log-MAP) TURBO编码
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一种LOG-MAP算法的改进迭代实现及其结构
6
作者 周亮 《电子科技大学学报》 EI CAS CSCD 北大核心 2003年第5期574-577,共4页
对LOG-MAP算法进行了可并发性分析,利用可以完整接收一个N长符号传输帧的条件以及正向迭代和反向迭代中的固有对称性质,提出了LOG-MAP算法的一种修正迭代实现算法,其正向和反向迭代计算次数只需码长N的一半,故比标准LOG-MAP算法提高了... 对LOG-MAP算法进行了可并发性分析,利用可以完整接收一个N长符号传输帧的条件以及正向迭代和反向迭代中的固有对称性质,提出了LOG-MAP算法的一种修正迭代实现算法,其正向和反向迭代计算次数只需码长N的一半,故比标准LOG-MAP算法提高了一倍的处理速度,且没有空间开销的增加、同时,根据修正的迭代实现算法给出了相应的适于FPGA实现的双总线硬件结构的实现方案。 展开更多
关键词 最大后验概率 对数最大后验概率 迭代算法 双总线结构
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UMTS Turbo码的滑动窗-线性-Log-MAP算法及VLSI设计 被引量:2
7
作者 刘小同 陈咏恩 《计算机工程与应用》 CSCD 北大核心 2007年第4期74-78,共5页
讨论UMTS中turbo码的设计,提出采用前向状态度量作为初始化精确值的滑动窗方法和改进的Log-MAP(线性Log-MAP)相结合的算法(称为滑动窗-线性-Log-MAP算法),设计出turbo码的VLSI结构,且在归一化处理时,介绍了一种可节约12.5%存储量的方法... 讨论UMTS中turbo码的设计,提出采用前向状态度量作为初始化精确值的滑动窗方法和改进的Log-MAP(线性Log-MAP)相结合的算法(称为滑动窗-线性-Log-MAP算法),设计出turbo码的VLSI结构,且在归一化处理时,介绍了一种可节约12.5%存储量的方法。FPGA设计结果显示在BER=10-5时,与最优算法Log-MAP相比,性能损失0.2dB,硬件资源节约30%,译码时延小,吞吐量大。 展开更多
关键词 通用无线通信系统 涡轮码 线性对数最大后验概率译码算法 滑动窗方法 滑动窗线性对敷域最大后验概率译码算法 可编程门阵列
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Turbo码SOVA译码器的系统仿真及性能分析
8
作者 林杰 贾怀义 《北方交通大学学报》 CSCD 北大核心 2003年第6期31-34,39,共5页
主要分析了3GPP标准中Turbo码采用SOVA译码器的译码性能.3GPP标准中给出了1/3Turbo码的编码结构和交织器设计方案,但未能给出译码方案.作者对帧长为4000bit的Turbo码,采用了SOVA译码器进行建模仿真.比较了SOVA译码器与MAX_LOG_MAP译... 主要分析了3GPP标准中Turbo码采用SOVA译码器的译码性能.3GPP标准中给出了1/3Turbo码的编码结构和交织器设计方案,但未能给出译码方案.作者对帧长为4000bit的Turbo码,采用了SOVA译码器进行建模仿真.比较了SOVA译码器与MAX_LOG_MAP译码器译码的性能和实现复杂度.本文作者认为,从综合算法的性能、计算复杂度和时延等方面来考虑,SOVA译码器作为Turbo码的译码是一个比较好的选择. 展开更多
关键词 无线通信技术 TURBO码 软输出维特比(SOVA)译码器 最大值对数最大后验概率 (MAX—LOG-LOG-MAP)译码器 信道编码 译码
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