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题名处理器访存子系统关键队列的性能建模
被引量：1
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作者
李文青
吴畏
章隆兵
肖俊华
王剑
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机构
计算机体系结构国家重点实验室(中国科学院计算技术研究所)
中国科学院大学
龙芯中科技术有限公司
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出处
《高技术通讯》
EI
CAS
北大核心
2020年第7期655-665,共11页
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基金
国家自然科学基金(61432016,61521092)
中国科学院重点部署(ZDRW-XH-2017-1)资助项目。
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文摘
处理器访存性能对其整体性能有着很大的影响,访存子系统的设计显得尤为重要。高性能超标量处理器的访存子系统中存在多个关键队列,如何快速进行设计折中,成为设计的关键。本文采用软件模拟器和回归模型结合的建模方法,提出了一个面向访存子系统关键队列的回归分析模型,并设计实现了相应的访存子系统模拟器。将软件模拟器与目标处理器设计的现场可编程门阵列(FPGA)原型验证平台进行准确性校准,并采用回归模型对软件模拟器的模拟数据进行分析,结果表明:实验验证结果稳定且对于所测试程序误差在10%以内。该建模方法可以量化分析访存子系统中关键队列大小与性能之间的关系,有效扩大硬件设计空间探索的范围,加快高性能处理器访存子系统的优化设计。
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关键词
处理器设计空间探索
访存子系统
软件模拟器
回归模型
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Keywords
processor design space exploration
memory subsystem
software simulator
regression model
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分类号
TP332
[自动化与计算机技术—计算机系统结构]
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