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嵌入式组合导航系统中高速通信链的实现
被引量：
1
1
作者
张国龙
徐晓苏
《华南理工大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2009年第9期77-81,共5页
为满足系统小型化、低功耗、低成本、高精度等要求,在基于数字信号处理器(DSP)的嵌入式组合导航系统中,使用一片现场可编程门阵列(FPGA)芯片完成系统各单元间的逻辑控制、多通道异步收发器(UART)的扩展及其收/发双缓冲先进先出(FIFO)存...
为满足系统小型化、低功耗、低成本、高精度等要求,在基于数字信号处理器(DSP)的嵌入式组合导航系统中,使用一片现场可编程门阵列(FPGA)芯片完成系统各单元间的逻辑控制、多通道异步收发器(UART)的扩展及其收/发双缓冲先进先出(FIFO)存储器的设计.同时,为了减少系统完成数据传输任务时CPU的额外开销,在DSP内部随机存取存储器(RAM)中设计了乒乓缓存区,并利用TMS320C6713的增强型直接内存存取(EDMA)功能完成FPGA中UART缓冲FIFO和DSP内部RAM中乒乓缓存区之间的数据传输.试验结果证明,此方案可以在CPU执行导航算法的同时,由EDMA控制多通道UART在460.8 kb/s波特率下稳定地工作,实现了DSP与外围设备之间高速通信链的设计,使得CPU更专注于导航计算.
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关键词
全球定位系统
惯性导航系统
数字信号处理器
现场可编程门阵列
串行通信
增强型直接内存存取
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职称材料
基于FPGA+DSP的振动主动控制系统设计
被引量：
1
2
作者
董淑伟
郑宾
杜鹏飞
《计算机工程与设计》
北大核心
2015年第8期2079-2082,共4页
针对振动主动控制中处理算法复杂的问题及实时性要求高的需求,提出一种多处理器协同处理的架构,建立FPGA+DSP的高速采集处理系统,以达到对振动目标的实时控制。在FPGA内建立MicroBlaze处理器,配置转化率为65MSPS的A/D对振动信号进行实...
针对振动主动控制中处理算法复杂的问题及实时性要求高的需求,提出一种多处理器协同处理的架构,建立FPGA+DSP的高速采集处理系统,以达到对振动目标的实时控制。在FPGA内建立MicroBlaze处理器,配置转化率为65MSPS的A/D对振动信号进行实时采集,采集得到的数据流经缓冲后,通过DMA传输方式经EMIF接口传给DSP进行处理,利用处理结果驱动致动器,达到抑制控制目标振动的目的。实验结果表明,该方法可将20g振动加速度下的振动幅值降低30%。
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关键词
主动控制
高速采集
外部存储器接口
增强型直接内存存取
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职称材料
RapidIO链的设计方案和应用
被引量：
1
3
作者
黄先春
黄登山
骆艳卜
《计算机工程与应用》
CSCD
北大核心
2009年第32期63-64,89,共3页
串行RapidIO支持两种工作方式:Message和DirectIO方式。DirectIO方式使用简单,但是它在连续传输多包的情况下,CPU需要等待LSU寄存器空闲。为了解决该问题,提出了RapidIO链的传输新方案,即用EDMA通道代替CPU配置SRIO的LSU寄存器。实验表...
串行RapidIO支持两种工作方式:Message和DirectIO方式。DirectIO方式使用简单,但是它在连续传输多包的情况下,CPU需要等待LSU寄存器空闲。为了解决该问题,提出了RapidIO链的传输新方案,即用EDMA通道代替CPU配置SRIO的LSU寄存器。实验表明该方案能有效地降低CPU负荷。
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关键词
高速串行IO
口(SRIO)
增强型
内存
直接
存取
(EDMA)
CPU负荷
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职称材料
题名
嵌入式组合导航系统中高速通信链的实现
被引量：
1
1
作者
张国龙
徐晓苏
机构
东南大学仪器科学与工程学院
出处
《华南理工大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2009年第9期77-81,共5页
基金
国防"973"项目(973-61334)
"十一五"总装备部预研项目(51309060402
+3 种基金
51309020503)
国家自然科学基金资助项目(50575042)
教育部高等学校博士点专项科研基金资助项目(20050286026)
原国防科工委基础科研项目(C1420080224)
文摘
为满足系统小型化、低功耗、低成本、高精度等要求,在基于数字信号处理器(DSP)的嵌入式组合导航系统中,使用一片现场可编程门阵列(FPGA)芯片完成系统各单元间的逻辑控制、多通道异步收发器(UART)的扩展及其收/发双缓冲先进先出(FIFO)存储器的设计.同时,为了减少系统完成数据传输任务时CPU的额外开销,在DSP内部随机存取存储器(RAM)中设计了乒乓缓存区,并利用TMS320C6713的增强型直接内存存取(EDMA)功能完成FPGA中UART缓冲FIFO和DSP内部RAM中乒乓缓存区之间的数据传输.试验结果证明,此方案可以在CPU执行导航算法的同时,由EDMA控制多通道UART在460.8 kb/s波特率下稳定地工作,实现了DSP与外围设备之间高速通信链的设计,使得CPU更专注于导航计算.
关键词
全球定位系统
惯性导航系统
数字信号处理器
现场可编程门阵列
串行通信
增强型直接内存存取
Keywords
global positioning system
inertial navigation system
digital signal processor
field programmable gate array
serial communication
enhanced direct memory access
分类号
V249.328 [航空宇航科学与技术—飞行器设计]
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职称材料
题名
基于FPGA+DSP的振动主动控制系统设计
被引量：
1
2
作者
董淑伟
郑宾
杜鹏飞
机构
中北大学仪器科学与动态测试教育部重点实验室
中北大学山西省光电信息与仪器工程技术研究中心
出处
《计算机工程与设计》
北大核心
2015年第8期2079-2082,共4页
基金
国家自然科学基金仪器专项基金项目(61127015)
国际科技合作基金项目(2012DFA10680
2013DFR10150)
文摘
针对振动主动控制中处理算法复杂的问题及实时性要求高的需求,提出一种多处理器协同处理的架构,建立FPGA+DSP的高速采集处理系统,以达到对振动目标的实时控制。在FPGA内建立MicroBlaze处理器,配置转化率为65MSPS的A/D对振动信号进行实时采集,采集得到的数据流经缓冲后,通过DMA传输方式经EMIF接口传给DSP进行处理,利用处理结果驱动致动器,达到抑制控制目标振动的目的。实验结果表明,该方法可将20g振动加速度下的振动幅值降低30%。
关键词
主动控制
高速采集
外部存储器接口
增强型直接内存存取
Keywords
active control
high-speed acquisition
EMIF interface
DMA
分类号
TP274 [自动化与计算机技术—检测技术与自动化装置]
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职称材料
题名
RapidIO链的设计方案和应用
被引量：
1
3
作者
黄先春
黄登山
骆艳卜
机构
西北工业大学电子信息学院
空军工程大学电讯工程学院
出处
《计算机工程与应用》
CSCD
北大核心
2009年第32期63-64,89,共3页
基金
西北工业大学第一批基础研究基金No.W018103~~
文摘
串行RapidIO支持两种工作方式:Message和DirectIO方式。DirectIO方式使用简单,但是它在连续传输多包的情况下,CPU需要等待LSU寄存器空闲。为了解决该问题,提出了RapidIO链的传输新方案,即用EDMA通道代替CPU配置SRIO的LSU寄存器。实验表明该方案能有效地降低CPU负荷。
关键词
高速串行IO
口(SRIO)
增强型
内存
直接
存取
(EDMA)
CPU负荷
Keywords
Serial RapidIO（SRIO）
Enhanced Direct Memory Aceess（EDMA）
CPU load
分类号
TN911.72 [电子电信—通信与信息系统]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
嵌入式组合导航系统中高速通信链的实现
张国龙
徐晓苏
《华南理工大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2009
1
在线阅读
下载PDF
职称材料
2
基于FPGA+DSP的振动主动控制系统设计
董淑伟
郑宾
杜鹏飞
《计算机工程与设计》
北大核心
2015
1
在线阅读
下载PDF
职称材料
3
RapidIO链的设计方案和应用
黄先春
黄登山
骆艳卜
《计算机工程与应用》
CSCD
北大核心
2009
1
在线阅读
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职称材料
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