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基带成形滤波器的FPGA实现 被引量:9
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作者 王建新 蒋立平 +1 位作者 吉训生 陈小梅 《电讯技术》 北大核心 2001年第5期43-46,共4页
针对数字化基带成形滤波的信号处理特点 ,将截短的基带波形进行二维分解 ,得到成形滤波器的多相结构。通过对多相结构的分析 ,给出了一种较为精简实用的基于滤波器系数查询表模式的FPGA实现结构 ,该结构具有实现简单、占用资源少等特点... 针对数字化基带成形滤波的信号处理特点 ,将截短的基带波形进行二维分解 ,得到成形滤波器的多相结构。通过对多相结构的分析 ,给出了一种较为精简实用的基于滤波器系数查询表模式的FPGA实现结构 ,该结构具有实现简单、占用资源少等特点。仿真结果表明 。 展开更多
关键词 基带成形滤波 现场可编程门阵列 电路
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CDMA2000 1x基带成形滤波器——一种低复杂度的设计和实现 被引量:4
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作者 吴明森 梁继业 刘海涛 《电子测量与仪器学报》 CSCD 2006年第3期67-70,共4页
本文采用查找表法实现了cdma20001x脉冲成形滤波器,相对于传统的滤波器设计方法,本文充分利用了滤波器系数对称的特性,并考虑到4倍过采样是采用内插三个零来完成这一特点,巧妙设计了数据查找存储表,节省了大量硬件资源。整个系统用veril... 本文采用查找表法实现了cdma20001x脉冲成形滤波器,相对于传统的滤波器设计方法,本文充分利用了滤波器系数对称的特性,并考虑到4倍过采样是采用内插三个零来完成这一特点,巧妙设计了数据查找存储表,节省了大量硬件资源。整个系统用verilog HDL语言RTL级描述。系统经过了FPGA验证并给出了仿真结果。 展开更多
关键词 CDMA2000 1x 查找表 内插 VERILOG HDL 基带脉冲滤波
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基于CPLD的基带成形数字滤波器的多相结构设计
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作者 谢纪刚 龙海南 李芬华 《河北大学学报(自然科学版)》 CAS 2002年第3期279-282,共4页
介绍了一种用数字信号处理的方法来实现基带成形数字滤波器 ,这种方法充分利用了CPLD的结构特点 ,可以大大提高数字信号传输速率 ,详细介绍了设计原理和实现框图 .
关键词 基带数字滤波 多相结构 CPLD 数字信号处理 设计原理 电路设计 传输速率
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一种数字化基带成形实现新方法:基于码元间隔的定长滑动窗算法 被引量:10
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作者 杨贞斌 邬江兴 《通信学报》 EI CSCD 北大核心 1999年第6期40-44,共5页
针对数字化基带成形滤波的信号处理特点,提出二维分解截短基带波形的方法,进而形成基于码元间隔的定长滑动窗算法。该算法具有最小数据缓存量要求以及最小输出延迟的显著特点,是特别适合于数字化基带成形滤波的一种新实现方法,并可... 针对数字化基带成形滤波的信号处理特点,提出二维分解截短基带波形的方法,进而形成基于码元间隔的定长滑动窗算法。该算法具有最小数据缓存量要求以及最小输出延迟的显著特点,是特别适合于数字化基带成形滤波的一种新实现方法,并可在序列间样点不等间隔的有限长序列与有限长序列、有限长序列与无限长序列之间的卷积运算上取得同样显著的实用效果。 展开更多
关键词 数字化 基带成形滤波 码元间隔 数字信号处理
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