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混合仿真下DDS的改进研究与实现
1
作者
周磊
王紫婷
《现代电子技术》
2007年第15期84-86,共3页
基于高性能FPGA实现的DDS电路是某些对于控制方式、置频速率等方面有特殊要求场合的最佳选择。通过把DDS的核心部件——相位累加器改进为回旋相位累加器,使得存储波形数据的ROM空间降低50%,频率分辨率提升了1倍。另外,在QuartusⅡ,VC与L...
基于高性能FPGA实现的DDS电路是某些对于控制方式、置频速率等方面有特殊要求场合的最佳选择。通过把DDS的核心部件——相位累加器改进为回旋相位累加器,使得存储波形数据的ROM空间降低50%,频率分辨率提升了1倍。另外,在QuartusⅡ,VC与Labwindows/CVI的混合仿真环境下,使得设计完全避免了硬件平台的限制,增加了硬件实现的成功率。
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关键词
现场可编程门阵列
直接数字频率合成器
回旋相位累加器
混合仿真
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职称材料
题名
混合仿真下DDS的改进研究与实现
1
作者
周磊
王紫婷
机构
兰州交通大学电子信息工程学院
出处
《现代电子技术》
2007年第15期84-86,共3页
基金
兰州交通大学学生科技创新基金项目(DXS-2006-22)
文摘
基于高性能FPGA实现的DDS电路是某些对于控制方式、置频速率等方面有特殊要求场合的最佳选择。通过把DDS的核心部件——相位累加器改进为回旋相位累加器,使得存储波形数据的ROM空间降低50%,频率分辨率提升了1倍。另外,在QuartusⅡ,VC与Labwindows/CVI的混合仿真环境下,使得设计完全避免了硬件平台的限制,增加了硬件实现的成功率。
关键词
现场可编程门阵列
直接数字频率合成器
回旋相位累加器
混合仿真
Keywords
FPGA
DDS
whirl accumulator
mixed simulation
分类号
TP391.9 [自动化与计算机技术—计算机应用技术]
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作者
出处
发文年
被引量
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1
混合仿真下DDS的改进研究与实现
周磊
王紫婷
《现代电子技术》
2007
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