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基于多径瑞利衰落信道的非规则LDPC码分析性能 被引量:2
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作者 吴晓丽 葛建华 岳安军 《空军工程大学学报(自然科学版)》 CSCD 北大核心 2006年第4期47-51,共5页
分析了在静态多径瑞利衰落信道上应用于正交频分复用技术的非规则LDPC码在相同的调制方式,不同的映射模式下的误码性能,并与规则LDPC码的性能作了比较,结果显示,在静态多径瑞利衰落信道上,不同的映射模式下,非规则LDPC码的误码性能均优... 分析了在静态多径瑞利衰落信道上应用于正交频分复用技术的非规则LDPC码在相同的调制方式,不同的映射模式下的误码性能,并与规则LDPC码的性能作了比较,结果显示,在静态多径瑞利衰落信道上,不同的映射模式下,非规则LDPC码的误码性能均优于规则LDPC码的误码性能,非规则LDPC码在相同的调制方式下,格雷映射的误码性能优于自然映射的误码性能。 展开更多
关键词 规则LDPC码 非规则LDPC码 正交频分复用 和-积算法
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CMMB系统中的LDPC码性能分析及译码器VLSI实现(英文)
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作者 刘海洋 张浩 +1 位作者 曲文泽 陈杰 《系统仿真学报》 CAS CSCD 北大核心 2011年第4期798-802,共5页
对CMMB标准中的LDPC码进行了研究。分析了该标准中两种不同码率的LDPC码采用和-积算法和最小-和算法的浮点性能,得出在相同迭代次数的条件下最小-和算法的性能接近和-积算法。选择最小-和算法进行VLSI实现,并提出了一种有效的量化方案... 对CMMB标准中的LDPC码进行了研究。分析了该标准中两种不同码率的LDPC码采用和-积算法和最小-和算法的浮点性能,得出在相同迭代次数的条件下最小-和算法的性能接近和-积算法。选择最小-和算法进行VLSI实现,并提出了一种有效的量化方案。仿真结果表明,量化后的性能相对于浮点运算的性能几乎没有性能损失。此外,设计了LDPC译码器的VLSI结构并且在Altera Stratix II EP2S130器件上进行了综合验证。综合结果表明,设计的译码器的最大时钟频率为90.7 MHz,在该频率下可以达到49.1 Mbps的高吞吐率,完全满足CMMB标准要求。 展开更多
关键词 LDPC码 CMMB 和-积算法 最小-算法 量化方案 VLSI实现
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