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同步动态随机存储器辐射效应测试系统研制 被引量:4
1
作者 姚志斌 罗尹虹 +3 位作者 陈伟 何宝平 张凤祁 郭红霞 《强激光与粒子束》 EI CAS CSCD 北大核心 2013年第10期2699-2704,共6页
在分析同步动态随机存储器(SDRAM)辐射效应主要失效现象的基础上,研制了具备了读写功能测试、刷新周期测试及功耗电流测试三种功能的SDRAM辐射效应在线测试系统,并开展了SDRAM的总剂量效应实验研究。结果表明,总剂量效应会导致SDRAM器... 在分析同步动态随机存储器(SDRAM)辐射效应主要失效现象的基础上,研制了具备了读写功能测试、刷新周期测试及功耗电流测试三种功能的SDRAM辐射效应在线测试系统,并开展了SDRAM的总剂量效应实验研究。结果表明,总剂量效应会导致SDRAM器件的数据保持时间不断减小,功耗电流不断增大以及读写功能失效。实验样品MT48LC8M32B2的功能失效主要由外围控制电路造成,而非存储单元翻转。数据保持时间虽然随着辐照剂量的累积不断减小,但不是造成该器件功能失效的直接原因。 展开更多
关键词 同步动态随机存储器 辐射效应 测试系统 刷新周期 总剂量效应
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基于FPGA的以太网与E1网中的同步动态随机存储控制器设计 被引量:1
2
作者 符世龙 陈松岩 《厦门大学学报(自然科学版)》 CAS CSCD 北大核心 2013年第3期360-365,共6页
为了实现不同速率数据链路通信的相互转换,提出了一种利用现场可编程门序列(FPGA)设计并实现可对同步动态随机存储器(SDRAM)进行数据缓存并高速读写的控制器.该控制器采取状态机和令牌环机制,通过对SDRAM操作,实现了双向4路的跨时钟域... 为了实现不同速率数据链路通信的相互转换,提出了一种利用现场可编程门序列(FPGA)设计并实现可对同步动态随机存储器(SDRAM)进行数据缓存并高速读写的控制器.该控制器采取状态机和令牌环机制,通过对SDRAM操作,实现了双向4路的跨时钟域的匹配.该控制器适用于任意长度的以太网帧和其他类型的数据相互转换. 展开更多
关键词 同步动态随机存储器 跨时钟域通信 现场可编程门序列 以太网帧
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一种自适应的存储器访问乱序调度机制
3
作者 杨磊 逄珺 +3 位作者 时磊 张铁军 王东辉 侯朝焕 《计算机工程》 CAS CSCD 北大核心 2009年第8期125-127,共3页
存储器访问速度已经成为现代处理器系统中的瓶颈。对于存储器访问的调度可以有效地提高存储器带宽利用率。基于一种称为突发调度的机制进行改进,通过使用优先级表达式从各个块里选择最合适的突发来访问存储器,运用自适应的方法来调节优... 存储器访问速度已经成为现代处理器系统中的瓶颈。对于存储器访问的调度可以有效地提高存储器带宽利用率。基于一种称为突发调度的机制进行改进,通过使用优先级表达式从各个块里选择最合适的突发来访问存储器,运用自适应的方法来调节优先级表达式里各项的系数,使得这一方法针对不同的应用都能取得好的效果。通过运行SPECCPU2000测试程序和stream程序,与顺序访问机制以及突发调度机制相比,该自适应调度机制将总线利用率分别提高了52%和4.8%。[0] 展开更多
关键词 同步动态随机存储器 存储器 突发 自适应
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基于训练方式的存储器时钟信号的自适应同步
4
作者 陆辰鸿 胡越黎 周俊 《上海大学学报(自然科学版)》 CAS CSCD 北大核心 2015年第4期393-401,共9页
存储器是现代电子系统的核心器件之一,常用于满足不同层次的数据交换与存储需求.然而频率提高、时钟抖动、相位漂移以及不合理的布局布线等因素,都可能导致CPU对存储器访问稳定性的下降.针对同步动态随机读写存储器(synchronous dynamic... 存储器是现代电子系统的核心器件之一,常用于满足不同层次的数据交换与存储需求.然而频率提高、时钟抖动、相位漂移以及不合理的布局布线等因素,都可能导致CPU对存储器访问稳定性的下降.针对同步动态随机读写存储器(synchronous dynamic random access memory,SDRAM)接口的时钟信号提出了一种自适应同步的训练方法,即利用可控延迟链使时钟相位按照训练模式偏移到最优相位,从而保证了存储器访问的稳定性.在芯片内部硬件上提供了一个可通过CPU控制的延迟电路,用来调整SDRAM时钟信号的相位.在系统软件上设计了训练程序,并通过与延迟电路的配合来达到自适应同步的目的:当CPU访问存储器连续多次发生错误时,系统抛出异常并自动进入训练模式.该模式令CPU在SDRAM中写入测试数据并读回,比对二者是否一致.根据测试数据比对结果,按训练模式调整延迟电路的延迟时间.经过若干次迭代,得到能正确访问存储器的延迟时间范围,即"有效数据采样窗口",取其中值即为SDRAM最优时钟相位偏移,完成训练后对系统复位,并采用新的时钟相位去访问存储器,从而保证读写的稳定性.仿真实验结果表明,本方法能迅速而准确地捕捉到有效数据采样窗口的两个端点位置,并以此计算出最佳的延迟单元数量,从而实现提高访问外部SDRAM存储器稳定性的目的. 展开更多
关键词 同步动态随机读写存储器 延迟电路 训练 自适应
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弹光调制高速大容量存储系统 被引量:2
5
作者 王耀利 王志斌 +3 位作者 赵冬娥 张敏娟 黄艳飞 张瑞 《计算机工程与设计》 CSCD 北大核心 2013年第8期2732-2736,共5页
为有效解决弹光调制(photoelastic modulation)傅里叶变换光谱仪数据采集速度高、存储容量大的问题,提出了一种基于FPGA和SDRAM相结合的高速数据存储方案。该方案在分析SDRAM的工作时序和系统各功能模块的基础上,在Xilinx ISE 12.4的开... 为有效解决弹光调制(photoelastic modulation)傅里叶变换光谱仪数据采集速度高、存储容量大的问题,提出了一种基于FPGA和SDRAM相结合的高速数据存储方案。该方案在分析SDRAM的工作时序和系统各功能模块的基础上,在Xilinx ISE 12.4的开发环境中,利用Verilog硬件描述语言编程,对数据的高速存储进行了设计输入和仿真验证,实现了SDRAM的突发全页传输模式,读写速度达到了100MHz,存储容量为64M,通过设计存储控制板实现了硬件测试,验证了该设计的可行性和准确性,实现了弹光调制傅里叶变换光谱仪高速大容量数据存储。 展开更多
关键词 弹光调制 高速存储 同步动态随机存储器 现场可编程门阵列 VERILOG硬件描述语言
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基于前递预取的SoC内存控制器精准仿真方法
6
作者 李作骏 卢天越 陈明宇 《高技术通讯》 北大核心 2025年第5期480-489,共10页
本文提出一种基于现场可编辑门阵列(field programmable gate array,FPGA)的内存控制器性能精确仿真评估方法,通过高速可扩展接口(advanced extensible interface,AXI)总线前递、访存预取和数据缓存的方式解决了FPGA芯片内外访存时序需... 本文提出一种基于现场可编辑门阵列(field programmable gate array,FPGA)的内存控制器性能精确仿真评估方法,通过高速可扩展接口(advanced extensible interface,AXI)总线前递、访存预取和数据缓存的方式解决了FPGA芯片内外访存时序需求不一致的问题,从而实现了在真实处理器系统应用仿真场景下对内存控制器的精确性能评估。与香山开源第5代精简指令集计算机(reduced instruction set computer-five,RISC-V)处理器雁栖湖架构硅后芯片对比,SPEC CPU2006基准测试程序的执行时间平均偏差为1.29%,最大偏差为3.45%。该方法解决了因为内存控制器模型不准确而导致FPGA片上系统(system of chip,SoC)原型系统中真实应用仿真性能评估与流片后实际性能存在较大偏差的问题,同时无需进行大量修改就能用于任何支持AXI和双倍数据速率物理层接口(DDR PHY interface,DFI)协议的标准内存控制器精确仿真。 展开更多
关键词 内存控制器 现场可编辑门阵列 性能评估 双倍数据速率 动态随机访问存储器
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基于USB 2.0及SDRAM的大容量存储卡设计 被引量:1
7
作者 熊兴中 汪学刚 《现代电子技术》 2005年第20期32-34,共3页
传统的存储卡常采用PC I接口或EPP接口,这两种接口的数据传输能力有限,在大容量、高速度数据传输时不能满足实际要求,而且他们不支持热拨插和即插即用,使用不方便,而U SB 2.0的数据传输速率可达480 M b/s,支持热拨插和即插即用;SDRAM是... 传统的存储卡常采用PC I接口或EPP接口,这两种接口的数据传输能力有限,在大容量、高速度数据传输时不能满足实际要求,而且他们不支持热拨插和即插即用,使用不方便,而U SB 2.0的数据传输速率可达480 M b/s,支持热拨插和即插即用;SDRAM是一种常用且性价比较高的高速存储器。基于U SB 2.0及SDRAM的大容量存储卡的设计,采用CY 7C 68013作为U SB通信及控制芯片,结合CPLD技术,实现了存储卡上SDRAM与计算机以及后续电路之间大容量、高速度数据传输,当CY 7C 68013工作为从模式时,slave F IFO与SDRAM之间的数据传输的最高速率可达到96 M B/s,该存储卡在高速信号处理领域中有着广泛的应用价值。 展开更多
关键词 USB 2.0协议 同步动态随机存储器 复杂可编程器件 固件
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用于空间遥感相机模拟源系统的DDR2 SDRAM高速存储电路设计
8
作者 倪建军 李涛 王建宇 《中国科学院大学学报(中英文)》 CAS CSCD 北大核心 2013年第5期682-687,共6页
为了满足空间遥感相机电子学系统的功能验证需求,设计了一套由FPGA和DDR2 SDRAM等组成的空间遥感相机模拟源系统.针对DDR2 SDRAM在设计时的难度,从提高信号完整性出发,对DDR2 SDRAM的阻抗匹配形式和匹配电阻位置进行详细分析,并对PCB布... 为了满足空间遥感相机电子学系统的功能验证需求,设计了一套由FPGA和DDR2 SDRAM等组成的空间遥感相机模拟源系统.针对DDR2 SDRAM在设计时的难度,从提高信号完整性出发,对DDR2 SDRAM的阻抗匹配形式和匹配电阻位置进行详细分析,并对PCB布局布线及FPGA管脚约束设计给出可行性设计方案.实验结果表明,按照提出的设计方法,DDR2 SDRAM不论采用单端或差分时钟工作,均可保证数据以320 Mbps/pin来传输,信号质量依然理想. 展开更多
关键词 现场可编程门阵列 双倍速率同步动态随机存储器 管脚约束 空间遥感相机模拟源系统
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同时基于预知信息和预测机制的SDRAM动态页策略 被引量:1
9
作者 吕晖 谢向辉 《计算机工程与科学》 CSCD 北大核心 2015年第12期2208-2215,共8页
提出一种同时基于预知信息和预测机制的SDRAM新型动态页策略。该策略可充分利用待处理访存请求的地址信息,能对后续页命中情况进行精确判断;而当没有待处理访存请求可预知时,则利用所记录的历史信息对后续页命中情况进行预测,以最大程... 提出一种同时基于预知信息和预测机制的SDRAM新型动态页策略。该策略可充分利用待处理访存请求的地址信息,能对后续页命中情况进行精确判断;而当没有待处理访存请求可预知时,则利用所记录的历史信息对后续页命中情况进行预测,以最大程度地选择最合适的页策略。分析证明该策略的硬件实现代价很小。实验证实三类主要的基于预知信息的动态页策略之间的性能差异较小,均能获得较理想的访存带宽,最好情况下,实际访存带宽可提升42%。其中,对于绝大多数测试激励,同时基于预知信息和预测机制的新型动态页策略的性能均为最优或接近最优,适应范围最广。 展开更多
关键词 同步动态随机存储器 存储控制器 页打开策略 页关闭策略 动态页策略
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面向高性能众核处理器的超频DDR4访存结构设计
10
作者 高剑刚 李川 +2 位作者 郑浩 王彦辉 胡晋 《计算机工程与设计》 北大核心 2024年第3期715-722,共8页
从高性能众核处理器的多路DDR4嵌入式工程应用出发,设计一种高密度DDR4串推互连结构,提出一种基于不同激励码型的仿真分析方法。采用双面盲孔印制板工艺折叠串推访存结构设计,解决地址组信号概率性出错问题。在压力测试环境下实测读/写... 从高性能众核处理器的多路DDR4嵌入式工程应用出发,设计一种高密度DDR4串推互连结构,提出一种基于不同激励码型的仿真分析方法。采用双面盲孔印制板工艺折叠串推访存结构设计,解决地址组信号概率性出错问题。在压力测试环境下实测读/写信号波形良好,支持信号超频可靠传输,标称2666 Mbps的DDR4存储颗粒可以在3000 Mbps速率下长时间稳定运行。已在神威E级原型机等多台套大型计算装备研发中得到规模化推广应用,产生了良好的技术效益。 展开更多
关键词 双倍数据速率 同步动态随机存取存储器 折叠串推 码型仿真 信号传输 盲孔 超频
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一种嵌入式实时网络多媒体数据传输方法 被引量:2
11
作者 王再见 万婷 +1 位作者 吴丹丹 邢青青 《系统仿真学报》 CAS CSCD 北大核心 2017年第4期808-817,共10页
为提高实时视频数据采集和传输的速率,以现场可编程门阵列(Filed Programmable Gate Array,FPGA)为核心处理器,以Verilog HDL描述电路功能实现对同步动态随机访问存储器(Synchronous Dynamic Random Access Memory,SDRAM)的高速访问,基... 为提高实时视频数据采集和传输的速率,以现场可编程门阵列(Filed Programmable Gate Array,FPGA)为核心处理器,以Verilog HDL描述电路功能实现对同步动态随机访问存储器(Synchronous Dynamic Random Access Memory,SDRAM)的高速访问,基于典型网络实时传输网络多媒体业务数据。新的视频数据高速实时传输方法充分利用FPGA并行处理的特点,提高视频数据采集和传输速率。实验结果证明了本文方法的有效性。 展开更多
关键词 高速实时传输 现场可编程门阵列 同步动态随机访问存储器 硬件描述语言
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实时合成孔径雷达成像中的专用快速CTM算法 被引量:4
12
作者 张冠杰 张涛 +2 位作者 张欢阳 王贞松 张守宏 《西安电子科技大学学报》 EI CAS CSCD 北大核心 2006年第1期11-14,27,共5页
在分析同步动态随机存储器读写特性的基础上,提出了基于现场可编程门阵列的专用同步动态随机存储器控制器快速矩阵转置算法,实现了矩阵转置读写及顺序读写的等速与高效.该算法不仅充分地发挥了同步动态随机存储器的最佳矩阵转置读写性能... 在分析同步动态随机存储器读写特性的基础上,提出了基于现场可编程门阵列的专用同步动态随机存储器控制器快速矩阵转置算法,实现了矩阵转置读写及顺序读写的等速与高效.该算法不仅充分地发挥了同步动态随机存储器的最佳矩阵转置读写性能,而且也提高了高分辨率合成孔径雷达成像处理的实时性. 展开更多
关键词 同步动态随机存储器 合成孔径雷达 矩阵转置 实时处理
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基于FPGA的TFT-LCD控制器设计与实现 被引量:6
13
作者 唐徐立 黄君凯 +2 位作者 刘明峰 杨帆 陈伦海 《半导体技术》 CAS CSCD 北大核心 2010年第11期1134-1137,共4页
提出了一种基于FPGA的TFT-LCD控制器设计方案,通过片外增加显示存储器SDRAM,以及用于储存多种字库和图片的FLASH芯片,片内嵌入精简指令集和图形加速引擎的方法,增强在文字和图形控制上的灵活性。在系统模块层次划分的基础上,利用Verilo... 提出了一种基于FPGA的TFT-LCD控制器设计方案,通过片外增加显示存储器SDRAM,以及用于储存多种字库和图片的FLASH芯片,片内嵌入精简指令集和图形加速引擎的方法,增强在文字和图形控制上的灵活性。在系统模块层次划分的基础上,利用Verilog硬件描述语言对各模块进行描述和设计,并在Xilinx的XC3S500E上加以实现。测试结果表明,该系统可支持分辨率最大为800×600的TFT-LCD显示屏,刷新频率达到60 Hz,并支持图文混排显示等功能。 展开更多
关键词 TFT-LCD控制器 现场可编程门阵列 同步动态随机存储器 FLASH XC3S500E
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基于PCI总线的高速大容量数据采集卡 被引量:10
14
作者 和志强 薛世建 《数据采集与处理》 CSCD 2004年第4期463-466,共4页
介绍了一种基于 PCI总线的高速大容量数据采集卡的设计原理与实现。该采集卡由预处理电路、A/D转换器、同步动态随机存储器 (SDRAM)、高频时钟发生器、集成于 FPGA芯片的 PCI接口控制器和 SDRAM控制器组成。它通过 PCI总线接口与计算机... 介绍了一种基于 PCI总线的高速大容量数据采集卡的设计原理与实现。该采集卡由预处理电路、A/D转换器、同步动态随机存储器 (SDRAM)、高频时钟发生器、集成于 FPGA芯片的 PCI接口控制器和 SDRAM控制器组成。它通过 PCI总线接口与计算机连接 ,可完成 40 0 MHz/s实时数据采集、5 1 2 MB实时数据存储。 展开更多
关键词 基于PC 数据采集卡 总线 512MB 同步动态随机存储器 PCI接口 SDRAM 高频时钟 FPGA芯片 高速
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大面阵CCD图像实时显示系统中的SDRAM控制器设计 被引量:7
15
作者 王明富 杨世洪 《计算机应用》 CSCD 北大核心 2009年第5期1449-1451,共3页
在分析了同步动态随机存储器(SDRAM)的存储原理之后,针对大面阵CCD图像实时显示系统中的数据缓存问题,应用参数化设计思想,采用VHDL硬件描述语言在Xilinx公司的ISE开发环境下设计了一种较为通用的、接口简单的SDRAM控制器,并成功运用在... 在分析了同步动态随机存储器(SDRAM)的存储原理之后,针对大面阵CCD图像实时显示系统中的数据缓存问题,应用参数化设计思想,采用VHDL硬件描述语言在Xilinx公司的ISE开发环境下设计了一种较为通用的、接口简单的SDRAM控制器,并成功运用在大面阵CCD图像实时显示系统中,很好地完成了图像的存取任务。 展开更多
关键词 同步动态随机存储器 控制器 参数化设计 大面阵CCD 实时显示 现场可编程门阵列
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高速SDRAM控制器的嵌入式设计 被引量:3
16
作者 邓耀华 刘桂雄 吴黎明 《计算机工程》 CAS CSCD 北大核心 2010年第16期216-218,共3页
为适应高数据吞吐速率的应用场合,在分析同步动态随机存储器(SDRAM)控制器工作原理的基础上,研究支持高数据处理效率可连续读写操作的存储控制算法。利用现场可编程门阵列设计SDRAM嵌入式存储控制器,采用CMD命令形式,根据猝发长度分配... 为适应高数据吞吐速率的应用场合,在分析同步动态随机存储器(SDRAM)控制器工作原理的基础上,研究支持高数据处理效率可连续读写操作的存储控制算法。利用现场可编程门阵列设计SDRAM嵌入式存储控制器,采用CMD命令形式,根据猝发长度分配连续读写延时,通过数据通道控制与读写操作协同工作提高数据处理效率。测试结果表明,该控制器运行频率高于100 MHz,数据处理效率大于95%,适用于视频采集数据缓存及大型LED显示控制中。 展开更多
关键词 同步动态随机存储器 现场可编程门阵列 连续读写指令
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基于PCI总线的行波数据采集系统 被引量:2
17
作者 方力谦 李晓明 +1 位作者 高辉 熊友红 《电网技术》 EI CSCD 北大核心 2006年第3期80-84,共5页
在行波故障测距中,传统的数据采集系统无法满足采集高速变化的暂态电压、电流行波的要求,难以实现故障的精确定位。笔者研制了一种基于PCI总线的高速数据采集系统,介绍了系统原理和硬件电路。以现场可编程门阵列(Field Programmable Gat... 在行波故障测距中,传统的数据采集系统无法满足采集高速变化的暂态电压、电流行波的要求,难以实现故障的精确定位。笔者研制了一种基于PCI总线的高速数据采集系统,介绍了系统原理和硬件电路。以现场可编程门阵列(Field Programmable Gate Array,FPGA)作为中央处理器,通过高速A/D转换、同步动态随机存储器(Synchronous Dynamic Random Access Memory,SDRAM)和先进先出(First In First Out,FIFO)高速缓冲存储及PCI总线传输实现高速数据采集。该系统可实现高达100MHz的采样频率,能有效解决输电线路暂态行波的采集问题,在故障定位及微机保护中均能得到广泛应用。 展开更多
关键词 高速数据采集 现场可编程门阵列 PCI总线 行波 同步动态随机存储器 先进先出
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一种避免页迁移的混合内存页管理策略 被引量:1
18
作者 刘翠梅 杨璇 +1 位作者 贾刚勇 韩光洁 《小型微型计算机系统》 CSCD 北大核心 2019年第6期1318-1323,共6页
相变存储器(Phase-change Memory,PCM)具有非易失性、能耗低、密度大等诸多优点,将成为下一代主流存储器.然而,相变存储器的写操作速度慢以及写次数有限的特征限制其立马替代现有主流的双倍速率同步动态随机存储器(DDR系列).为了发挥两... 相变存储器(Phase-change Memory,PCM)具有非易失性、能耗低、密度大等诸多优点,将成为下一代主流存储器.然而,相变存储器的写操作速度慢以及写次数有限的特征限制其立马替代现有主流的双倍速率同步动态随机存储器(DDR系列).为了发挥两种存储介质各自的优势,目前主要采用混合内存的体系结构,该结构不仅包括新型的相变存储器同时还包括传统的动态随机存储器.针对混合内存结构,数据划分变得尤为重要,目前大多数划分算法采用页面迁移作为保障效率和损耗的手段.但是迁移需要消耗大量的处理器资源,同时导致大量不必要的写相变存储器的操作,降低混合内存系统的性能和寿命.为了减少迁移操作带来的效率损失,本文提出一种避免页迁移的混合内存页管理策略(PMP)提高混合内存系统的性能和寿命.该策略最大的优势在于提出了一种基于虚拟内存页的访存行为特征分析方法,能够高效准确的获取各页的访存行为,所以在系统运行过程中避免因页分配错误导致的页迁移操作.实验表明本文提出的避免页迁移的混合内存页管理策略(PMP)能够有效的提高混合内存系统的性能和寿命. 展开更多
关键词 相变存储器 双倍速率同步动态随机存储器 内存页管理 混合内存
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基于FPGA和DDR的高效率矩阵转置方法 被引量:2
19
作者 吴沁文 《现代雷达》 CSCD 北大核心 2017年第4期34-40,44,共8页
用可编程门阵列(FPGA)作为主处理芯片实现雷达信号处理时,大阶数矩阵转置经常由于双倍速率同步动态随机存储器(DDR)的跳行访问速率而成为系统处理速率的瓶颈。文中分析了DDR的读写机制,对DDR读写时间的组成进行了定量分析,提出了一种提... 用可编程门阵列(FPGA)作为主处理芯片实现雷达信号处理时,大阶数矩阵转置经常由于双倍速率同步动态随机存储器(DDR)的跳行访问速率而成为系统处理速率的瓶颈。文中分析了DDR的读写机制,对DDR读写时间的组成进行了定量分析,提出了一种提高矩阵转置效率的分块式矩阵转置方法。该方法采用矩阵分块技术,使矩阵转置时DDR的读写速率得以均衡,从而提高DDR读写的平均效率。文中提供了矩阵转置效率的实验室实测数据,验证了该方法的有效性。该方法已在工程实践中得到了成功的应用。 展开更多
关键词 可编程门阵列 双倍速率同步动态随机存储器 矩阵转置
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一种基于DDR的PS与PL数据交互方法的设计与实现 被引量:1
20
作者 陈小宇 李常对 阳梦雪 《电子测量技术》 北大核心 2021年第24期79-84,共6页
针对片上系统芯片中处理系统和可编程逻辑之间数据交互量大的应用,提出了一种基于双倍速率同步动态随机存储器的PS与PL数据交互方法。PS与PL通过访问共同的DDR,按照自定义的协议进行数据交互。将DDR中用于数据交互的空间划分为指令空间... 针对片上系统芯片中处理系统和可编程逻辑之间数据交互量大的应用,提出了一种基于双倍速率同步动态随机存储器的PS与PL数据交互方法。PS与PL通过访问共同的DDR,按照自定义的协议进行数据交互。将DDR中用于数据交互的空间划分为指令空间和数据空间,PS和PL通过读写指令空间中的指令数据并按照协议分析其所传递的信息,以控制各自的读写进程。PL通过高速片内总线访问DDR,PS利用内存读写工具实现对DDR的读写。测试结果表明该交互方法具有速度快、占用逻辑资源少、使用方便等优点,数据交互速度可达88 MB/s,适用于PS和PL需要实时交互大量数据的应用场景,在基于三维激光雷达的车辆实时高精度定位系统中得到了成功应用。 展开更多
关键词 片上系统 数据交互 AXI总线 处理系统 可编程逻辑 双倍速率同步动态随机存储器
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