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同步动态随机存储器辐射效应测试系统研制 被引量:4
1
作者 姚志斌 罗尹虹 +3 位作者 陈伟 何宝平 张凤祁 郭红霞 《强激光与粒子束》 EI CAS CSCD 北大核心 2013年第10期2699-2704,共6页
在分析同步动态随机存储器(SDRAM)辐射效应主要失效现象的基础上,研制了具备了读写功能测试、刷新周期测试及功耗电流测试三种功能的SDRAM辐射效应在线测试系统,并开展了SDRAM的总剂量效应实验研究。结果表明,总剂量效应会导致SDRAM器... 在分析同步动态随机存储器(SDRAM)辐射效应主要失效现象的基础上,研制了具备了读写功能测试、刷新周期测试及功耗电流测试三种功能的SDRAM辐射效应在线测试系统,并开展了SDRAM的总剂量效应实验研究。结果表明,总剂量效应会导致SDRAM器件的数据保持时间不断减小,功耗电流不断增大以及读写功能失效。实验样品MT48LC8M32B2的功能失效主要由外围控制电路造成,而非存储单元翻转。数据保持时间虽然随着辐照剂量的累积不断减小,但不是造成该器件功能失效的直接原因。 展开更多
关键词 同步动态随机存储器 辐射效应 测试系统 刷新周期 总剂量效应
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同步动态随机存储器的控制器设计与实现 被引量:7
2
作者 吴进 刘路 《西安邮电学院学报》 2012年第5期78-80,83,共4页
为了满足不同平台的需求,简化同步动态随机存储器(SDRAM)的控制器,采用现场可编程门阵列(FPGA)方法,给出一种SDRAM控制器设计方案。引入的仲裁机制可以用Verilog硬件描述语言编写,灵活性强,只需加以简单修改即可满足不同需求。仿真结果... 为了满足不同平台的需求,简化同步动态随机存储器(SDRAM)的控制器,采用现场可编程门阵列(FPGA)方法,给出一种SDRAM控制器设计方案。引入的仲裁机制可以用Verilog硬件描述语言编写,灵活性强,只需加以简单修改即可满足不同需求。仿真结果表明,采用基于FPGA设计的SDRAM控制器能很好完成规定读写操作。 展开更多
关键词 同步动态随机存储器 控制器 现场可编程门阵列Verilog硬件描述语言
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凌力尔特推出双通道单片同步降压型稳压器为DDR1、DDR2或DDR3存储器供电
3
《电子与电脑》 2011年第7期66-66,共1页
凌力尔特公司(Linea Technology)推出高效率、双通道单片同步降压型稳压器LTC3634.该器件为DDR1,DDR2和DDR3 SDRAM控制器提供电源和总线终端轨。LTC3634在3.6V~15V的输入电压范围内工作.从而非常适用于双节锂离子电池应用以及5V... 凌力尔特公司(Linea Technology)推出高效率、双通道单片同步降压型稳压器LTC3634.该器件为DDR1,DDR2和DDR3 SDRAM控制器提供电源和总线终端轨。LTC3634在3.6V~15V的输入电压范围内工作.从而非常适用于双节锂离子电池应用以及5V和12V中间总线系统。LTC3634采用独特的恒定频率/受控接通时间、电流模式架构.这种架构非常适用于从一个12V输入电源以高开关频率给DDR应用供电。 展开更多
关键词 同步降压型稳压器 DDR2 供电源 双通道 单片 存储器 sdram控制器 总线系统
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基于USB 2.0及SDRAM的大容量存储卡设计 被引量:1
4
作者 熊兴中 汪学刚 《现代电子技术》 2005年第20期32-34,共3页
传统的存储卡常采用PC I接口或EPP接口,这两种接口的数据传输能力有限,在大容量、高速度数据传输时不能满足实际要求,而且他们不支持热拨插和即插即用,使用不方便,而U SB 2.0的数据传输速率可达480 M b/s,支持热拨插和即插即用;SDRAM是... 传统的存储卡常采用PC I接口或EPP接口,这两种接口的数据传输能力有限,在大容量、高速度数据传输时不能满足实际要求,而且他们不支持热拨插和即插即用,使用不方便,而U SB 2.0的数据传输速率可达480 M b/s,支持热拨插和即插即用;SDRAM是一种常用且性价比较高的高速存储器。基于U SB 2.0及SDRAM的大容量存储卡的设计,采用CY 7C 68013作为U SB通信及控制芯片,结合CPLD技术,实现了存储卡上SDRAM与计算机以及后续电路之间大容量、高速度数据传输,当CY 7C 68013工作为从模式时,slave F IFO与SDRAM之间的数据传输的最高速率可达到96 M B/s,该存储卡在高速信号处理领域中有着广泛的应用价值。 展开更多
关键词 USB 2.0协议 同步动态随机存储器 复杂可编程器件 固件
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多标准视频硬件解码器的存储器地址映射方法 被引量:1
5
作者 陆泳 张文军 刘佩林 《电视技术》 北大核心 2006年第12期39-42,共4页
提出了一种支持多标准视频的存储器地址映射方法,用一个简洁的公式把视频图像映射到DDRSDRAM的存储空间。该方法兼顾运动补偿模块、去块效应滤波模块(或重建模块)和显示模块的不同需求特点,通过充分减少DDRSDRAM非读写命令的额外延时,... 提出了一种支持多标准视频的存储器地址映射方法,用一个简洁的公式把视频图像映射到DDRSDRAM的存储空间。该方法兼顾运动补偿模块、去块效应滤波模块(或重建模块)和显示模块的不同需求特点,通过充分减少DDRSDRAM非读写命令的额外延时,达到较高的存储器接口效率。 展开更多
关键词 地址映射 倍速同步动态随机存储器 多标准视频 运动补偿
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多路读写的SDRAM接口设计 被引量:10
6
作者 赵丕凤 徐元欣 +1 位作者 赵亮 李式巨 《电子技术应用》 北大核心 2002年第9期11-13,共3页
介绍SDRAM的主要控制信号和基本命令时序,提出一种应用于解复用的支持多路读写的SDRAM接口设计,为需要大容量存储器的电路设计提供了新思路。
关键词 多路读写 sdram 解复用 接口 同步动态随机存储器
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视频处理算法中的SDRAM接口设计 被引量:2
7
作者 徐红 梁骏 +1 位作者 缪纲 王匡 《电视技术》 北大核心 2004年第3期14-15,24,共3页
提出了一种在视频处理算法电路中的SDRAM接口设计,它巧妙地利用SDRAM高效的Full-page模式和Ping-Pang模式,在性能和模式选择上进行了很好的折衷,为需要大容量、高吞吐率存储器进行高速率数据处理提供了新思路。
关键词 sdram 视频处理 Full-page模式 Ping-Pang模式 同步动态随机存储器 接口
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一种DDR SDRAM控制器设计 被引量:5
8
作者 蔡钟 吴皓 +1 位作者 刘鹏 王维东 《电视技术》 北大核心 2004年第8期34-36,44,共4页
在分析DDRSDRAM基本操作原理的基础上,提出了一个基于FPGA的DDRSDRAM控制器的设计,实现了DDRSDRAM读写时序控制,并给出实现结果。
关键词 双数据率同步动态随机访问存储器 现场可编程门阵列 控制器
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SDRAM控制器的FPGA设计与实现 被引量:13
9
作者 李卫 王杉 魏急波 《电子工程师》 2004年第10期29-32,共4页
介绍了利用现场可编程门阵列 (FPGA)实现同步动态随机存储器 (SDRAM)控制器的方法 ,着重于FPGA具体实现过程中的一些常见问题。分析了设计中所用的SDRAM性能、特点 ,给出了其读写时序状态图 ,给出SDRAM初始化方式及其相应的模式设置值 ... 介绍了利用现场可编程门阵列 (FPGA)实现同步动态随机存储器 (SDRAM)控制器的方法 ,着重于FPGA具体实现过程中的一些常见问题。分析了设计中所用的SDRAM性能、特点 ,给出了其读写时序状态图 ,给出SDRAM初始化方式及其相应的模式设置值 ,并根据本设计的实际情况对SDRAM状态机进行了简化 ,给出了一种相对容易实现的SDRAM状态机。本设计采用甚高速集成电路硬件描述语言 (VHDL)编程 ,直观而且占用资源较少 ,其基本设计原理对其他同类SDRAM也适用 ,对需要大容量存储器的应用是较经济的设计。 展开更多
关键词 现场可编程门阵列(FPGA) 同步动态随机存储器(sdram) 控制器
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一种适用于MCU的SDRAM控制器的实现方法 被引量:2
10
作者 谢时根 张利 王志华 《电视技术》 北大核心 2003年第5期69-70,76,共3页
介绍了同步动态存储器SDRAM的特点、操作原理,提出了一种对于MCU等微控制器有着友好接口的SDRAM控制器的实现方法,使得不带SDRAM控制器的微处理器可以方便地实现对于SDRAM的控制。
关键词 同步动态存储器 sdram MCU 微控制器 结构设计
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SDRAM在任意波形发生器中的应用 被引量:2
11
作者 储飞黄 杨景曙 黄崧 《电子技术应用》 北大核心 2003年第8期61-63,共3页
随着任意波形发生器工作频率的不断提高,为了精确表达复杂信号,使用SRAM作为波形存储体已不能满足容量上的要求。介绍了一种基于SDRAM的设计方案,能有效解决这一问题。文中重点讨论了一种简化SDRAM控制器的设计方法。
关键词 sdram 任意波形发生器 工作频率 同步动态存储器 可编程逻辑器件
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高速DSP与SDRAM之间信号传输延时的分析及应用 被引量:1
12
作者 葛宝珊 裴艳薇 王希常 《电子技术应用》 北大核心 2003年第5期73-75,共3页
在高速数字电路设计中,信号在印刷电路板(PCB)上的传输延时对于电路的时序影响已不容忽视。详细分析并推导了高速数字信号处理器(DSP)与同步动态随机存取存储器(SDRAM)之间各信号的传输延时约束关系;通过一个实例,给出了应用约束条件的... 在高速数字电路设计中,信号在印刷电路板(PCB)上的传输延时对于电路的时序影响已不容忽视。详细分析并推导了高速数字信号处理器(DSP)与同步动态随机存取存储器(SDRAM)之间各信号的传输延时约束关系;通过一个实例,给出了应用约束条件的具体方法。 展开更多
关键词 DSP sdram 信号传输延时 数字信号处理器 同步动态随机存取存储器 数字电路设计 印刷电路板
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基于网口传输的LED同步屏控制系统及其FPGA实现 被引量:4
13
作者 刘丽莎 朱桦 韩秀清 《电子设计工程》 2010年第2期63-66,共4页
介绍一种以FPGA为核心,基于网口传输的全彩高灰度同步LED显示屏控制系统的设计方法。该设计改变传统设计中低效高成本的信号采集和传送方式,改用实时采集DVI接口显示信号、通过网口传输数据,采用高集成度FPGA和大容量SDRAM,采用信号包... 介绍一种以FPGA为核心,基于网口传输的全彩高灰度同步LED显示屏控制系统的设计方法。该设计改变传统设计中低效高成本的信号采集和传送方式,改用实时采集DVI接口显示信号、通过网口传输数据,采用高集成度FPGA和大容量SDRAM,采用信号包复用技术同步传送显示数据和控制数据及高效率的灰度切片算法等新技术,具有成本低、显示面积大、显示稳定、刷新率高等特点。 展开更多
关键词 DVI FPGA 百兆网口 同步LED显示屏控制系统 同步动态随机存储器 灰度切片算法
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利用EPLD实现TMS320C5402与SDRAM接口 被引量:1
14
作者 尹军 梁光明 唐朝京 《电子技术应用》 北大核心 2001年第8期63-64,62,共3页
介绍了基于电可擦除可编程逻辑器件 EPLD,用VHDL语言设计实现的TMS320C5402与SDRAM的接口电路。
关键词 电可擦除可编程逻辑器件 数字信号处理器 同步动态随机存储器 接口电路
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用于高速图像处理的DDR2 SDRAM控制器 被引量:3
15
作者 韩刚 《西安邮电大学学报》 2015年第4期58-61,共4页
为满足图像数据处理对高速大容量存储的需要,设计一种DDR2SDRAM控制器。采用模块化设计方法,通过基础模块、物理层模块、用户接口模块和控制模块实现对DDR2SDRAM的控制。仿真结果与验证结果表明,该控制器能够有效可行,32位数据总线最大... 为满足图像数据处理对高速大容量存储的需要,设计一种DDR2SDRAM控制器。采用模块化设计方法,通过基础模块、物理层模块、用户接口模块和控制模块实现对DDR2SDRAM的控制。仿真结果与验证结果表明,该控制器能够有效可行,32位数据总线最大传输率达到12.8Gbit/s。 展开更多
关键词 图像处理 双倍速率同步动态随机存储器 现场可编程门阵列
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基于J750EX测试系统的SDRAM测试技术研究 被引量:3
16
作者 王征宇 何志伟 章少云 《电子与封装》 2014年第8期18-24,41,共8页
SDRAM(Synchronous Dynamic Random Access Memory,同步动态随机存储器)以其卓越的性能、低廉的价格得到了广泛的应用,但由于此类器件具有容量较大(通常为百兆级及以上)、对其实施控制较复杂等特点,使得SDRAM的测试也存在较高难度,因此... SDRAM(Synchronous Dynamic Random Access Memory,同步动态随机存储器)以其卓越的性能、低廉的价格得到了广泛的应用,但由于此类器件具有容量较大(通常为百兆级及以上)、对其实施控制较复杂等特点,使得SDRAM的测试也存在较高难度,因此,探索SDRAM的测试技术,并创建该类器件的测试平台也具有十分重要的意义。首先介绍了SDRAM的基本工作原理,其次详细阐述了基于J750EX测试系统的测试技术研究,提出了采用J750EX系统的DSIO资源实现SDRAM地址累加生成的方法,大大减少了测试矢量长度,可以有效节省测试开发时间,降低测试成本。另外,针对SDRAM的关键时序参数,如tRCD(行选通周期)、CL(读取潜伏期)、tWR(写回时间)等,使用测试系统为器件施加适当的控制激励,完成SDRAM复杂的时序配合,从而达到器件性能的测试要求。 展开更多
关键词 同步动态随机存储器 DSIO J750EX
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基于DMA传输方式的SDRAM控制器的设计与实现 被引量:3
17
作者 顾峰 《舰船电子对抗》 2009年第2期108-111,共4页
在简单介绍同步动态随机存储器(SDRAM)的基础上,提出了一种基于直接存储器读取(DMA)传输方式的SDRAM控制器,详细介绍了DMA控制器和SDRAM控制器的设计,并说明了其现场可编程门阵列(FPGA)实现后的性能。
关键词 直接存储器读取传输 同步动态随机存储控制器 现场可编程门阵列
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基于FPGA实现TMS320VC3X与SDRAM接口
18
作者 王维博 吴自恒 《四川工业学院学报》 2003年第4期6-8,共3页
 同步动态随机存储器(SDRAM)具有高速,大容量,价格低廉等优点,因而成为缓冲存储器的首选,但是SDRAM控制时序比较复杂,不能与DSP直接接口,这极大地限制了它的广泛应用。为了满足电力系统运行对故障数据的精度和实时要求,本文作者基于FPG...  同步动态随机存储器(SDRAM)具有高速,大容量,价格低廉等优点,因而成为缓冲存储器的首选,但是SDRAM控制时序比较复杂,不能与DSP直接接口,这极大地限制了它的广泛应用。为了满足电力系统运行对故障数据的精度和实时要求,本文作者基于FPGA提出了一种简单易用的方案,用VHDL语言实现TMS320VC3X与SDRAM的接口。 展开更多
关键词 硬件描述语言 现场可编程逻辑门阵列 数字信号处理器 同步动态随机存储器
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基于FPGA的支持切换Bank的SDRAM控制器设计 被引量:7
19
作者 武文杰 刘皓 李少谦 《信息技术》 2006年第1期33-36,共4页
介绍了一种高效使用SDRAM的方法———切换BANK存取操作,并提出了一种基于FPGA的SDRAM控制器的设计方法,不仅支持对SDRAM进行普通的存取操作,而且还支持切换BANK存取操作。通过使用切换BANK存取操作,大大提高了SDRAM的使用效率,增大了... 介绍了一种高效使用SDRAM的方法———切换BANK存取操作,并提出了一种基于FPGA的SDRAM控制器的设计方法,不仅支持对SDRAM进行普通的存取操作,而且还支持切换BANK存取操作。通过使用切换BANK存取操作,大大提高了SDRAM的使用效率,增大了数据吞吐量。 展开更多
关键词 同步动态随机存储器 切换Bank VERILOG HDL 状态机
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一种适用于DDR SDRAM控制器的DLL新结构 被引量:1
20
作者 叶波 罗敏 王紫石 《固体电子学研究与进展》 CAS CSCD 北大核心 2008年第2期299-303,共5页
提出了一种适用于DDR SDRAM控制器的DLL新结构,在不同的工艺、电压和温度(PVT)条件下,DDR SDRAM的数据经过传输线传输后均能被器件采样到正确的数据。采用256M133MHz DDR SDRAM和1.5V、0.16μm CMOS标准单元库,模拟和测试结果都表明了... 提出了一种适用于DDR SDRAM控制器的DLL新结构,在不同的工艺、电压和温度(PVT)条件下,DDR SDRAM的数据经过传输线传输后均能被器件采样到正确的数据。采用256M133MHz DDR SDRAM和1.5V、0.16μm CMOS标准单元库,模拟和测试结果都表明了该结构的正确性。该结构同样可用于其它不同PVT条件下需要固定延迟的电路。 展开更多
关键词 双数据率 延迟锁相环 同步动态随机存取存储器 工艺电压温度
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