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题名基于FPGA的可重构JH算法设计与实现
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作者
周权
王奕
李仁发
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机构
湖南大学嵌入式系统及网络实验室
湖南大学网络与信息安全湖南省重点实验室
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出处
《计算机工程》
CAS
CSCD
2012年第11期208-210,共3页
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基金
国家自然科学基金资助项目(60873074
60673061)
长沙市科技计划基金资助项目(K1003028-11)
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文摘
针对现有可重构JH算法硬件实现方案吞吐量较低的问题,利用查找表方法对S盒进行优化,使改进的JH算法在现场可编程门阵列上实现时具有速度快和面积小的特点,在此基础上提出一种可重构方案。实验结果证明,该方案最高时钟频率可达322.81 MHz,占用1 405 slices,具有资源占用少、性能参数较好、功耗较低等特点。
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关键词
JH算法
安全哈希算法
现场可编程门阵列
可重构算法
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Keywords
JH algorithm
Secure Hash Algorithm（SHA）
Field Programmable Gate Array（FPGA）
reconfigurable algorithm
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分类号
TP312
[自动化与计算机技术—计算机软件与理论]
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题名基于SoC可重构密码算法IP核接口电路设计与实现
被引量：1
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作者
张鲁国
王简瑜
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机构
解放军信息工程大学电子技术学院
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出处
《计算机工程与设计》
CSCD
北大核心
2010年第7期1447-1450,1454,共5页
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基金
现代通信国家重点实验室基金项目(9140C1106030806)
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文摘
针对SoC芯片多IP核集成问题,提出了系统集成时软硬件协同设计方案,建立了可重构密码算法IP核接口电路模型。该模型引入桥芯片和可编程原理,解决了不同密码算法接口位宽不一致的问题。在介绍微控制器和可重构密码算法IP核相关功能的基础上,通过基于双端口存储器和寄存器组接口电路实例,验证了IP核接口电路功能的完备性和普适性。
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关键词
接口电路
片上系统
可重构密码算法IP核
系统集成
协同设计
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Keywords
interface circuit
SoC
configurable cipher algorithm IP core
system integration
co-design
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分类号
TP309
[自动化与计算机技术—计算机系统结构]
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题名基于片上网络的容错通信方法
被引量：2
- 3
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作者
欧阳一鸣
郭凯
梁华国
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机构
合肥工业大学计算机与信息学院
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出处
《电信科学》
北大核心
2010年第7期55-60,共6页
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基金
国家自然科学基金资助项目(No.60876028
No.60633060)
+1 种基金
安徽省自然科学基金资助项目(No.090412034)
安徽高校省级自然科学研究重点项目(No.KJ2010A280)
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文摘
本文提出了一种基于片上网络的容错通信算法。若NoC中出现路由器或者链路故障,将导致NoC不能有效地进行通信。本方案为每个路由器的输出端口配置输出状态寄存器,标识出输出端口所连接的路由器或链路的故障状态,从而建立起一个新的容错模型,在路由时采用新的可重构路由算法避免这些故障的路由器和链路,从而达到保证NoC有效通信的目的。本文在5×52D-Mesh结构上仿真了所提出的方案,统计了数据传输时延,实验结果表明,与现有方案相比,这种方法能够在保证容忍NoC中路由器和链路故障的前提下,获得较低的通信时延。
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关键词
片上网络
容错模型
可重构路由算法
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Keywords
network on chip
model of fault-tolerance
reconfigurable routing algorithm
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分类号
TP311.1
[自动化与计算机技术—计算机软件与理论]
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