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宽函数的布尔匹配及其在FPGA重综合中的应用
1
作者
张峰
王作建
+2 位作者
吴洋
于芳
刘忠立
《华南理工大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2013年第5期34-42,共9页
当前大多数商用现场可编程门阵列(FPGA)可配置逻辑块结构在查找表(LUT)的基础上增加了很多辅助逻辑资源,而传统的LUT基工艺映射算法无法充分利用这些资源.为此,文中提出一种基于香农展开式和不相交支持集分解算法的布尔匹配方法,并将其...
当前大多数商用现场可编程门阵列(FPGA)可配置逻辑块结构在查找表(LUT)的基础上增加了很多辅助逻辑资源,而传统的LUT基工艺映射算法无法充分利用这些资源.为此,文中提出一种基于香农展开式和不相交支持集分解算法的布尔匹配方法,并将其应用于工艺映射后的重综合.使用该方法对工艺映射后网表中的宽函数进行布尔匹配,使其在目标FPGA结构上重新实现,从而达到充分利用所有逻辑资源和减少LUT数的目的.实验结果表明,该方法能在不增加电路关键路径延时的基础上,对学术界综合工具ABC工艺映射之后的4-LUT和6-LUT网表分别节省7.9%和7.8%的面积开销.
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关键词
电子设计自动化
现场可编程门阵列
布尔匹配
宽函数
重综合
可配置逻辑块
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职称材料
题名
宽函数的布尔匹配及其在FPGA重综合中的应用
1
作者
张峰
王作建
吴洋
于芳
刘忠立
机构
中国科学院微电子研究所
北京飘石科技有限公司
出处
《华南理工大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2013年第5期34-42,共9页
基金
武器装备预研基金资助项目(110***110***02098)
文摘
当前大多数商用现场可编程门阵列(FPGA)可配置逻辑块结构在查找表(LUT)的基础上增加了很多辅助逻辑资源,而传统的LUT基工艺映射算法无法充分利用这些资源.为此,文中提出一种基于香农展开式和不相交支持集分解算法的布尔匹配方法,并将其应用于工艺映射后的重综合.使用该方法对工艺映射后网表中的宽函数进行布尔匹配,使其在目标FPGA结构上重新实现,从而达到充分利用所有逻辑资源和减少LUT数的目的.实验结果表明,该方法能在不增加电路关键路径延时的基础上,对学术界综合工具ABC工艺映射之后的4-LUT和6-LUT网表分别节省7.9%和7.8%的面积开销.
关键词
电子设计自动化
现场可编程门阵列
布尔匹配
宽函数
重综合
可配置逻辑块
查找表
Keywords
electronic design automation
field programmable gate array
Boolean matching
wide function
resyn- thesis
configurable logic block
lookup table
分类号
TN47 [电子电信—微电子学与固体电子学]
TP319 [自动化与计算机技术—计算机软件与理论]
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职称材料
题名
作者
出处
发文年
被引量
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1
宽函数的布尔匹配及其在FPGA重综合中的应用
张峰
王作建
吴洋
于芳
刘忠立
《华南理工大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2013
0
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