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基于FPGA组的ASIC验证原型系统和逻辑分割算法的研究与实现
被引量：
4
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作者
夏飞
刘光明
《计算机工程与科学》
CSCD
2006年第9期83-87,共5页
随着ASIC设计规模的增长和问题复杂度的增加,传统的逻辑验证方法已难以满足应用的要求。基于FPGA组的验证方法能有效缩短系统的开发周期,可提供更快、更彻底的验证,更能满足逻辑验证的需要。本文对验证系统的可配置互连结构和ASIC逻辑...
随着ASIC设计规模的增长和问题复杂度的增加,传统的逻辑验证方法已难以满足应用的要求。基于FPGA组的验证方法能有效缩短系统的开发周期,可提供更快、更彻底的验证,更能满足逻辑验证的需要。本文对验证系统的可配置互连结构和ASIC逻辑分割算法进行了研究,提出了相应的实现方法。
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关键词
FPGA组
ASIC验证
可配置原型
分割算法
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职称材料
题名
基于FPGA组的ASIC验证原型系统和逻辑分割算法的研究与实现
被引量：
4
1
作者
夏飞
刘光明
机构
国防科技大学计算机学院
出处
《计算机工程与科学》
CSCD
2006年第9期83-87,共5页
文摘
随着ASIC设计规模的增长和问题复杂度的增加,传统的逻辑验证方法已难以满足应用的要求。基于FPGA组的验证方法能有效缩短系统的开发周期,可提供更快、更彻底的验证,更能满足逻辑验证的需要。本文对验证系统的可配置互连结构和ASIC逻辑分割算法进行了研究,提出了相应的实现方法。
关键词
FPGA组
ASIC验证
可配置原型
分割算法
Keywords
multiple FPGAs
ASIC verification
reconfigurable prototype
partitioning algorithm
分类号
TN407 [电子电信—微电子学与固体电子学]
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题名
作者
出处
发文年
被引量
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1
基于FPGA组的ASIC验证原型系统和逻辑分割算法的研究与实现
夏飞
刘光明
《计算机工程与科学》
CSCD
2006
4
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