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基于可逆触发器的可逆移位寄存器设计方法
1
作者
王友仁
沈先坤
周影辉
《南京航空航天大学学报》
EI
CAS
CSCD
北大核心
2014年第4期533-537,共5页
为了进一步提高可逆时序逻辑电路设计方法的通用性和改善可逆电路性能指标,以可逆主从D触发器为基本单元,通过将时钟信号及垃圾位信号级联再利用,提出了一种可逆串行移位寄存器优化设计方案。在此基础上,通过目标函数构造及变换构建带...
为了进一步提高可逆时序逻辑电路设计方法的通用性和改善可逆电路性能指标,以可逆主从D触发器为基本单元,通过将时钟信号及垃圾位信号级联再利用,提出了一种可逆串行移位寄存器优化设计方案。在此基础上,通过目标函数构造及变换构建带有移位控制的单元模块,设计了满足串行输入串/并行输出功能的n位可逆双向移位寄存器。设计结果表明,采用方法所设计的可逆移位寄存器具有较优的性能指标,且对于双向移位寄存器综合具有较好的通用性。
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关键词
可逆时序逻辑电路
可逆
触发器
垃圾位
可逆
移位寄存器
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职称材料
题名
基于可逆触发器的可逆移位寄存器设计方法
1
作者
王友仁
沈先坤
周影辉
机构
南京航空航天大学自动化学院
出处
《南京航空航天大学学报》
EI
CAS
CSCD
北大核心
2014年第4期533-537,共5页
基金
航空科学基金(2013ZD52055)资助项目
文摘
为了进一步提高可逆时序逻辑电路设计方法的通用性和改善可逆电路性能指标,以可逆主从D触发器为基本单元,通过将时钟信号及垃圾位信号级联再利用,提出了一种可逆串行移位寄存器优化设计方案。在此基础上,通过目标函数构造及变换构建带有移位控制的单元模块,设计了满足串行输入串/并行输出功能的n位可逆双向移位寄存器。设计结果表明,采用方法所设计的可逆移位寄存器具有较优的性能指标,且对于双向移位寄存器综合具有较好的通用性。
关键词
可逆时序逻辑电路
可逆
触发器
垃圾位
可逆
移位寄存器
Keywords
reversible sequential logic circuit
reversible flip flop
garbage bit
reversible shift register
分类号
TP302 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于可逆触发器的可逆移位寄存器设计方法
王友仁
沈先坤
周影辉
《南京航空航天大学学报》
EI
CAS
CSCD
北大核心
2014
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