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基于ISA总线的纳秒级同步器的研制 被引量:5
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作者 党钊 李小群 +1 位作者 陈骥 唐军 《兵工自动化》 2004年第6期72-73,共2页
基于 ISA 总线的纳秒级同步器采用可编程硬件延时设计,其电路采用 10 片 MC100E195 级联,17 位地址选择线通过并行接口 8255 控制门电路。晶振脉冲分频后经 8254 计数并产生基准信号,送可编程门阵列 MC100E195,得到 20ns 级的延迟范围... 基于 ISA 总线的纳秒级同步器采用可编程硬件延时设计,其电路采用 10 片 MC100E195 级联,17 位地址选择线通过并行接口 8255 控制门电路。晶振脉冲分频后经 8254 计数并产生基准信号,送可编程门阵列 MC100E195,得到 20ns 级的延迟范围。采用 VC++ 对同步器硬件端口操作,通过参数设置,得到多路延时同步信号。 展开更多
关键词 同步器 纳秒级 可编程硬件延时 ISA总线
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