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面向HDMI2.1协议的高速双通道并行16b/18b编码器设计
1
作者
李小鹏
熊太平
+2 位作者
崔更申
吴明军
曾必诚
《光通信技术》
北大核心
2025年第4期46-52,共7页
为了满足高清晰度多媒体接口(HDMI)2.1协议对高速数据传输的需求并解决传统16b/18b编码器因运行差异(RD)依赖导致的延迟问题,提出了一种高速双通道并行16b/18b编码器设计方案。通过引入快速RD生成模块和双通道并行冗余架构,优化了编码流...
为了满足高清晰度多媒体接口(HDMI)2.1协议对高速数据传输的需求并解决传统16b/18b编码器因运行差异(RD)依赖导致的延迟问题,提出了一种高速双通道并行16b/18b编码器设计方案。通过引入快速RD生成模块和双通道并行冗余架构,优化了编码流程,实现了真正的并行编码,并基于Xilinx Zynq UltraScale+MPSoC现场可编程门阵列(FPGA)平台进行实验验证。实验结果表明:在400 MHz时钟频率下,编码器数据传输速率达到14.4 Gb/s,且资源占用率低(Block RAM占比62.5%),功耗仅为2.636 W;该设计显著降低了编码延迟,并保持了稳定的线性时延特性。
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关键词
16b/18b
编码
多
通道
编码器
双通道并行编码器
高清晰度多媒体接口
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职称材料
题名
面向HDMI2.1协议的高速双通道并行16b/18b编码器设计
1
作者
李小鹏
熊太平
崔更申
吴明军
曾必诚
机构
桂林电子科技大学
桂林电子科技大学南宁研究院
出处
《光通信技术》
北大核心
2025年第4期46-52,共7页
基金
国家自然科学基金项目(12064004)资助
广西重点研发计划项目(桂科AB23075076)资助。
文摘
为了满足高清晰度多媒体接口(HDMI)2.1协议对高速数据传输的需求并解决传统16b/18b编码器因运行差异(RD)依赖导致的延迟问题,提出了一种高速双通道并行16b/18b编码器设计方案。通过引入快速RD生成模块和双通道并行冗余架构,优化了编码流程,实现了真正的并行编码,并基于Xilinx Zynq UltraScale+MPSoC现场可编程门阵列(FPGA)平台进行实验验证。实验结果表明:在400 MHz时钟频率下,编码器数据传输速率达到14.4 Gb/s,且资源占用率低(Block RAM占比62.5%),功耗仅为2.636 W;该设计显著降低了编码延迟,并保持了稳定的线性时延特性。
关键词
16b/18b
编码
多
通道
编码器
双通道并行编码器
高清晰度多媒体接口
Keywords
16b/18b encoding
multi-channel encoder
dual-channel parallel encoder
high-definition multimedia interface
分类号
TP391 [自动化与计算机技术—计算机应用技术]
TN91 [电子电信—通信与信息系统]
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作者
出处
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被引量
操作
1
面向HDMI2.1协议的高速双通道并行16b/18b编码器设计
李小鹏
熊太平
崔更申
吴明军
曾必诚
《光通信技术》
北大核心
2025
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