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采用Karatsuba算法在FPGA上实现双精度浮点乘法
被引量：
1
1
作者
康磊
徐英卓
《西安石油大学学报（自然科学版）》
CAS
北大核心
2014年第1期98-100,105,共4页
双精度浮点运算广泛应用于数值计算和信号处理中,在IEEE754标准中实现两个双精度浮点乘法需要一个53 bit×53 bit的尾数乘法器,这样的一个乘法器若采用FPGA实现需要大量的硬件资源。将Karatsuba算法应用于浮点运算器中,采用FPGA实...
双精度浮点运算广泛应用于数值计算和信号处理中,在IEEE754标准中实现两个双精度浮点乘法需要一个53 bit×53 bit的尾数乘法器,这样的一个乘法器若采用FPGA实现需要大量的硬件资源。将Karatsuba算法应用于浮点运算器中,采用FPGA实现了一个浮点乘法器,与传统方法相比该乘法器占用硬件资源较少。
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关键词
双精度浮点数
浮点乘法
Karatsuba算法
FPGA
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职称材料
10级流水线双精度浮点乘法器的设计
被引量：
1
2
作者
胡正伟
仲顺安
《北京理工大学学报》
EI
CAS
CSCD
北大核心
2007年第4期349-353,共5页
提出了一种基于IEEE754标准的双精度浮点乘法器的流水线设计方法.该方法面向32 bit数据通路的数字信号处理器,每个64 bit双精度浮点操作数划分为2个32 bit数据,采用32 bit×32 bit无符号阵列乘法器实现有效数的相乘,并通过控制部分...
提出了一种基于IEEE754标准的双精度浮点乘法器的流水线设计方法.该方法面向32 bit数据通路的数字信号处理器,每个64 bit双精度浮点操作数划分为2个32 bit数据,采用32 bit×32 bit无符号阵列乘法器实现有效数的相乘,并通过控制部分积与其选择信号在流水线中的同步传递,用1个66 bit加法器实现了4个部分积的相加.采用提出的舍入方法完成了有效数的舍入.整个双精度浮点乘法器的设计分为10级流水线.硬件仿真验证了该方法的正确性和有效性.
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关键词
双精度浮点数
乘法器
流水线
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职称材料
题名
采用Karatsuba算法在FPGA上实现双精度浮点乘法
被引量：
1
1
作者
康磊
徐英卓
机构
西安石油大学计算机学院
出处
《西安石油大学学报（自然科学版）》
CAS
北大核心
2014年第1期98-100,105,共4页
基金
国家自然基金资助项目(编号:51074125)
文摘
双精度浮点运算广泛应用于数值计算和信号处理中,在IEEE754标准中实现两个双精度浮点乘法需要一个53 bit×53 bit的尾数乘法器,这样的一个乘法器若采用FPGA实现需要大量的硬件资源。将Karatsuba算法应用于浮点运算器中,采用FPGA实现了一个浮点乘法器,与传统方法相比该乘法器占用硬件资源较少。
关键词
双精度浮点数
浮点乘法
Karatsuba算法
FPGA
Keywords
double-precision floating-point number
floating-point multiplication
Karatsuba algorithm
FPGA
分类号
TP302.2 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
10级流水线双精度浮点乘法器的设计
被引量：
1
2
作者
胡正伟
仲顺安
机构
北京理工大学信息科学技术学院电子工程系
出处
《北京理工大学学报》
EI
CAS
CSCD
北大核心
2007年第4期349-353,共5页
基金
国家部委预研项目(200205)
文摘
提出了一种基于IEEE754标准的双精度浮点乘法器的流水线设计方法.该方法面向32 bit数据通路的数字信号处理器,每个64 bit双精度浮点操作数划分为2个32 bit数据,采用32 bit×32 bit无符号阵列乘法器实现有效数的相乘,并通过控制部分积与其选择信号在流水线中的同步传递,用1个66 bit加法器实现了4个部分积的相加.采用提出的舍入方法完成了有效数的舍入.整个双精度浮点乘法器的设计分为10级流水线.硬件仿真验证了该方法的正确性和有效性.
关键词
双精度浮点数
乘法器
流水线
Keywords
double precision floating point data
multiplier
pipeline
分类号
TP302.2 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
作者
出处
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1
采用Karatsuba算法在FPGA上实现双精度浮点乘法
康磊
徐英卓
《西安石油大学学报（自然科学版）》
CAS
北大核心
2014
1
在线阅读
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职称材料
2
10级流水线双精度浮点乘法器的设计
胡正伟
仲顺安
《北京理工大学学报》
EI
CAS
CSCD
北大核心
2007
1
在线阅读
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职称材料
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参考文献
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