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基于TSPC的4/5双模前置分频器设计
被引量:
2
1
作者
陶小妍
张海鹏
+1 位作者
阴亚东
王德君
《半导体技术》
CAS
CSCD
北大核心
2014年第1期33-37,共5页
针对无线传感网络对射频电路高速、低功耗方面日益增长的性能要求,设计了一款用于高频锁相环中的高速、低功耗4/5双模前置分频器。在分析真单相时钟(TSPC)电路工作原理的基础上,指出了该电路结构存在的两个主要缺点,并结合器件工艺和物...
针对无线传感网络对射频电路高速、低功耗方面日益增长的性能要求,设计了一款用于高频锁相环中的高速、低功耗4/5双模前置分频器。在分析真单相时钟(TSPC)电路工作原理的基础上,指出了该电路结构存在的两个主要缺点,并结合器件工艺和物理给出了相应的版图优化解决方法。然后,采用SMIC 0.18μm标准CMOS工艺,设计了一款基于这种改进后的真单相时钟电路的集成4/5双模前置分频器。在版图优化设计后利用Cadence Spectre进行了后仿真验证,结果表明,在直流电源电压1.8 V时,该4/5双模前置分频器的最高工作频率可达到3.4 GHz,总功耗仅有0.80 mW。该4/5双模前置分频器的最低输入幅值为0.2 V时,工作频率范围为20 MHz^2.5 GHz,能够满足面向无线传感网络应用的锁相环(PLL)的高速、低功耗性能要求。
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关键词
高频
低功耗
双模前置分频器
真单相时钟(TSPC)
锁相环(PLL)
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职称材料
L波段数字微波本振源设计
2
作者
赵海洲
田波
郑武团
《陕西师范大学学报(自然科学版)》
CAS
CSCD
北大核心
2003年第z1期101-104,共4页
叙述了集成锁相本振源的原理、关键技术及设计过程 ,并应用Motorola大规模集成电路 ,采用“脉冲吞食”可变分频技术设计L波段锁相本振源 。
关键词
数字微波本振源
锁相环
双模前置分频器
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职称材料
题名
基于TSPC的4/5双模前置分频器设计
被引量:
2
1
作者
陶小妍
张海鹏
阴亚东
王德君
机构
杭州电子科技大学电子信息学院
中国科学院微电子研究所
大连理工大学电子科学与技术学院
出处
《半导体技术》
CAS
CSCD
北大核心
2014年第1期33-37,共5页
基金
国家科技重大专项资助项目(2012ZX03004006)
文摘
针对无线传感网络对射频电路高速、低功耗方面日益增长的性能要求,设计了一款用于高频锁相环中的高速、低功耗4/5双模前置分频器。在分析真单相时钟(TSPC)电路工作原理的基础上,指出了该电路结构存在的两个主要缺点,并结合器件工艺和物理给出了相应的版图优化解决方法。然后,采用SMIC 0.18μm标准CMOS工艺,设计了一款基于这种改进后的真单相时钟电路的集成4/5双模前置分频器。在版图优化设计后利用Cadence Spectre进行了后仿真验证,结果表明,在直流电源电压1.8 V时,该4/5双模前置分频器的最高工作频率可达到3.4 GHz,总功耗仅有0.80 mW。该4/5双模前置分频器的最低输入幅值为0.2 V时,工作频率范围为20 MHz^2.5 GHz,能够满足面向无线传感网络应用的锁相环(PLL)的高速、低功耗性能要求。
关键词
高频
低功耗
双模前置分频器
真单相时钟(TSPC)
锁相环(PLL)
Keywords
high frequency
low-power loss
dual-modulus prescaler
true single phase clock(TSPC)
phase locked loop (PLL)
分类号
TN43 [电子电信—微电子学与固体电子学]
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职称材料
题名
L波段数字微波本振源设计
2
作者
赵海洲
田波
郑武团
机构
空军工程大学导弹学院
出处
《陕西师范大学学报(自然科学版)》
CAS
CSCD
北大核心
2003年第z1期101-104,共4页
文摘
叙述了集成锁相本振源的原理、关键技术及设计过程 ,并应用Motorola大规模集成电路 ,采用“脉冲吞食”可变分频技术设计L波段锁相本振源 。
关键词
数字微波本振源
锁相环
双模前置分频器
Keywords
numeric microwave local oscillator
phase locked loop
dual mode pre divider
分类号
TN62 [电子电信—电路与系统]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于TSPC的4/5双模前置分频器设计
陶小妍
张海鹏
阴亚东
王德君
《半导体技术》
CAS
CSCD
北大核心
2014
2
在线阅读
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职称材料
2
L波段数字微波本振源设计
赵海洲
田波
郑武团
《陕西师范大学学报(自然科学版)》
CAS
CSCD
北大核心
2003
0
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职称材料
已选择
0
条
导出题录
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参考文献
引证文献
统计分析
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