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一种动态可重构IP系统设计研究
被引量：
2
1
作者
蔡洪波
蔡启先
+1 位作者
黄晓璐
蔡启仲
《小型微型计算机系统》
CSCD
北大核心
2007年第5期926-930,共5页
针对通用逻辑开发和可继承性设计提出一种动态可重构IP系统的设计方案,它主要依靠下载bits流文件改变FPGA的配置存储器来实现重构,其配置时间只与预设的IP模块大小有关,与IP的结构无关而且可以利用相关的辅助设计工具.本文介绍了该系统...
针对通用逻辑开发和可继承性设计提出一种动态可重构IP系统的设计方案,它主要依靠下载bits流文件改变FPGA的配置存储器来实现重构,其配置时间只与预设的IP模块大小有关,与IP的结构无关而且可以利用相关的辅助设计工具.本文介绍了该系统设计实现的流程及关键技术,并以具体实验给以验证.
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关键词
动态可
重构
动态可
重构
IP
动态可重构阵列
IP模块
FPGA
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职称材料
题名
一种动态可重构IP系统设计研究
被引量：
2
1
作者
蔡洪波
蔡启先
黄晓璐
蔡启仲
机构
中国科学院国家天文台
广西工学院计算机工程系
北京科技大学信息工程学院
广西工学院电子信息与控制工程系
出处
《小型微型计算机系统》
CSCD
北大核心
2007年第5期926-930,共5页
基金
国家"八六三"计划基金项目(863-2.5.1.2)资助
文摘
针对通用逻辑开发和可继承性设计提出一种动态可重构IP系统的设计方案,它主要依靠下载bits流文件改变FPGA的配置存储器来实现重构,其配置时间只与预设的IP模块大小有关,与IP的结构无关而且可以利用相关的辅助设计工具.本文介绍了该系统设计实现的流程及关键技术,并以具体实验给以验证.
关键词
动态可
重构
动态可
重构
IP
动态可重构阵列
IP模块
FPGA
Keywords
dynamic reconfigurable
dynamic reconfigurable IP
dynamic reconfigurable array
intelligence property module
FPGA
分类号
TP303 [自动化与计算机技术—计算机系统结构]
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作者
出处
发文年
被引量
操作
1
一种动态可重构IP系统设计研究
蔡洪波
蔡启先
黄晓璐
蔡启仲
《小型微型计算机系统》
CSCD
北大核心
2007
2
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