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大约束度Viterbi译码器中路径存储单元的设计
1
作者
王春光
陈新
《现代电子技术》
2007年第13期51-54,共4页
维特比(Viterbi)译码器由于其优良的纠错性能,在通信领域有着十分广泛的应用。用FPGA实现Viterbi译码算法时,其硬件资源的消耗与译码速度始终是相互制约的两个方面,通过合理安排加比选单元和路径度量存储单元可有效缓解这一矛盾。基于基...
维特比(Viterbi)译码器由于其优良的纠错性能,在通信领域有着十分广泛的应用。用FPGA实现Viterbi译码算法时,其硬件资源的消耗与译码速度始终是相互制约的两个方面,通过合理安排加比选单元和路径度量存储单元可有效缓解这一矛盾。基于基4算法所提出的同址路径度量存储管理方法能在提高译码速度同时有效降低译码器的硬件资源需求。
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关键词
VITERBI译码器
加比选单元
路径度量存储
FPGA
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职称材料
利用有限资源实现高速Viterbi解码
2
作者
王丽
王金刚
《电子测量技术》
2003年第2期39-40,共2页
文中提供一种分组方法简单,兼顾连线复杂性与存储空间有限性的Viterbi解码方法,并提出三种处理方法,可以依据实际情况选定所需的处理结构。
关键词
VITERBI解码
加比选单元
路径量度
支路量度
卷积码
分组
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职称材料
题名
大约束度Viterbi译码器中路径存储单元的设计
1
作者
王春光
陈新
机构
福州大学物理与信息工程学院
出处
《现代电子技术》
2007年第13期51-54,共4页
基金
福建省科技厅资助项目:集成电路(IC)技术平台建设(2003Q013)
福建省科技重点资助项目:新型射频MEMS开关及其功能电路的集成技术研究(2005H029)
文摘
维特比(Viterbi)译码器由于其优良的纠错性能,在通信领域有着十分广泛的应用。用FPGA实现Viterbi译码算法时,其硬件资源的消耗与译码速度始终是相互制约的两个方面,通过合理安排加比选单元和路径度量存储单元可有效缓解这一矛盾。基于基4算法所提出的同址路径度量存储管理方法能在提高译码速度同时有效降低译码器的硬件资源需求。
关键词
VITERBI译码器
加比选单元
路径度量存储
FPGA
Keywords
Viterbi decoder
ACS unit
path metric memory
FPGA
分类号
TN911.21 [电子电信—通信与信息系统]
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职称材料
题名
利用有限资源实现高速Viterbi解码
2
作者
王丽
王金刚
机构
天津大学
出处
《电子测量技术》
2003年第2期39-40,共2页
文摘
文中提供一种分组方法简单,兼顾连线复杂性与存储空间有限性的Viterbi解码方法,并提出三种处理方法,可以依据实际情况选定所需的处理结构。
关键词
VITERBI解码
加比选单元
路径量度
支路量度
卷积码
分组
Keywords
Viterbi decode ACS(Add - Compare- Select) Path metric Branch metric
分类号
TN911.22 [电子电信—通信与信息系统]
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职称材料
题名
作者
出处
发文年
被引量
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1
大约束度Viterbi译码器中路径存储单元的设计
王春光
陈新
《现代电子技术》
2007
0
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职称材料
2
利用有限资源实现高速Viterbi解码
王丽
王金刚
《电子测量技术》
2003
0
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职称材料
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