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题名一种基于预判机制的极化码译码算法及VLSI架构
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作者
杜高明
胡国庆
林青
张多利
宋宇鲲
欧阳一鸣
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机构
合肥工业大学电子科学与应用物理学院
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出处
《微电子学与计算机》
北大核心
2019年第12期11-15,20,共6页
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基金
国家自然科学基金(61474036)
教育部IC设计网上合作研究中心(JSGG20170413153845042)
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文摘
本文提出一种基于对数似然比的预判机制,根据每层对数似然比符号直接判决分裂成"1"或者"0"和固定比特层直接分裂成已知比特,旨在减少路径分裂以及通过直接继承上一层路径度量值的方式,移除冗余的路径度量值计算.基于该机制,我们设计码长N=1 024,码率R=0.5,列表宽度L=2的VLSI硬件架构.实验结果表明,其工作频率在384 MHz下,能达到约160 Mbps的吞吐率,延迟降低约51%.
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关键词
极化码
串行抵消列表
预判机制
减少路径分裂
冗余计算
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Keywords
polar codes
SCL
pre-judgment mechanism
RRS-SCL
redundant calculation
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分类号
TN47
[电子电信—微电子学与固体电子学]
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