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基于双FPGA系统的高速全局动态重构设计与实现
被引量：
7
1
作者
夏飞
李晖宙
《现代电子技术》
北大核心
2017年第16期151-154,共4页
基于双FPGA芯片的可重构原型系统,提出一种系统高速全局动态重构设计方法。利用Xilinx Virtex-7系列FPGA的常规配置通道,使用一片规模较小的FPGA芯片作为重构控制器对大规模算法FPGA芯片实现全局动态重构。实验结果表明,系统重构时间小...
基于双FPGA芯片的可重构原型系统,提出一种系统高速全局动态重构设计方法。利用Xilinx Virtex-7系列FPGA的常规配置通道,使用一片规模较小的FPGA芯片作为重构控制器对大规模算法FPGA芯片实现全局动态重构。实验结果表明,系统重构时间小于60 ms,与常规FPGA逻辑下载方法相比,配置效率提高了2~3个数量级。
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关键词
可编程门阵列
可
重构
计算
全局动态重构
并行配置通道
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职称材料
题名
基于双FPGA系统的高速全局动态重构设计与实现
被引量：
7
1
作者
夏飞
李晖宙
机构
海军工程大学电子工程学院
出处
《现代电子技术》
北大核心
2017年第16期151-154,共4页
基金
国家自然科学基金资助项目(61572515)
中国博士后科学基金资助项目(2016M593023)
文摘
基于双FPGA芯片的可重构原型系统,提出一种系统高速全局动态重构设计方法。利用Xilinx Virtex-7系列FPGA的常规配置通道,使用一片规模较小的FPGA芯片作为重构控制器对大规模算法FPGA芯片实现全局动态重构。实验结果表明,系统重构时间小于60 ms,与常规FPGA逻辑下载方法相比,配置效率提高了2~3个数量级。
关键词
可编程门阵列
可
重构
计算
全局动态重构
并行配置通道
Keywords
FPGA
reconfigurable computing
global dynamic reconfiguration
parallel configuration channel
分类号
TN919-34 [电子电信—通信与信息系统]
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作者
出处
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被引量
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1
基于双FPGA系统的高速全局动态重构设计与实现
夏飞
李晖宙
《现代电子技术》
北大核心
2017
7
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