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抗差分功耗分析和差分故障分析的AES算法VLSI设计与实现
被引量：
3
1
作者
韩军
曾晓洋
赵佳
《通信学报》
EI
CSCD
北大核心
2010年第1期20-29,共10页
提出了一种抗差分功耗分析和差分故障分析的AES算法硬件设计与实现方案,该设计主要采用了数据屏蔽和二维奇偶校验方法相结合的防御措施。在保证硬件安全性的前提下,采用将128bit运算分成4次32bit运算、模块复用、优化运算次序等方法降...
提出了一种抗差分功耗分析和差分故障分析的AES算法硬件设计与实现方案,该设计主要采用了数据屏蔽和二维奇偶校验方法相结合的防御措施。在保证硬件安全性的前提下,采用将128bit运算分成4次32bit运算、模块复用、优化运算次序等方法降低了硬件实现成本,同时使用3级流水线结构提高了硬件实现的速度和吞吐率。基于以上技术设计的AESIP核不仅具有抗双重旁道攻击的能力,而且拥有合理的硬件成本和运算性能。
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关键词
信息安全
抗攻击算法
VLSI实现
旁道攻击
先进加密标准
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职称材料
基于CMOS工艺的AES高速接口电路设计
被引量：
1
2
作者
施佺
孙玲
陈海进
《电子器件》
CAS
2004年第3期413-415,396,共4页
为提高 AES加密电路的数据吞吐量 ,采用 0 .6μm CMOS工艺设计了输入接口单元电路。该接口电路接收串行的高速数据流 ,经过串并转换后 ,输出 1 2 8路低速并行数据流。CMOS互补逻辑结构降低了电路的功耗。手工版图布局优化了芯片面积 。
关键词
先进加密标准
串并转换
版图
CMOS互补逻辑
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职称材料
题名
抗差分功耗分析和差分故障分析的AES算法VLSI设计与实现
被引量：
3
1
作者
韩军
曾晓洋
赵佳
机构
复旦大学专用集成电路与系统国家重点实验室
出处
《通信学报》
EI
CSCD
北大核心
2010年第1期20-29,共10页
基金
国家自然科学基金资助项目(60776028)~~
文摘
提出了一种抗差分功耗分析和差分故障分析的AES算法硬件设计与实现方案,该设计主要采用了数据屏蔽和二维奇偶校验方法相结合的防御措施。在保证硬件安全性的前提下,采用将128bit运算分成4次32bit运算、模块复用、优化运算次序等方法降低了硬件实现成本,同时使用3级流水线结构提高了硬件实现的速度和吞吐率。基于以上技术设计的AESIP核不仅具有抗双重旁道攻击的能力,而且拥有合理的硬件成本和运算性能。
关键词
信息安全
抗攻击算法
VLSI实现
旁道攻击
先进加密标准
Keywords
information security
anti-attack algorithm
VLSI implementation
side channel attack
AES
分类号
TN492 [电子电信—微电子学与固体电子学]
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职称材料
题名
基于CMOS工艺的AES高速接口电路设计
被引量：
1
2
作者
施佺
孙玲
陈海进
机构
南通大学江苏省专用集成电路设计重点实验室
出处
《电子器件》
CAS
2004年第3期413-415,396,共4页
基金
南通工学院自然科学基金资助项目 (院自 2 0 0 3 40 )
文摘
为提高 AES加密电路的数据吞吐量 ,采用 0 .6μm CMOS工艺设计了输入接口单元电路。该接口电路接收串行的高速数据流 ,经过串并转换后 ,输出 1 2 8路低速并行数据流。CMOS互补逻辑结构降低了电路的功耗。手工版图布局优化了芯片面积 。
关键词
先进加密标准
串并转换
版图
CMOS互补逻辑
Keywords
advanced encryption standard
serial-to-parallel
layout
CMOS complementary logic
分类号
TM855 [电气工程—高电压与绝缘技术]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
抗差分功耗分析和差分故障分析的AES算法VLSI设计与实现
韩军
曾晓洋
赵佳
《通信学报》
EI
CSCD
北大核心
2010
3
在线阅读
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职称材料
2
基于CMOS工艺的AES高速接口电路设计
施佺
孙玲
陈海进
《电子器件》
CAS
2004
1
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职称材料
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