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基于改进型选择进位加法器的32位浮点乘法器设计
被引量：
4
1
作者
刘容
赵洪深
李晓今
《现代电子技术》
2013年第16期133-136,共4页
在修正型Booth算法和Wallace树结构以及选择进位加法器的基础上,提出了一种新型32位单精度浮点乘法器结构。该新型结构通过截断选择进位加法器进位链,缩短了关键路径延时。传统选择进位加法器每一级加法器的进位选择来自上级的进位输出...
在修正型Booth算法和Wallace树结构以及选择进位加法器的基础上,提出了一种新型32位单精度浮点乘法器结构。该新型结构通过截断选择进位加法器进位链,缩短了关键路径延时。传统选择进位加法器每一级加法器的进位选择来自上级的进位输出。提出的结构可以提前计算出尾数第16位的结果,它与Wallace树输出的相关位比较就可得出来自前一位的进位情况进而快速得到进位选择。在Altera的EP2C70F896C6器件上,基于该结构实现了一个支持IEEE754浮点标准的4级流水线浮点乘法器,时序仿真表明,该方法将传统浮点乘法器结构关键路径延时由6.4 ns减小到5.9 ns。
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关键词
修正booth算法
Wallace树结构
选择进位加法器
浮点乘法器
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题名
基于改进型选择进位加法器的32位浮点乘法器设计
被引量：
4
1
作者
刘容
赵洪深
李晓今
机构
中国科学院光电技术研究所
中国科学院
出处
《现代电子技术》
2013年第16期133-136,共4页
文摘
在修正型Booth算法和Wallace树结构以及选择进位加法器的基础上,提出了一种新型32位单精度浮点乘法器结构。该新型结构通过截断选择进位加法器进位链,缩短了关键路径延时。传统选择进位加法器每一级加法器的进位选择来自上级的进位输出。提出的结构可以提前计算出尾数第16位的结果,它与Wallace树输出的相关位比较就可得出来自前一位的进位情况进而快速得到进位选择。在Altera的EP2C70F896C6器件上,基于该结构实现了一个支持IEEE754浮点标准的4级流水线浮点乘法器,时序仿真表明,该方法将传统浮点乘法器结构关键路径延时由6.4 ns减小到5.9 ns。
关键词
修正booth算法
Wallace树结构
选择进位加法器
浮点乘法器
Keywords
modified
booth
encoding
Wallace tree structure
carry-select adder
float-point multiplier
分类号
TN702-34 [电子电信—电路与系统]
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作者
出处
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被引量
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1
基于改进型选择进位加法器的32位浮点乘法器设计
刘容
赵洪深
李晓今
《现代电子技术》
2013
4
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