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具备时间统一支持的网络智能传感器设计 被引量:12
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作者 王刚 黄飞 乔纯捷 《电子测量与仪器学报》 CSCD 2008年第6期112-116,共5页
为构建分布式网络测控系统,提出了基于高性能浮点数字信号处理器TMS320C6713的网络智能传感器模块设计,并具备时间统一支持的能力。采用FPGA对物理介质无关接口操作的方案,实现了处理器通过同步串口接入网络,结合DSP强大的数据处理能力... 为构建分布式网络测控系统,提出了基于高性能浮点数字信号处理器TMS320C6713的网络智能传感器模块设计,并具备时间统一支持的能力。采用FPGA对物理介质无关接口操作的方案,实现了处理器通过同步串口接入网络,结合DSP强大的数据处理能力对数据进行预处理和灵活的网络协议封装;采用"DSP+主机"的方案实现了传感器模块DSP程序的网络调试和更新;提出了基于开环的时间传递方法,实现了分布式网络时间统一支持体系的建立。 展开更多
关键词 智能传感器 介质无关接口 网络调试 统一时间
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10GBASE-X物理层并行光传输研究 被引量:1
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作者 苗澎 王志功 《高技术通讯》 CAS CSCD 北大核心 2007年第7期661-666,共6页
研究了符合IEEE802.3ae标准的万兆以太网10GBASE-X物理层技术,建立了万兆以太网10GBASE-X物理层点到点并行光传输系统.该系统由10GE连接单元接口(XAUI)与10Gb介质无关接口(XGMII)转换芯片、4×3.125Gbit/s 850nm自制垂直腔面发... 研究了符合IEEE802.3ae标准的万兆以太网10GBASE-X物理层技术,建立了万兆以太网10GBASE-X物理层点到点并行光传输系统.该系统由10GE连接单元接口(XAUI)与10Gb介质无关接口(XGMII)转换芯片、4×3.125Gbit/s 850nm自制垂直腔面发射激光器(VCSEL)并行光发射模块与并行光接收模块构成.利用现场可编程门阵列(FPGA)实现了10GBASE-X物理层编解码子层(PCS)、物理介质连接子层(PMA)的全部功能,光互联采用2m并行12芯400MHz·km 62.5μm多模带状光纤.经逻辑分析仪(Agilent 1682A)在接收端低速IO引脚测试,在接收端恢复出发端的万兆以太网帧结构数据,逻辑功能正确. 展开更多
关键词 万兆以太网10GBASE-X物理层 10GE连接单元接口 10Gb介质无关接口 并行光传输
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IEEE-1588协议时钟同步报文的精确时间标记方法研究 被引量:49
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作者 魏丰 孙文杰 《仪器仪表学报》 EI CAS CSCD 北大核心 2009年第1期162-169,共8页
采用专用硬件在物理层标记(time stamping)时钟同步报文发出和到达的时刻是实现高精度网络时钟同步的基础。本文分析了IEEE-1588协议中Sync和Delay_Req报文的数据帧结构,提出了一种在以太网物理层(PHY)和MAC层之间的介质无关接口(MII)... 采用专用硬件在物理层标记(time stamping)时钟同步报文发出和到达的时刻是实现高精度网络时钟同步的基础。本文分析了IEEE-1588协议中Sync和Delay_Req报文的数据帧结构,提出了一种在以太网物理层(PHY)和MAC层之间的介质无关接口(MII)处检测同步报文的策略和实现精确时间标记的方案。并根据此方案采用Altera公司的CycloneⅠ系列FPGA芯片EP1C12Q240研制了相关的测试平台。在此平台上对10Mbps以太网环境中的时间标记精度进行了初步实测,标记精度优于500nS。 展开更多
关键词 IEEE 1588协议 网络时钟同步 时间标记 介质无关(MII)接口
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基于E1链路的HDLC成帧解帧处理电路 被引量:6
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作者 党成 黄海生 +1 位作者 李鑫 张治国 《光通信技术》 2021年第2期28-31,共4页
为了在E1链路上能够可靠稳定地传输以太网数据包,提出了一种基于E1链路的高级数据链路控制(HDLC)成帧解帧处理电路。该电路采用HDLC协议在系统发送部分对介质无关接口(MII)发送的以太网数据包进行封装,并通过广域网(WAN)接口发送出去;... 为了在E1链路上能够可靠稳定地传输以太网数据包,提出了一种基于E1链路的高级数据链路控制(HDLC)成帧解帧处理电路。该电路采用HDLC协议在系统发送部分对介质无关接口(MII)发送的以太网数据包进行封装,并通过广域网(WAN)接口发送出去;在系统接收部分再对WAN接口接收的数据进行解封装。仿真结果表明:在发送端以太网数据包通过MII进行发送的情况下,该电路在接收端可以成功恢复出初始的以太网数据帧。 展开更多
关键词 E1链路 以太网数据包 高级数据链路控制 介质无关接口 广域网接口
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