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基于DSP+FPGA的嵌入式图像处理系统设计
被引量：
10
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作者
李佩斌
黄莹
赵誉婷
《现代电子技术》
2014年第20期95-98,共4页
为满足数据量大、算法复杂度高的应用需求,使用高性能DSP完成复杂图像算法处理,FPGA作为协处理器,完成图像采集、存储和显示等功能,构建了一种高性能的嵌入式图像处理系统。DSP和FPGA通过EMIF接口实现了高速无缝互联。采用三重缓冲读写...
为满足数据量大、算法复杂度高的应用需求,使用高性能DSP完成复杂图像算法处理,FPGA作为协处理器,完成图像采集、存储和显示等功能,构建了一种高性能的嵌入式图像处理系统。DSP和FPGA通过EMIF接口实现了高速无缝互联。采用三重缓冲读写机制解决了采集和显示的异步时钟域问题及算法处理时间不确定的问题。介绍了基于BIOS和NDK开发的C6455软件流程,展示了该系统图像处理算法运行周期的统计结果。该系统运行稳定可靠,具有较高的实用价值。
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关键词
嵌入式图像处理系统
三重缓冲
异步时钟域
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职称材料
题名
基于DSP+FPGA的嵌入式图像处理系统设计
被引量：
10
1
作者
李佩斌
黄莹
赵誉婷
机构
公安部第一研究所
出处
《现代电子技术》
2014年第20期95-98,共4页
基金
国家科技支撑计划资助(2011BAK09B05)
文摘
为满足数据量大、算法复杂度高的应用需求,使用高性能DSP完成复杂图像算法处理,FPGA作为协处理器,完成图像采集、存储和显示等功能,构建了一种高性能的嵌入式图像处理系统。DSP和FPGA通过EMIF接口实现了高速无缝互联。采用三重缓冲读写机制解决了采集和显示的异步时钟域问题及算法处理时间不确定的问题。介绍了基于BIOS和NDK开发的C6455软件流程,展示了该系统图像处理算法运行周期的统计结果。该系统运行稳定可靠,具有较高的实用价值。
关键词
嵌入式图像处理系统
三重缓冲
异步时钟域
Keywords
DSP
FPGA
embedded image processing system
digital signal processor
field programmable gate array
triple buffering
asynchronous clock domain
分类号
TN710.9 [电子电信—电路与系统]
TP391.4 [自动化与计算机技术—计算机应用技术]
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题名
作者
出处
发文年
被引量
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1
基于DSP+FPGA的嵌入式图像处理系统设计
李佩斌
黄莹
赵誉婷
《现代电子技术》
2014
10
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