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结构半随机LDPC码的递增冗余HARQ方案
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作者 文红 符初生 靳蕃 《电讯技术》 2006年第4期18-21,共4页
提出了结构半随机LDPC码,分析了其在不同码率时,编、译码具有兼容性的特性。介绍了基于结构半随机LDPC码的递增冗余HARQ方案,给出了这种方案的吞吐量性能封闭解。在AWGN信道和Rayleigh衰落信道下,通过仿真将新方案的性能和随机LDPC码的... 提出了结构半随机LDPC码,分析了其在不同码率时,编、译码具有兼容性的特性。介绍了基于结构半随机LDPC码的递增冗余HARQ方案,给出了这种方案的吞吐量性能封闭解。在AWGN信道和Rayleigh衰落信道下,通过仿真将新方案的性能和随机LDPC码的性能进行了比较,结果显示,结构半随机LDPC码的递增冗余HARQ方案性能接近随机LDPC码,但编、译码更简单,参数选择范围更广。 展开更多
关键词 高速数据传输 差错控制 结构半随机ldpc HARQ 递增冗余
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无短环不规则QC_LDPC码的快速编码及联合译码 被引量:2
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作者 刘蕾 孙书龙 +1 位作者 常亮 李华旺 《现代电子技术》 北大核心 2015年第17期34-37,共4页
基于不规则部分并行结构设计了一种高吞吐量,低复杂度,码长码率可变且去除四环的低密度奇偶校验LDPC码及其译码结构实现方案,该编码结构可针对不同码长的不规则部分并行结构LDPC码进行扩展,译码器采用缩放最小和定点(Sum-Min)算法实现译... 基于不规则部分并行结构设计了一种高吞吐量,低复杂度,码长码率可变且去除四环的低密度奇偶校验LDPC码及其译码结构实现方案,该编码结构可针对不同码长的不规则部分并行结构LDPC码进行扩展,译码器采用缩放最小和定点(Sum-Min)算法实现译码,中间信息节点存储器地址采用格雷码编码,降低动态功耗;采用Xilinx公司的Virtex-5XC5Vt X150T-ff1156FPGA芯片设计了一款码长1 270,码率1 2的不规则部分并行LDPC码的编码器和译码器。综合结果表明:该编码器信息吞吐量为2.52 Gb/s,译码器在10次迭代的情况下信息吞吐率达到44 Mb/s。 展开更多
关键词 低密度奇偶校验码 不规则码 部分并行结构 FPGA
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