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Novel Optical Analog-To-Digital Converter Based on Optical Time Division Multiplexing
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作者 王晓东 孙雨南 +1 位作者 伍剑 崔芳 《Journal of Beijing Institute of Technology》 EI CAS 2003年第S1期58-61,共4页
A novel optical analog-to-digital converter based on optical time division multiplexing(OTDM) is described which uses electrooptic sampling and time-demultiplexing together with multiple electronic analog-to-digital c... A novel optical analog-to-digital converter based on optical time division multiplexing(OTDM) is described which uses electrooptic sampling and time-demultiplexing together with multiple electronic analog-to-digital converter(ADC). Compared with the previous scheme, the time-division multiplexer and the time-division demultiplexer are applied in the optical analog-to-digital converter(OADC) at the same time, the design of the OADC is simplified and the performance of the OADC based on time-division demultiplexer is improved. A core optical part of the system is demonstrated with a sample rate of 10 Gs/s. The signals in three channels are demultiplexed from the optical pulses.The result proves our scheme is feasible. 展开更多
关键词 OADC(optical analog-to-digital converter) electrooptic sampling OTDM(optical time division multiplexing)
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一种16位110 dB无杂散动态范围的低功耗SAR ADC
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作者 邢向龙 王倩 +3 位作者 康成 彭姜灵 李清 俞军 《电子科技大学学报》 EI CAS CSCD 北大核心 2024年第2期185-193,共9页
该文设计了一款16位、转换速率为625 kS/s的逐次逼近寄存器型模数转换器(SAR ADC)。改进的采样保持电路结构,优化了采样线性度和噪声性能。采用分段结构设计电容型数模转换器并使用混合方式的电容切换方案,减小面积和能耗。利用扰动注... 该文设计了一款16位、转换速率为625 kS/s的逐次逼近寄存器型模数转换器(SAR ADC)。改进的采样保持电路结构,优化了采样线性度和噪声性能。采用分段结构设计电容型数模转换器并使用混合方式的电容切换方案,减小面积和能耗。利用扰动注入技术提升ADC的线性度。比较器采用两级积分型预放大器减小噪声,利用输出失调存储技术及优化的电路设计减小了比较器失调电压和失调校准引入的噪声,优化并提升了比较器速度。芯片采用CMOS 0.18μm工艺设计和流片,ADC核心面积为1.15 mm^(2)。测试结果表明,在1 kHz正弦信号输入下,ADC差分输入峰峰值幅度达8.8 V,信纳比为85.9 dB,无杂散动态范围为110 dB,微分非线性为-0.27/+0.32 LSB,积分非线性为-0.58/+0.53 LSB,功耗为4.31 mW。 展开更多
关键词 模数转换器 数模转换器 低噪声比较器 失调校准 采样保持 逐次逼近寄存器
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一种11bit流水线高速模数转换器
3
作者 黄政 蔡孟冶 姜岩峰 《半导体技术》 CAS 北大核心 2024年第6期561-568,共8页
为解决流水线模数转换器(ADC)在连续工作时功耗高、电容器匹配度有限以及运算放大器大摆幅输出信号下线性度下降的问题,基于0.5μm BCD工艺,设计了一款11 bit流水线高速ADC。提出了无采样保持放大器、幅度减半和多位量化相结合的设计方... 为解决流水线模数转换器(ADC)在连续工作时功耗高、电容器匹配度有限以及运算放大器大摆幅输出信号下线性度下降的问题,基于0.5μm BCD工艺,设计了一款11 bit流水线高速ADC。提出了无采样保持放大器、幅度减半和多位量化相结合的设计方法,使ADC在大摆幅信号下有足够的线性度来处理信号,同时使电容数模转换器(DAC)的匹配精度满足ADC分辨率的要求,极大地降低了对电容阵列几何参数的匹配精度要求,具有较低的功耗。采用Cadence Virtuoso设计版图,测试结果表明,芯片的微分非线性(DNL)在-0.5~+0.5 LSB范围内,有效位数(ENOB)为10.61 bit,功耗为97 mW,获得了较好的性能。 展开更多
关键词 流水线模数转换器(ADC) 幅度减半 无采样保持 线性度 多位量化 电容失配 有效位数(ENOB)
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应用于5.8 GHz雷达中的12 bit SAR ADC
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作者 郑喜鹏 陈磊 +1 位作者 伍振环 邢蕾 《电子设计工程》 2024年第13期93-98,共6页
为满足5.8 GHz雷达系统的需要,在HLMC55LP工艺中设计了一款12 bit SAR ADC,ADC的采样率为500 kHz/250 kHz两档可调,采用单调电容开关时序,且在电容阵列的高位部分加上2个冗余位设计,该冗余位对高位的CDAC建立误差,比较器误差都有一定的... 为满足5.8 GHz雷达系统的需要,在HLMC55LP工艺中设计了一款12 bit SAR ADC,ADC的采样率为500 kHz/250 kHz两档可调,采用单调电容开关时序,且在电容阵列的高位部分加上2个冗余位设计,该冗余位对高位的CDAC建立误差,比较器误差都有一定的容忍能力,可以带来ADC性能上的提升。系统采用上极板采样,可以在采样周期结束的瞬间就开始逐位比较过程,省去了采用底极板采样第一拍CDAC建立的过程,提高了转换速度,相对于底极板采样也节省了一定的开关功耗。后仿结果表明,模拟输入20 kHz差分中频信号,在500 kHz采样频率,3.3 V电源电压下,ADC的有效位数为11.56 bit,SNR为71.04 dB,SFDR为80.37 dBc,功耗约为2 mW。 展开更多
关键词 逐次逼近型模数转换器 上极板采样 冗余结构 单调电容开关时序
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利用过采样技术提高ADC测量分辨率 被引量:14
5
作者 刘青兰 方志刚 邵志学 《现代电子技术》 2007年第12期74-76,79,共4页
针对目前单片机内嵌ADC分辨率较低,而外接高分辨率ADC成本又较高的情况,提出了用“过采样”技术使在有用的测量频带内的信噪比得到改善,从而提高ADC测量的分辨率。并利用Matlab对其结论进行仿真,且在TMS320LF2407 DSP上予以实现,结果表... 针对目前单片机内嵌ADC分辨率较低,而外接高分辨率ADC成本又较高的情况,提出了用“过采样”技术使在有用的测量频带内的信噪比得到改善,从而提高ADC测量的分辨率。并利用Matlab对其结论进行仿真,且在TMS320LF2407 DSP上予以实现,结果表明信噪比和测量分辨率明显提高。 展开更多
关键词 过采样 模/数转换器 数据采集 数字信号处理
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基于现场可编程门阵列并行频率源的改进方法 被引量:3
6
作者 徐跃 简金蕾 +2 位作者 任宏滨 连可 吉阳 《探测与控制学报》 CSCD 北大核心 2016年第2期82-87,共6页
针对传统直接数字频率合成(DDS)电路中相位累加器与波形查找表的工作频率与高速数模转换器(DAC)采样频率不匹配的问题,提出了基于现场可编程门阵列(FPGA)并行频率源的改进方法。该方法采用改进的8路并行DDS电路有效地扩展了DDS电路的输... 针对传统直接数字频率合成(DDS)电路中相位累加器与波形查找表的工作频率与高速数模转换器(DAC)采样频率不匹配的问题,提出了基于现场可编程门阵列(FPGA)并行频率源的改进方法。该方法采用改进的8路并行DDS电路有效地扩展了DDS电路的输出带宽;基于并行DDS结构,利用FPGA和高速DAC生成了不同调制模式下的通信信号,并在Vivado2014.2环境下进行测试。实验表明:该设计具有结构简单、易于实现、分辨率高等特点,可用于雷达、电子对抗领域中宽频带高分辨率信号的产生。 展开更多
关键词 并行直接数字频率合成 波形查找表 现场可编程门阵列 调制 高速数模转换器
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用于CMOS图像传感器的列并行高精度ADC 被引量:4
7
作者 张娜 姚素英 徐江涛 《固体电子学研究与进展》 CAS CSCD 北大核心 2006年第3期349-353,共5页
设计了一种适用于CMOS图像传感器的列并行Single-slopeADC。采用的列并行ADC,同时对多数据源并行处理,增强了数据吞吐量,特别适用于CMOS图像传感器大像素阵列的数据处理。分析了影响ADC精度的因素,并给出了减小失调的方法。该ADC在0.35... 设计了一种适用于CMOS图像传感器的列并行Single-slopeADC。采用的列并行ADC,同时对多数据源并行处理,增强了数据吞吐量,特别适用于CMOS图像传感器大像素阵列的数据处理。分析了影响ADC精度的因素,并给出了减小失调的方法。该ADC在0.35μm工艺下成功流片验证,测试结果表明,该ADC,在50MS/s的高数据吞吐量下,实现了CMOS图像传感器的8bit精度的设计要求和17.35mW的低功耗,以及0.62mm2的芯片面积。ADC的DNL=0.8LSB,INL=1.096LSB。 展开更多
关键词 图像传感器 列并行 单斜 模数转换器
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用于14位210 MS/s电荷域ADC的采样保持前端电路 被引量:2
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作者 陈珍海 魏敬和 +4 位作者 钱宏文 于宗光 苏小波 薛颜 张鸿 《电子与信息学报》 EI CSCD 北大核心 2019年第3期732-738,共7页
该文提出一种用于电荷域流水线模数转换器(ADC)的高精度输入共模电平不敏感采样保持前端电路。该采样保持电路可对电荷域流水线ADC中由输入共模电平误差引起的共模电荷误差进行补偿。所提出的高精度输入共模电平不敏感采样保持电路被运... 该文提出一种用于电荷域流水线模数转换器(ADC)的高精度输入共模电平不敏感采样保持前端电路。该采样保持电路可对电荷域流水线ADC中由输入共模电平误差引起的共模电荷误差进行补偿。所提出的高精度输入共模电平不敏感采样保持电路被运用于一款14位210 MS/s电荷域ADC中,并在1P6M 0.18μm CMOS工艺下实现。测试结果显示,该14位ADC电路在210 MS/s条件下对于30.1 MHz单音正弦输入信号得到的无杂散动态范围为85.4 dBc,信噪比为71.5 dBFS,而ADC内核功耗仅为205 mW,面积为3.2 mm^2。 展开更多
关键词 流水线模数转换器 电荷域 采样保持 低功耗 共模电荷
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一种新的并行交替采样系统误差估计方法 被引量:2
9
作者 马仑 廖桂生 +1 位作者 杨鹏 明洋 《电子学报》 EI CAS CSCD 北大核心 2014年第5期912-917,共6页
并行交替采样系统的性能依赖于各通道的精确配合,相对于传统单通道采样系统,其面临更多的系统误差源.未补偿的失配误差将导致采样波形非线性失真、输出信噪比降低以及无伪峰动态范围损失等.本文提出了一种新的并行交替采样系统误差校正... 并行交替采样系统的性能依赖于各通道的精确配合,相对于传统单通道采样系统,其面临更多的系统误差源.未补偿的失配误差将导致采样波形非线性失真、输出信噪比降低以及无伪峰动态范围损失等.本文提出了一种新的并行交替采样系统误差校正方法,在频域利用相邻频率点输出矢量对应信号子空间的旋转关系和正交投影矩阵的唯一性,实现增益误差以及时基误差的精确估计.该方法无需迭代,估计精度较高,对噪声以及偏置误差稳健,并且可以同时完成信号重构.仿真数据的处理结果验证了本文方法的有效性. 展开更多
关键词 并行交替采样 模数转换器 时基误差 增益误差 旋转不变性
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适用于中频采样的CMOS自举采样开关 被引量:2
10
作者 钱宏文 朱燕君 +1 位作者 季惠才 陈珍海 《中国电子科学研究院学报》 2013年第2期209-212,共4页
分析了影响CMOS采样开关性能的非理想因素,针对中频采样A/D转换器对采样开关特性的要求,改进得到了一种新型的CMOS自举采样开关。较之传统栅压自举开关,此新型MOS采样开关能够消除由于阈值电压随输入信号变化所产生的非线性。基于0.18μ... 分析了影响CMOS采样开关性能的非理想因素,针对中频采样A/D转换器对采样开关特性的要求,改进得到了一种新型的CMOS自举采样开关。较之传统栅压自举开关,此新型MOS采样开关能够消除由于阈值电压随输入信号变化所产生的非线性。基于0.18μm标准CMOS数模混合工艺对电路进行了模拟,模拟结果显示,在输入信号为2.39 MHz正弦波,峰峰值为2 V,采样时钟频率为100 MHz时,开关的无杂散动态范围达到116.7 dB,较之传统自举采样开关提高了15dB左右。试验结果表明该栅增压电路非常适用于高速中频采样。 展开更多
关键词 模数转换器 中频采样 栅压自举开关 MOS开关
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多片ADC并行采集系统的增益误差补偿 被引量:5
11
作者 尹亮 周劼 姚军 《现代电子技术》 2007年第17期170-171,共2页
时间交叉采样结构是提高模数转换系统采样率的一种有效途径。由于制造工艺的局限,这种结构会引入通道失配误差而限制系统的性能。通道失配误差包括偏置误差、增益误差和时间误差。提出了一种基于频域计算增益误差对其进行补偿的方法,并... 时间交叉采样结构是提高模数转换系统采样率的一种有效途径。由于制造工艺的局限,这种结构会引入通道失配误差而限制系统的性能。通道失配误差包括偏置误差、增益误差和时间误差。提出了一种基于频域计算增益误差对其进行补偿的方法,并通过Matlab仿真验证了算法的有效性和可行性。 展开更多
关键词 时间交叉采样 模数转换器 通道失配误差 增益误差
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基于0.6μm工艺的流水线模数转换器设计 被引量:1
12
作者 陈曦 何乐年 +1 位作者 张鲁 尹坤 《浙江大学学报(工学版)》 EI CAS CSCD 北大核心 2006年第6期1080-1084,共5页
为了实现10位高性能和低功耗的流水线模拟数字转换器ADC,提出了基于0.6微米互补型金属氧化物半导体(CMOS)混合信号工艺的电路设计方法.在信号输入端设置了采样保持放大器(SHA),级电路中采用了低功耗运算跨导放大器(OTA)和动态比较器,并... 为了实现10位高性能和低功耗的流水线模拟数字转换器ADC,提出了基于0.6微米互补型金属氧化物半导体(CMOS)混合信号工艺的电路设计方法.在信号输入端设置了采样保持放大器(SHA),级电路中采用了低功耗运算跨导放大器(OTA)和动态比较器,并且使用了采样电容优化技术和数字校正技术.测试结果表明,在20MHz采样率和5 MHz输入信号频率条件下,由该方法设计的ADC可以达到58 dB的信号噪声失调比(SNDR),相当于9.38个有效位数(ENOB),并且在5 V供电电压下的功耗仅为49 mW,达到了高SNDR性能、高线性度和低功耗的设计要求. 展开更多
关键词 模数转换器 采样保持电路 动态比较器 电容优化
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一种高速高宽带主从式采样保持电路 被引量:3
13
作者 丁浩 王建业 +1 位作者 刘伟 熊永忠 《西安电子科技大学学报》 EI CAS CSCD 北大核心 2018年第4期123-128,共6页
基于0.13μm SiGe BiCMOS工艺设计并实现了一种新型高速高宽带主从式采样保持电路.该电路采用PMOS源极跟随器作输入级实现了直流耦合,使得低频、低偏置电压信号也可以被正常采样.采用Cherry-Hooper放大器将带宽提升至18GHz.通过主从式... 基于0.13μm SiGe BiCMOS工艺设计并实现了一种新型高速高宽带主从式采样保持电路.该电路采用PMOS源极跟随器作输入级实现了直流耦合,使得低频、低偏置电压信号也可以被正常采样.采用Cherry-Hooper放大器将带宽提升至18GHz.通过主从式采样结构和交叉耦合电容消除了信号馈通,使用互补三极管抵消了时钟馈通的影响,将无杂散动态范围控制在33~38dB.对比结果表明,这种设计方案在带宽方面具有较大的优势,并且具有较高的采样率. 展开更多
关键词 高速高宽带 主从式采样 采样保持电路 信号馈通 时钟馈通 模数转换器
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基于线下估计和线上补偿的时间交错采样ADC失配误差补偿方法 被引量:2
14
作者 邹应全 吴太龙 +3 位作者 彭榆淞 孙一航 刘宜罡 张翠芳 《电子与信息学报》 EI CSCD 北大核心 2019年第1期226-232,共7页
该文提出一种改进的时间交错采样模数转换器(TIADC)失配误差补偿方法。系统通过误差参数和简化的拉格朗日插值算法分别实现了对偏置、增益的失配误差补偿和采样时间的失配误差补偿。该补偿方法在FPGA中采用低复杂度的定点运算实现,在TI... 该文提出一种改进的时间交错采样模数转换器(TIADC)失配误差补偿方法。系统通过误差参数和简化的拉格朗日插值算法分别实现了对偏置、增益的失配误差补偿和采样时间的失配误差补偿。该补偿方法在FPGA中采用低复杂度的定点运算实现,在TIADC硬件平台中实现了对多通道ADC采样数据的线上校正。实验结果表明:所提改进方法在仿真环境下使无杂散动态范围提升了51 dB,并且在硬件实现过程中使SFDR优化达45 dB。在保持失配误差估计精度和补偿效果优良的前提下,该方法不仅降低了算法的计算复杂度,而且该补偿结构不受TIADC通道数目的限制。 展开更多
关键词 模数转换器 时间交错采样 失配误差 补偿结构 定点运算
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一种用于12位250MSPS流水线ADC的中频采样前端 被引量:1
15
作者 钱宏文 陈珍海 于宗光 《中国电子科学研究院学报》 2014年第5期543-546,共4页
设计了一种具有中频采样功能的流水线ADC采样保持前端电路。采样保持前端电路采用基于开关电容的底板采样翻转式结构,运算放大器采用了米勒补偿型两级结构以提高信号摆幅,采样开关采用了消除衬底偏置效应的自举开关以提高中频采样特性... 设计了一种具有中频采样功能的流水线ADC采样保持前端电路。采样保持前端电路采用基于开关电容的底板采样翻转式结构,运算放大器采用了米勒补偿型两级结构以提高信号摆幅,采样开关采用了消除衬底偏置效应的自举开关以提高中频采样特性。该采样保持前端电路被运用于一种12位250 MSPS流水线ADC,电路采用0.18μm 1P5M 1.8 V CMOS工艺实现,测试结果表明该ADC电路在全速采样条件下对于20 MHz的输入信号得到的SNR为69.92 d B,SFDR为81.17 d B,-3 d B带宽达700 MHz以上,整个前端电路的功耗为58 m W。 展开更多
关键词 流水线模数转换器 采样保持电路 中频采样
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用于16位流水线ADC的高速动态比较器设计 被引量:1
16
作者 周启才 张勇 郭良权 《固体电子学研究与进展》 CAS CSCD 北大核心 2013年第6期583-589,共7页
介绍一种用于16位100MS/s流水线ADC中第一级子ADC的开关电容高速动态比较器电路,在传统的前置放大器加锁存比较电路结构的基础上,设计再生比较器的复位信号,增加失调消除反馈环路,当输入信号在各基准电压判定点附近一定范围内时交叉输出... 介绍一种用于16位100MS/s流水线ADC中第一级子ADC的开关电容高速动态比较器电路,在传统的前置放大器加锁存比较电路结构的基础上,设计再生比较器的复位信号,增加失调消除反馈环路,当输入信号在各基准电压判定点附近一定范围内时交叉输出0、1电平,一方面均衡噪声,另一方面消除因工艺制造失配等带来的失调误差的影响。电路采用0.18μm 1.8V1P5MCMOS工艺,在1.8V条件下传输延时约300ps,转换速率约100ps,功耗约250μA,失调电压仅约0.2mV,可以满足16位流水线ADC对比较器性能的要求。 展开更多
关键词 流水线模数转换器 高速动态比较器 开关电容 失调 采样保持
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VSP2000及在线阵CCD测量系统中应用分析 被引量:1
17
作者 赵凯生 刘爽 +2 位作者 龙再川 冯林 郝培育 《光电子技术》 CAS 2005年第3期194-197,共4页
介绍了CCD信号处理器V SP2000的内部结构和功能特点,并结合线阵CCD传感器TCD 1209D和ARM微处理器LPC 2106等设计了线阵CCD测量系统,详细叙述了系统的基本原理、线阵CCD驱动脉冲的产生和系统应用程序的设计方法。
关键词 VSP2000 电荷耦合器件 相关双采样 模数转换器
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工业数字化平台中电力参数计量的研究与实现 被引量:1
18
作者 朱弘 韩江洪 张永利 《合肥工业大学学报(自然科学版)》 CAS CSCD 北大核心 2006年第6期703-706,共4页
以工业安全生产数字化平台为研究背景,分析了几种交流采样算法,并根据实时性和精度要求选用适宜的算法;提出一种基于三相电能专用计量芯片的设计方案,实现对系统所需要的电力参数进行实时、准确及快速的计量,提高了整个控制系统的性能。
关键词 电力参数 交流采样 ∑-△ADC
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基于C31数字信号处理器的高精度新型地震数据采集站 被引量:1
19
作者 刘益成 程世旭 《江汉石油学院学报》 CSCD 北大核心 1997年第1期46-50,共5页
基于TMS320C31数字信号处理器设计了一种新型的地震数据采集站。该采集站用过采样A/D转换器作为数据采集的模数转换器件,采用两片TMS320C31构成流水线式的多级实时抽取滤波器,对采集的信号进行实时滤波抽取处理... 基于TMS320C31数字信号处理器设计了一种新型的地震数据采集站。该采集站用过采样A/D转换器作为数据采集的模数转换器件,采用两片TMS320C31构成流水线式的多级实时抽取滤波器,对采集的信号进行实时滤波抽取处理,将采集站的瞬时动态范围提高到120dB。介绍了地震采集站的结构,根据过采样A/D转换器采样率很高的特点,着重说明了多级抽取滤波器的设计方法以及采用TMS320C31实现实时滤波抽取的过程,最后给出了试验结果。 展开更多
关键词 数据采集 数字信息处理器 地震勘探
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基于PCI接口的高速A/D采集电路设计 被引量:5
20
作者 解文涛 《航空计算技术》 2010年第6期113-116,共4页
描述了一种基于PCI总线接口的高速A/D采样电路设计,提出了基本系统构型和硬件设计的开发思路,阐述了高速A/D芯片的选择、智能控制、PCI接口的电路设计,以及信号完整性设计的一般要求。
关键词 高速采样 ADC 转换器 信号完整性 PCI
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