基于触发行为的J、K激励函数的最小化技术 被引量：15

1

作者 吴训威 陈豪 《浙江大学学报（理学版）》 CAS CSCD 2004年第2期163-166,共4页

以JK触发器为例,提出了一种基于触发器行为的J、K激励函数的最小化技术.通过其与目前国内教科书中介绍的基于触发器次态函数最小化技术的对比与分析,证明了新的最小化技术是一种更行之有效的求最小化J、K激励函数的方法,对简化时序电路... 以JK触发器为例,提出了一种基于触发器行为的J、K激励函数的最小化技术.通过其与目前国内教科书中介绍的基于触发器次态函数最小化技术的对比与分析,证明了新的最小化技术是一种更行之有效的求最小化J、K激励函数的方法,对简化时序电路结构具有实用意义. 展开更多

关键词 激励函数 JK触发器 逻辑设计 时序电路设计 最小化

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基于低功耗双边沿JK触发器的异步时序电路设计 被引量：8

2

作者 赵敏笑 余红娟 陈偕雄 《浙江大学学报（理学版）》 CAS CSCD 北大核心 2005年第1期45-48,共4页

从JK触发器的激励表出发,介绍了基于单边沿JK触发器的同步时序电路和异步时序电路设计,提出了双边沿JK触发器的完整状态方程,并以此为基础讨论了基于双边沿JK触发器的异步时序电路的设计方法.

关键词 低功耗 双边沿触发器 异步时序电路 逻辑设计

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一个分析时序逻辑电路ICAI系统的设计与实现 被引量：3

3

作者 刘正光 张惊雷 张军 《天津大学学报（自然科学与工程技术版）》 EI CAS CSCD 北大核心 2002年第1期116-119,共4页

提出了一个用于分析时序逻辑电路的智能计算机辅助教学系统的构成 ,详细阐述了采用面向对象的知识表示方法建立系统领域知识库的设计思想及专家模型的设计过程 ,并讨论了实现中的一些技术问题 .研究结果表明本系统可快速求解一类时序逻... 提出了一个用于分析时序逻辑电路的智能计算机辅助教学系统的构成 ,详细阐述了采用面向对象的知识表示方法建立系统领域知识库的设计思想及专家模型的设计过程 ,并讨论了实现中的一些技术问题 .研究结果表明本系统可快速求解一类时序逻辑电路 (计数器电路 ) 展开更多

关键词 ICAI 时序逻辑电路 面向对象 知识表示 智能计算机辅助教学系统 数字逻辑电路 知识库

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时序逻辑电路的Petri网分析方法 被引量：4

4

作者 司玉娟 王万树 +2 位作者 郎六琪 郭殿龙 戴逸松 《计算机学报》 EI CSCD 北大核心 1996年第7期492-498,共7页

本文应用带抑止弧的增广Ｐｅｔｒｉ网，建立了基本门电路和常用触发器的Ｐｅｔｒｉ网模型，讨论了运用该模型描述同步和异步时序逻辑电路，给出了此增广Ｐｅｔｒｉ网的矩阵描述和状态转移方程，在此基础上提出了同步和异步时序逻辑电路... 本文应用带抑止弧的增广Ｐｅｔｒｉ网，建立了基本门电路和常用触发器的Ｐｅｔｒｉ网模型，讨论了运用该模型描述同步和异步时序逻辑电路，给出了此增广Ｐｅｔｒｉ网的矩阵描述和状态转移方程，在此基础上提出了同步和异步时序逻辑电路统一分析的Ｐｅｔｒｉ网方法． 展开更多

关键词 时序电路 PETRI网 逻辑分析 逻辑电路

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同步和异步时序电路的统一设计和分析理论 被引量：5

5

作者 吴训威 陈晓莉 金瓯 《电子科学学刊》 CSCD 1994年第4期365-372,共8页

本文讨论了时钟信号的普遍描述和含时钟信号的触发器次态方程,并在此基础上提出了同步和异步时序电路的统一设计和分析理论。该理论的有效性已由实例予以证明。

关键词 时序电路 时钟信号 同步 异步

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组合逻辑电路的软错误率自动分析平台 被引量：2

6

作者 绳伟光 肖立伊 毛志刚 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2009年第11期1661-1666,共6页

为在设计阶段快速评估集成电路的软错误率,以指导高可靠集成电路的设计,提出一种适用于组合逻辑电路和时序逻辑电路组合逻辑部分的快速软错误率自动分析平台HSECT-ANLY.采用精确的屏蔽概率计算模型来分析软错误脉冲在电路中的传播;用向... 为在设计阶段快速评估集成电路的软错误率,以指导高可靠集成电路的设计,提出一种适用于组合逻辑电路和时序逻辑电路组合逻辑部分的快速软错误率自动分析平台HSECT-ANLY.采用精确的屏蔽概率计算模型来分析软错误脉冲在电路中的传播;用向量传播和状态概率传播的方法来克服重汇聚路径的影响,以提高分析速度;使用LL(k)语法分析技术自动解析Verilog网表,使分析过程自动化,且使得本平台可分析时序电路的组合逻辑部分.开发工作针对综合后Verilog网表和通用的标准单元库完成,使得HSECT-ANLY的实用性更强.对ISCAS85和ISCAS89 Benchmark电路进行分析实验的结果表明:文中方法取得了与同类文献相似的结果,且速度更快,适用电路类型更多,可自动分析电路的软错误率并指导高可靠集成电路的设计. 展开更多

关键词 软错误率 组合逻辑电路 时序逻辑电路 语法分析 高可靠

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时序逻辑电路失效分析 被引量：4

7

作者 龚欣 王旭 《半导体技术》 CAS CSCD 北大核心 2009年第10期974-977,共4页

利用液晶热点定位和电压衬度像等技术手段,准确定位了一时序逻辑电路的失效部位,结合电路原理分析以及芯片版图,详细解释了器件失效模式与失效现象的关系,并对其失效原因进行了实验验证。结果显示,电压衬度技术可以直观地显示逻辑电路... 利用液晶热点定位和电压衬度像等技术手段,准确定位了一时序逻辑电路的失效部位,结合电路原理分析以及芯片版图,详细解释了器件失效模式与失效现象的关系,并对其失效原因进行了实验验证。结果显示,电压衬度技术可以直观地显示逻辑电路内部某点的逻辑状态,在失效定位以及失效模式确认方面起重要作用;时序逻辑电路失效后存在电势竞争现象,本失效案例表明,当电路中某点出现"1"和"0"的电势竞争时,该点表现为"1"。 展开更多

关键词 时序逻辑电路 失效分析 电压衬度像 电势竞争

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基于次态卡诺图的J、K激励函数最小化方法及时序逻辑电路自启动设计 被引量：23

8

作者 任骏原 《浙江大学学报（理学版）》 CAS CSCD 北大核心 2010年第4期425-427,共3页

分析了JK触发器的激励函数和次态函数的关系并在卡诺图上建立二者的联系,提出了在触发器的次态卡诺图上直接求解最小化J、K激励函数的方法,讨论了无效状态的赋值问题及自启动设计方法,对简化时序逻辑电路的设计过程具有实用意义.

关键词 JK触发器 激励函数 自启动 时序逻辑电路设计

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时序电路逻辑初始化研究 被引量：1

9

作者 王仲 康葳 魏道政 《电子测量与仪器学报》 CSCD 1999年第2期20-23,共4页

本文讨论了同步时序电路初始化问题，提出了一种基于电路存储元件逻辑定级和可控性分析的同步时序电路逻辑初始化方法。同时也给出了针对ＩＳＣＡＳ８９电路的一些实验结果。

关键词 同步时序电路 逻辑初始化 逻辑定级 可控性排序

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一种用于实现任意基数值时序逻辑的阈值存储电路 被引量：3

10

作者 张德龙 陈效玖 《计算机学报》 EI CSCD 北大核心 1992年第1期67-71,共5页

本文基于多值时序电路的次态方程和输出方程最小项展开式,提出了一种具有任意值输入、双轨二值输出的阈值存储电路设计方案,它和多值与或门配合,运用Disjoint代数能够设计出任意基数值时序电路.文中通过三值九进制计数器的设计,阐明了... 本文基于多值时序电路的次态方程和输出方程最小项展开式,提出了一种具有任意值输入、双轨二值输出的阈值存储电路设计方案,它和多值与或门配合,运用Disjoint代数能够设计出任意基数值时序电路.文中通过三值九进制计数器的设计,阐明了任意基数值时序电路的设计方法. 展开更多

关键词 阈值存储电路 时序逻辑 逻辑电路

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nMOS四值触发器的设计及其应用 被引量：1

11

作者 夏银水 吴训威 《电子科学学刊》 EI CSCD 1997年第5期669-676,共8页

本文应用限幅电压开关理论设计了两种主从型nMOS四值触发器。这砦触发器具有双端预置能力和双轨互补输出。通过采用JKLM型触发器对十六进制加法计数器和十进制加法计数器的设计实例证明了这些触发器能有效地用于四值时序电路的设计。

关键词 开关理论 NMOS 四值逻辑 触发器 设计

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基于数据选择器和D触发器的多输入时序电路设计 被引量：2

12

作者 任骏原 《现代电子技术》 2010年第12期10-12,共3页

为了探索多输入时序逻辑电路的简便实现方法,介绍了基于数据选择器和D触发器的多输入时序逻辑电路设计技术。即将D触发器和数据选择器进行组合,用触发器的现态作为数据选择器选择输入变量、数据选择器的输出函数作为触发器的D输入信号,... 为了探索多输入时序逻辑电路的简便实现方法,介绍了基于数据选择器和D触发器的多输入时序逻辑电路设计技术。即将D触发器和数据选择器进行组合,用触发器的现态作为数据选择器选择输入变量、数据选择器的输出函数作为触发器的D输入信号,构成既有存储功能又有数据选择功能的多输入端时序网络。由触发器的现态选择输入变量、所选择的输入变量决定触发器的次态转换方向。该方法适合实现互斥多变量时序逻辑电路,且在设计过程中不需要进行函数化简。 展开更多

关键词 D触发器 数据选择器 时序网络 多输入时序逻辑电路

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异步时序逻辑电路分析方法的研究 被引量：2

13

作者 齐耀辉 《现代电子技术》 2008年第6期14-18,共5页

首先对异步时序逻辑电路的特点和分类进行描述,接着从具体的操作步骤、结果的表现方式等方面结合具体实例阐述其一般的分析方法和新出现的分析方法:计算分析法和卡诺图分析法,并对计算分析法进行改进,以期能够更好地指导异步时序电路的... 首先对异步时序逻辑电路的特点和分类进行描述,接着从具体的操作步骤、结果的表现方式等方面结合具体实例阐述其一般的分析方法和新出现的分析方法:计算分析法和卡诺图分析法,并对计算分析法进行改进,以期能够更好地指导异步时序电路的分析。通过实例分别阐述3种分析方法,并进行对比,在保证分析结果的前提下,改进的计算分析法分析异步时序逻辑电路时不用考虑时钟信号,使分析变得简单;而卡诺图分析法使分析过程思路清晰,状态转换更加直观化。 展开更多

关键词 异步时序逻辑电路 触发器 计算分析法 卡诺图分析法

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数字集成电路芯片微机检测法 被引量：1

14

作者 蒋万君 《现代电子技术》 2002年第4期18-20,共3页

用可编程并行接口 82 5 5 A设计一个 PC机的接口电路 ,该电路用来检测数字集成电路芯片的好坏 ,具有成本低、效率高。

关键词 数字集成电路芯片 微机检测法 组合逻辑电路 时序逻辑电路

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时序逻辑电路在片进化设计与实现

15

作者 娄建安 李川涛 +1 位作者 常小龙 满梦华 《郑州大学学报（工学版）》 CAS 北大核心 2012年第6期10-14,共5页

针对EHW(Evolvable Hardware)技术在电子设计自动化、容错运行、自诊断、自适应和自修复等方面的特点,借鉴传统时序电路设计的方法,建立了适应于片内进化的时序电路演化模型和基于XilinxFPGA Virtex-5(XC5VLX110T)的Microblaze软核结构... 针对EHW(Evolvable Hardware)技术在电子设计自动化、容错运行、自诊断、自适应和自修复等方面的特点,借鉴传统时序电路设计的方法,建立了适应于片内进化的时序电路演化模型和基于XilinxFPGA Virtex-5(XC5VLX110T)的Microblaze软核结构,并运行GA算法对本文设计的VRC进行配置、演化.进而,利用设计的时序电路演化模型成功演化了1001检波器以及二、四、八分频器等时序逻辑电路,验证了本模型的有效性、通用性,并深入分析了演化算法中的随机数种子对演化性能的影响,可为演化算法设计提供一定的参考. 展开更多

关键词 时序逻辑 演化 在片电路 MICROBLAZE

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时序电路逻辑初始化问题研究

16

作者 徐红东 王晓群 +2 位作者 林大勇 赵月雷 王仲 《计算机工程》 CAS CSCD 北大核心 2003年第8期167-169,共3页

讨论同步时序电路初始化问题,提出了一种基于电路存储元件逻辑定级和可控性分析的同步时序电路逻辑初始化方法。同时也给出了针对ISCAS89电路的一些实验结果。

关键词 同步时序电路 逻辑初始化 可控性

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时序电路仿真实现

17

作者 奚文骏 冯玉光 《电子测量技术》 2002年第5期14-15,共2页

在Protel仿真平台下,针对时序电路仿真的具体问题,阐述了仿真电路搭接和电路仿真过程中应该注意的一些细节问题和操作技巧。

关键词 时序电路 仿真 PROTEL EDA

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基于可逆触发器的可逆移位寄存器设计方法

18

作者 王友仁 沈先坤 周影辉 《南京航空航天大学学报》 EI CAS CSCD 北大核心 2014年第4期533-537,共5页

为了进一步提高可逆时序逻辑电路设计方法的通用性和改善可逆电路性能指标,以可逆主从D触发器为基本单元,通过将时钟信号及垃圾位信号级联再利用,提出了一种可逆串行移位寄存器优化设计方案。在此基础上,通过目标函数构造及变换构建带... 为了进一步提高可逆时序逻辑电路设计方法的通用性和改善可逆电路性能指标,以可逆主从D触发器为基本单元,通过将时钟信号及垃圾位信号级联再利用,提出了一种可逆串行移位寄存器优化设计方案。在此基础上,通过目标函数构造及变换构建带有移位控制的单元模块,设计了满足串行输入串/并行输出功能的n位可逆双向移位寄存器。设计结果表明,采用方法所设计的可逆移位寄存器具有较优的性能指标,且对于双向移位寄存器综合具有较好的通用性。 展开更多

关键词 可逆时序逻辑电路 可逆触发器 垃圾位 可逆移位寄存器

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直接控制触发器预置端的2-3混值计数器设计

19

作者 应时彦 陈偕雄 《杭州大学学报（自然科学版）》 CSCD 1992年第2期155-161,共7页

本文研究混值计数器设计中触发器直接预置端的应用.文中首先分析了三值触发器预置端的功能,将二值触发器的邻控原理推广到三值触发器中.然后提出了反馈式和邻控式混值计数器的设计.按照此法设计的电路比较简单,具有一定的实用意义.

关键词 混值计数器 触发器 多值逻辑

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基于U_h门的三值触发器和时序电路设计

20

作者 沈继忠 陈偕雄 《电子科学学刊》 CSCD 1993年第3期261-267,共7页

本文根据基于模代数的各种三值触发器的次态方程,提出用U_k通用门实现各种三值触发器。在此基础上,利用U_k门阵列实现三值时序电路。

关键词 通用门 三值触发器 时序电路

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