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适于航天应用的高速SPIHT图像压缩算法 被引量:5
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作者 张宁 吴银花 +1 位作者 金龙旭 陶宏江 《液晶与显示》 CAS CSCD 北大核心 2011年第6期847-852,共6页
SPIHT和无链表SPIHT(Not List SPIHT)是高效的图像压缩算法,但是抗误码性差、压缩速度慢等缺点限制了其在航天领域的应用。文章针对上述两个缺点对算法进行了改进,采用Le Gall5/3小波对遥感图像进行小波分解,将小波域系数分家族块进行... SPIHT和无链表SPIHT(Not List SPIHT)是高效的图像压缩算法,但是抗误码性差、压缩速度慢等缺点限制了其在航天领域的应用。文章针对上述两个缺点对算法进行了改进,采用Le Gall5/3小波对遥感图像进行小波分解,将小波域系数分家族块进行索引、扫描和码率分配,按照比特平面或运算进行重要性预测,实现了N个位平面同时编码。改进算法与SPIHT相比易于硬件编程实现,仿真结果显示,解压后图像峰值信噪比(PSNR)提高了0.2~0.6db,压缩速度提高了4~6倍。用硬件实现时如果采用并行和流水线操作,速度还可以进一步提高。 展开更多
关键词 航天应用 高速SPIHT 抗误码性 比特平面并行
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JPEG2000全并行位平面编码器的VLSI设计验证 被引量:3
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作者 刘文松 朱恩 +2 位作者 王健 徐龙涛 黄宁 《东南大学学报(自然科学版)》 EI CAS CSCD 北大核心 2011年第6期1132-1136,共5页
研究了JPEG2000位平面编码器的算法和全并行电路结构.以单列样本点作为数据单元,分析了通道编码过程中数据的关联性.只需缓存前一列样本点的显著性状态信息,并读取当前列和后续2列的原始数据,便可在一个编码窗口内完成当前列的通道和位... 研究了JPEG2000位平面编码器的算法和全并行电路结构.以单列样本点作为数据单元,分析了通道编码过程中数据的关联性.只需缓存前一列样本点的显著性状态信息,并读取当前列和后续2列的原始数据,便可在一个编码窗口内完成当前列的通道和位平面并行编码;每次仅需读入一列新的数据,即可实现编码循环.据此设计了三级流水线的全并行电路结构,仅需259个周期就可处理完32×32的小波子带,同时保持了较低的硬件开销.FPGA综合结果表明,系统时钟可以综合到76.355 MHz,达到301.9Mcoefficient/sec的处理能力,可满足现有图像实时处理要求. 展开更多
关键词 JPEG2000 位平面编码 通道并行 位平面并行 VLSI
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高性能的EBCOT编码及其VLSI结构 被引量:7
3
作者 刘凯 李云松 吴成柯 《软件学报》 EI CSCD 北大核心 2006年第7期1553-1560,共8页
提出了比特平面与编码过程全并行处理的EBCOT(embeddedblockcodingwithoptimizedtruncation)编码结构.通过分析JPEG2000和国内外提出的EBCOT编码结构,指出不仅每一个比特平面,而且对应的编码过程的编码信息可以同时获得,从而给出了比特... 提出了比特平面与编码过程全并行处理的EBCOT(embeddedblockcodingwithoptimizedtruncation)编码结构.通过分析JPEG2000和国内外提出的EBCOT编码结构,指出不仅每一个比特平面,而且对应的编码过程的编码信息可以同时获得,从而给出了比特平面与编码过程全并行处理的块编码方法,并且详细说明了实现的VLSI结构.理论分析以及具体实验结果表明,比特平面与编码过程全并行处理所需的时钟周期最少,FPGA原型系统最高时钟频率可达65MHz,对于512512的灰度图像,处理速度可达30fps,完全可以实时处理,图像质量达到了公布的JPEG2000标准. 展开更多
关键词 EBCOT算法 比特平面与编码过程全并行 块编码
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基于单窗口扫描的并行EBCOT编码 被引量:4
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作者 唐国维 顾国昌 《哈尔滨工业大学学报》 EI CAS CSCD 北大核心 2008年第12期2078-2081,共4页
针对JPEG2000中EBCOT编码算法在上下文的生成过程中需对比特平面进行多次扫描,提出基于单窗口扫描的并行EBCOT编码算法.通过预存行状态去除带间相关性,然后进行基于单窗口的上下文逻辑编码,并优先计算比特平面状态值,实现一次扫描完成... 针对JPEG2000中EBCOT编码算法在上下文的生成过程中需对比特平面进行多次扫描,提出基于单窗口扫描的并行EBCOT编码算法.通过预存行状态去除带间相关性,然后进行基于单窗口的上下文逻辑编码,并优先计算比特平面状态值,实现一次扫描完成比特平面及平面内三个通道的并行编码.实验结果表明,在保证一定编码质量的前提下,有效地提高了JPEG2000系统的并行性,压缩了编码时间. 展开更多
关键词 EBCOT算法 单窗口扫描 比特平面 并行编码 图像编码
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嵌入式块编码的快速算法和结构 被引量:2
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作者 熊承义 侯建华 +1 位作者 田金文 柳健 《通信学报》 EI CSCD 北大核心 2006年第7期53-60,共8页
为了更加有效地解决JPEG2000位平面编码算法实现的低效问题,提出了一种快速的基于字级顺序的嵌入式块编码方法。新的编码方法采用对样本的编码通道预测和样本的上下文形成并行流水线执行的技术,实现了对一个子块系数的所有位平面多通道... 为了更加有效地解决JPEG2000位平面编码算法实现的低效问题,提出了一种快速的基于字级顺序的嵌入式块编码方法。新的编码方法采用对样本的编码通道预测和样本的上下文形成并行流水线执行的技术,实现了对一个子块系数的所有位平面多通道编码的一次扫描顺序完成。提出了一种新的实现字级顺序且多字并行的高速结构,能够在一个时钟周期同时执行对一个条带列4个系数的上下文形成,完成对一个N×N子块系数的上下文形成只需大约N2/4个时钟周期。理论分析和实验结果表明,新的结构比较同类最新设计具有更快的数据处理能力和良好的加速比成本的性能。 展开更多
关键词 位平面编码 块编码 字级顺序 并行
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适合空间应用的高速图像压缩核设计 被引量:2
6
作者 王怀超 顾晓东 陈晓敏 《宇航学报》 EI CAS CSCD 北大核心 2009年第6期2297-2302,共6页
针对空间遥感图像压缩的具体应用,给出了基于CCSDS[1]算法的高速图像压缩核的设计和实现。对CCSDS算法的实现方法进行了优化,算法的VLSI架构设计充分利用了流水和并行技术,使处理速度相比串行方式平均提高了40倍。压缩验证系统实验结果... 针对空间遥感图像压缩的具体应用,给出了基于CCSDS[1]算法的高速图像压缩核的设计和实现。对CCSDS算法的实现方法进行了优化,算法的VLSI架构设计充分利用了流水和并行技术,使处理速度相比串行方式平均提高了40倍。压缩验证系统实验结果表明压缩核在编码效率、处理速度和容错能力上均具有较高的性能,50MHz频率下压缩核的数据处理速度可达12.5Mpixels/s。 展开更多
关键词 遥感图像 小波变换 并行处理 流水线 位平面编码
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一个新的嵌入式零树小波图像编码的多位平面并行算法 被引量:1
7
作者 钟萃相 韩国强 黄明和 《计算机应用研究》 CSCD 北大核心 2007年第3期283-285,共3页
发现了一个EZW(Embedded Zerotree Wavelet)编码的多位平面并行算法,其每个位平面的编码仅需对位平面进行一遍扫描,大大提高了EZW的编码速度。
关键词 嵌入式小波零树编码 多位平面并行编码 图像编码 编码速度
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JPEG2000的系数位上下文建模算法及其应用研究
8
作者 钟萃相 韩国强 黄明和 《计算机应用研究》 CSCD 北大核心 2007年第12期370-373,376,共5页
提出了系数位上下文建模算法,利用它可先建立每个位平面的上下文,再直接进行编码,大大提高了编码的并行性。利用它还可以容易地实现一次性扫描的快速编码系统和位平面并行编码系统。
关键词 JPEG2000 优化截断嵌入式块编码 上下文 一次性扫描编码 并行位平面编码
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基于整数小波变换的零树编码的多位平面并行算法
9
作者 钟萃相 韩国强 黄明和 《计算机应用》 CSCD 北大核心 2006年第7期1573-1576,共4页
为了解决整数小波变换与传统零树编码(EZW)算法相结合产生的量化阈值的选取问题,有人提出了基于整数平方量化阈值的零树编码(ISZW)算法。但是,由于ISZW使用连续的整数平方作为量化阈值,缩短了相邻阈值间的距离,却增加了编码的次数,降低... 为了解决整数小波变换与传统零树编码(EZW)算法相结合产生的量化阈值的选取问题,有人提出了基于整数平方量化阈值的零树编码(ISZW)算法。但是,由于ISZW使用连续的整数平方作为量化阈值,缩短了相邻阈值间的距离,却增加了编码的次数,降低了编码速度。为此设计了基于整数小波变换的零树编码的多位平面并行算法,其中每个位平面的编码仅需对位平面进行一遍扫描,大大提高了ISZW的编码速度。 展开更多
关键词 整数小波变换 零树编码 量化阈值 多位平面并行
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基于Handel-C的空间图像压缩核的CCSDS算法实现 被引量:1
10
作者 滕学剑 顾晓东 陈晓敏 《电子学报》 EI CAS CSCD 北大核心 2010年第7期1716-1722,共7页
本文给出了一种采用Handel-C设计理念,基于CCSDS图像压缩算法的硬件图像压缩核的设计过程.算法实现过程中充分利用Handel-C语言的硬件并行实现机制,在各个硬件模块间大量采用并行运算和流水结构,提高了芯片的处理速度.实验数据表明,本... 本文给出了一种采用Handel-C设计理念,基于CCSDS图像压缩算法的硬件图像压缩核的设计过程.算法实现过程中充分利用Handel-C语言的硬件并行实现机制,在各个硬件模块间大量采用并行运算和流水结构,提高了芯片的处理速度.实验数据表明,本文压缩核的设计在资源消耗和码速率两方面取得了很好的折中.在频率为50MHz的情况下,码速率可以达到15.2Mpixels/s;在8倍压缩情况下,平均PSNR接近40dB,16倍压缩情况下,平均PSNR超过30dB. 展开更多
关键词 HANDEL-C CCSDS 离散小波变换 并行处理 流水线 位平面编码
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