DRAM芯片的最新研制进展与发展趋势 被引量：11

1

作者 成立 王振宇 高平 《半导体技术》 CAS CSCD 北大核心 2004年第4期1-5,14,共6页

介绍了动态随机存取存储器(DRAM)的最新制造技术、0.1μm特征尺寸理论极限的突破和相关新技术的进展,并展望了3种非易失性随机存取存储器(NVRAM),如FRAM、相变RAM、MRAM和BiCMOS技术的开发前景与发展趋势。

关键词 DRAM 动态随机存取存储器 数字集成电路 FRAM 相变RAM MRAM BICMOS 发展趋势

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BST铁电薄膜材料的研究现状及其进展 被引量：5

2

作者 苗鸿雁 马景云 +1 位作者 谈国强 孙正球 《材料导报》 EI CAS CSCD 北大核心 2005年第12期99-101,105,共4页

铁电钛酸锶钡(Ba_xSr_(1-x))TiO_3是一种具有十分优越铁电/介电性能的材料,在可调微波器件及动态随机存储器件方面有很好的应用前景。介绍了钛酸锶钡薄膜材料的基本结构、制备技术、掺杂改性等方面的研究现状.并在性能改善的基础上,指... 铁电钛酸锶钡(Ba_xSr_(1-x))TiO_3是一种具有十分优越铁电/介电性能的材料,在可调微波器件及动态随机存储器件方面有很好的应用前景。介绍了钛酸锶钡薄膜材料的基本结构、制备技术、掺杂改性等方面的研究现状.并在性能改善的基础上,指出了该材料的未来发展方向。 展开更多

关键词 钛酸锶钡薄膜 性能改善 微波器件 存储器

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实时合成孔径雷达成像中的专用快速CTM算法 被引量：4

3

作者 张冠杰 张涛 +2 位作者 张欢阳 王贞松 张守宏 《西安电子科技大学学报》 EI CAS CSCD 北大核心 2006年第1期11-14,27,共5页

在分析同步动态随机存储器读写特性的基础上,提出了基于现场可编程门阵列的专用同步动态随机存储器控制器快速矩阵转置算法,实现了矩阵转置读写及顺序读写的等速与高效.该算法不仅充分地发挥了同步动态随机存储器的最佳矩阵转置读写性能... 在分析同步动态随机存储器读写特性的基础上,提出了基于现场可编程门阵列的专用同步动态随机存储器控制器快速矩阵转置算法,实现了矩阵转置读写及顺序读写的等速与高效.该算法不仅充分地发挥了同步动态随机存储器的最佳矩阵转置读写性能,而且也提高了高分辨率合成孔径雷达成像处理的实时性. 展开更多

关键词 同步动态随机存储器 合成孔径雷达 矩阵转置 实时处理

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BST材料在DRAM电容中的应用研究 被引量：6

4

作者 肖斌 汪家友 +1 位作者 苏祥林 杨银堂 《压电与声光》 CSCD 北大核心 2005年第3期287-290,共4页

钛酸锶钡(BST)高介电常数材料被普遍认为是最有前途的DRAM电容介质材料。BST作为DRAM电容介质材料的研究已有多年,到目前为止取得了不少突破性的进展。介绍了BST的材料特性和堆积型电容结构电极、埋层材料的设计考虑,探讨了BST膜的制备... 钛酸锶钡(BST)高介电常数材料被普遍认为是最有前途的DRAM电容介质材料。BST作为DRAM电容介质材料的研究已有多年,到目前为止取得了不少突破性的进展。介绍了BST的材料特性和堆积型电容结构电极、埋层材料的设计考虑,探讨了BST膜的制备、掺杂及刻蚀工艺技术。 展开更多

关键词 钛酸锶钡 动态随机存储器 介质材料 堆积型电容

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同步动态随机存储器辐射效应测试系统研制 被引量：4

5

作者 姚志斌 罗尹虹 +3 位作者 陈伟 何宝平 张凤祁 郭红霞 《强激光与粒子束》 EI CAS CSCD 北大核心 2013年第10期2699-2704,共6页

在分析同步动态随机存储器(SDRAM)辐射效应主要失效现象的基础上,研制了具备了读写功能测试、刷新周期测试及功耗电流测试三种功能的SDRAM辐射效应在线测试系统,并开展了SDRAM的总剂量效应实验研究。结果表明,总剂量效应会导致SDRAM器... 在分析同步动态随机存储器(SDRAM)辐射效应主要失效现象的基础上,研制了具备了读写功能测试、刷新周期测试及功耗电流测试三种功能的SDRAM辐射效应在线测试系统,并开展了SDRAM的总剂量效应实验研究。结果表明,总剂量效应会导致SDRAM器件的数据保持时间不断减小,功耗电流不断增大以及读写功能失效。实验样品MT48LC8M32B2的功能失效主要由外围控制电路造成,而非存储单元翻转。数据保持时间虽然随着辐照剂量的累积不断减小,但不是造成该器件功能失效的直接原因。 展开更多

关键词 同步动态随机存储器 辐射效应 测试系统 刷新周期 总剂量效应

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一种面向写穿透Cache的写合并设计及验证 被引量：2

6

作者 梅魁志 李国辉 张斌 《西安交通大学学报》 EI CAS CSCD 北大核心 2010年第4期1-4,共4页

为了利用片上缓冲技术来提高处理器应用性能,提出一种面向写穿透Cache的写合并设计方法.使用同步动态随机存储器(SDRAM)的单个写方式和片上写缓冲器,对SDRAM一行内的局部数据采用写合并策略,由此提高了外部存储的访问效率,同时给出了连... 为了利用片上缓冲技术来提高处理器应用性能,提出一种面向写穿透Cache的写合并设计方法.使用同步动态随机存储器(SDRAM)的单个写方式和片上写缓冲器,对SDRAM一行内的局部数据采用写合并策略,由此提高了外部存储的访问效率,同时给出了连续和单个Cache读写的缓存与内存的数据一致性策略.在寄存器传输语言(RTL)仿真环境下使用mp3解码对Leon2处理器进行数据测试,结果表明:在缓冲区优化为3行8列的参数下,SDRAM每次行开启平均进行7.8个字的写入操作,外存的读写效率由12%提高到19%;在TSMC0.18μm工艺下,综合后面积为0.263mm2,流片后工作主频为100MHz. 展开更多

关键词 写穿透 写合并 处理器 同步读写存储器 读写效率

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视频图像采集及网络传输系统的设计 被引量：7

7

作者 罗霄华 张博 《吉林大学学报（信息科学版）》 CAS 2011年第5期424-428,共5页

为满足特殊行业对高分辨率视频监控的需求,设计一种基于FPGA(Field Programmable Gate Array)的视频图像采集及网络传输系统。采用IIC(Intel-Integrated Circuit)协议,利用FPGA实现对图像传感器寄存器的配置,图像传感器输出分辨率为1 02... 为满足特殊行业对高分辨率视频监控的需求,设计一种基于FPGA(Field Programmable Gate Array)的视频图像采集及网络传输系统。采用IIC(Intel-Integrated Circuit)协议,利用FPGA实现对图像传感器寄存器的配置,图像传感器输出分辨率为1 024×768、帧率为8 Hz、16位数字YCbCr的视频信号至FPGA,FPGA对接收的视频信号按照4 Hz的帧率进行采样存储。采用DDR SDRAM存储器作为帧缓存,接收的视频信号通过FPGA内部的以太网控制器模块打包成以太网数据帧格式,通过物理层芯片接口模块发送到外部物理层芯片,图像传感器采集的视频数据可通过以太网进行远距离传输。该系统设计采用VHDL(Very-High-Speed Integrat-ed Circuit Hardware Description Language)语言实现,并在Xilinx FPGA上验证。验证结果表明,该系统可有效传输高分辨率视频图像。 展开更多

关键词 图像采集 双倍速率同步动态随机存储器 以太网控制器 现场可编程逻辑门阵列

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基于SDRAM的大容量FIFO的方案设计 被引量：1

8

作者 李宝 刘志轩 +2 位作者 徐进 陈东涛 李箭 《导弹与航天运载技术》 北大核心 2014年第4期67-70,共4页

在数据高速采集系统中缓存是一个关键的部分,随着数据量的增加和速度的提高,对缓存的容量和速度提出更高的要求。采用Altera公司的Cyclone系列的FPGA设计了大容量高速率的可随时读写的FIFO,并将设计嵌入到数据采集系统中,完成了数据的... 在数据高速采集系统中缓存是一个关键的部分,随着数据量的增加和速度的提高,对缓存的容量和速度提出更高的要求。采用Altera公司的Cyclone系列的FPGA设计了大容量高速率的可随时读写的FIFO,并将设计嵌入到数据采集系统中,完成了数据的存储功能。最后以QuartusII为平台进行设计,用Modelsim软件进行仿真,并已经应用到某型号设计中,达到了预期的目标。 展开更多

关键词 数据采集 SDRAM控制器 缓存

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基于FPGA的SDRAM控制器设计 被引量：18

9

作者 宋一鸣 谢煜 李春茂 《电子工程师》 2003年第9期10-13,共4页

介绍了SDRAM的结构和控制时序特点 ,以及基于FPGA的SDRAM控制器设计的关键技术 ,并引入仲裁机制 ,从而实现了快速高效地控制SDRAM。

关键词 FPGA SDRAM 控制器 控制时序 仲裁机制 动态存储器

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海量CT图像的激光三维信息存储结构设计 被引量：1

10

作者 方胜吉 翁苏湘 《激光杂志》 北大核心 2017年第10期105-109,共5页

为了满足使用者对海量CT图像的存储需求,设计一种存储性能优异的海量CT图像的激光三维信息存储结构。该结构主要包括FPGA、SRAM和SDRAM三种元件,提出了信息的整体与部分存储方案,SDRAM和SRAM分别负责一级缓存和二级缓存。FPGA选择Cyclon... 为了满足使用者对海量CT图像的存储需求,设计一种存储性能优异的海量CT图像的激光三维信息存储结构。该结构主要包括FPGA、SRAM和SDRAM三种元件,提出了信息的整体与部分存储方案,SDRAM和SRAM分别负责一级缓存和二级缓存。FPGA选择Cyclone架构的FD2C13为SDRAM提供存储配置,描述了FPGA配置连接电路图,共提供7种配置方式。为SDRAM选型MT41GO7M14C3,设计出存储结构的内部存储电路,并依次对SRAM和SDRAM进行了逻辑实现。经测试可知,所设计的存储结构存储速度快、存储完整性高、存储同步性强。 展开更多

关键词 CT图像 激光三维信息 FPGA SRAM SDRAM 存储结构

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具有访问约束和随机时延的网络化系统动态输出反馈控制 被引量：2

11

作者 祝超群 张磐 《兰州理工大学学报》 CAS 北大核心 2021年第6期84-93,共10页

针对一类同时具有介质访问约束和随机时延的网络化控制系统,研究了其中的动态输出反馈控制设计问题.考虑到介质访问约束和随机时延的影响,将系统建模为一类具有参数不确定性的马尔可夫跳变系统,基于李雅普诺夫稳定性理论和LMI技术推导... 针对一类同时具有介质访问约束和随机时延的网络化控制系统,研究了其中的动态输出反馈控制设计问题.考虑到介质访问约束和随机时延的影响,将系统建模为一类具有参数不确定性的马尔可夫跳变系统,基于李雅普诺夫稳定性理论和LMI技术推导出系统稳定的充分条件,并且设计了相应的动态输出反馈控制器,使得闭环系统鲁棒稳定并具有给定的H_(∞)性能,最后通过仿真算例证明了所提出方法是有效的. 展开更多

关键词 网络化控制系统 介质访问约束 随机时延 动态输出反馈

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基于相机连接接口的大图像实时显示系统 被引量：1

12

作者 姚引娣 《西安邮电大学学报》 2015年第4期54-57,共4页

采用高速缓存、帧分多路输出,实现一种实时大图像多显示器联合显示系统。该方案采用现场可编程逻辑阵列芯片,利用双倍速率同步动态随机存储器芯片作为数据缓存单元,通过片上同步动态随机存取存储器乒乓缓存数据,将每帧图像数据平均分配... 采用高速缓存、帧分多路输出,实现一种实时大图像多显示器联合显示系统。该方案采用现场可编程逻辑阵列芯片,利用双倍速率同步动态随机存储器芯片作为数据缓存单元,通过片上同步动态随机存取存储器乒乓缓存数据,将每帧图像数据平均分配并通过相机连接(Camera Link)接口发给上位机显示。通过Chipscope在线调试软件测试,该实时显示系统支持5路Camera Link输出,每路Camera Link图像输出采用12比特位宽,支持最大数据吞吐量为960Mbps,能解决超大尺寸图像因常规显示器显示范围有限而不能在一个显示器上完整显示的问题。 展开更多

关键词 现场可编程逻辑阵列 相机连接接口 乒乓控制 双倍速率同步动态随机存储器

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基于DMA传输方式的SDRAM控制器的设计与实现 被引量：3

13

作者 顾峰 《舰船电子对抗》 2009年第2期108-111,共4页

在简单介绍同步动态随机存储器(SDRAM)的基础上,提出了一种基于直接存储器读取(DMA)传输方式的SDRAM控制器,详细介绍了DMA控制器和SDRAM控制器的设计,并说明了其现场可编程门阵列(FPGA)实现后的性能。

关键词 直接存储器读取传输 同步动态随机存储控制器 现场可编程门阵列

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一种基于碳纳米管的随机存储器

14

作者 孙劲鹏 王太宏 《微纳电子技术》 CAS 2002年第10期8-13,26,共7页

随着传统存储器集成度的不断提高,每个存储单元的电子数目不断减少,并逐渐接近其极限。为了解决传统存储器件发展遇到的困难,利用碳纳米管之间范德瓦耳斯力,设计了一种基于碳纳米管的可读写的随机存储器,研究了系统的双稳性,讨论了存储... 随着传统存储器集成度的不断提高,每个存储单元的电子数目不断减少,并逐渐接近其极限。为了解决传统存储器件发展遇到的困难,利用碳纳米管之间范德瓦耳斯力,设计了一种基于碳纳米管的可读写的随机存储器,研究了系统的双稳性,讨论了存储器的优点和可行性,并认为系统具有良好存储效应所应满足的条件。 展开更多

关键词 碳纳米管 随机存储器 范德瓦耳斯力 动态随机存储器 化学汽相沉积

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SDRAM及其可编程逻辑器件控制 被引量：1

15

作者 张若岚 《电子工程师》 2000年第11期11-14,共4页

对计算机内存 SDRAM的内部结构 ,主要信号及其时序控制作了详尽的介绍。提出了用可编程逻辑器件作为逻辑控制芯片对内存条进行控制 ,从而使在工程项目中使用计算机内存条成为可能 ,为需要大容量高速存储器的电子设计提供了一种新的思路。

关键词 SDRAM 计算机 内存 可编程逻辑件

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一种用于FPGA的可配置存储器设计 被引量：4

16

作者 高闯 吴利华 +1 位作者 芳罗 家俊 《固体电子学研究与进展》 CAS CSCD 北大核心 2016年第1期66-70,共5页

设计了一种用于FPGA中的同步、双端口、容量为4kbit、可配置的存储器模块(Block RAM,BRAM)。BRAM以阵列形式内嵌在FPGA内部,是FPGA的主要模块之一。该BRAM可实现1、2、4、8、16bit 5种不同的数据位宽,且具有数据初始化及回读验证的功能... 设计了一种用于FPGA中的同步、双端口、容量为4kbit、可配置的存储器模块(Block RAM,BRAM)。BRAM以阵列形式内嵌在FPGA内部,是FPGA的主要模块之一。该BRAM可实现1、2、4、8、16bit 5种不同的数据位宽,且具有数据初始化及回读验证的功能。本文分别对BRAM的逻辑层、配置层、布线层进行了描述,重点介绍了逻辑层中时序控制电路和配置层中配置电路的结构和实现方法。基于0.18μm 5层金属SOI CMOS工艺完成BRAM设计实现,并对BRAM进行了仿真,功能仿真结果符合时序控制电路和配置电路的预期设计目标,性能仿真表明其工作频率可达200 MHz。 展开更多

关键词 块存储器 现场可编程门阵列 可配置 存储器 时序控制 配置电路

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优化内存系统能效的DRAM架构研究综述 被引量：1

17

作者 展旭升 包云岗 孙凝晖 《高技术通讯》 EI CAS 北大核心 2018年第9期794-812,共19页

介绍了不同层次优化内存系统能效研究的现状,对通过修改动态随机存取存储器(DRAM)架构优化内存系统能效的研究进行了详细论述。概述了通过修改内存控制器和操作系统实现的高能效DRAM系统的研究。着重介绍了通过修改DRAM架构实现内存系... 介绍了不同层次优化内存系统能效研究的现状,对通过修改动态随机存取存储器(DRAM)架构优化内存系统能效的研究进行了详细论述。概述了通过修改内存控制器和操作系统实现的高能效DRAM系统的研究。着重介绍了通过修改DRAM架构实现内存系统能效优化的研究,并将这些研究分为"低延迟的DRAM架构"和"低功耗的DRAM架构"两大类进行介绍,其中低延迟架构的研究包括优化关键操作、降低平均访存延迟以及提升请求并发度等3个方面;低功耗的架构研究包括细粒度激活、低功耗与低频率芯片、优化写操作、优化刷新操作以及多粒度访存等5个方面。最后给出了关于修改DRAM架构实现内存能效优化的总结和展望。 展开更多

关键词 内存 动态随机存取存储器(DRAM) 内存控制器 架构 能效 低延迟 低功耗

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基于FPGA的SDRAM控制器设计与实现 被引量：5

18

作者 仵宗钦 王晓曼 +2 位作者 刘鹏 王奇 张立媛 《电子与封装》 2014年第10期20-24,共5页

针对SDRAM(Synchronous Dynamic Random Access Memory)在缓存图像数据时时序的控制比较复杂的问题,在研究SDRAM的特点和原理的基础上,提出了一种基于现场可编程逻辑器件FPGA(Field Programmable Gate Array)为核心的SDRAM控制器的设计... 针对SDRAM(Synchronous Dynamic Random Access Memory)在缓存图像数据时时序的控制比较复杂的问题,在研究SDRAM的特点和原理的基础上,提出了一种基于现场可编程逻辑器件FPGA(Field Programmable Gate Array)为核心的SDRAM控制器的设计方案。采用分模块的思想,把SDRAM的控制分成不同的功能模块,各模块之间通过信号状态线相互关联,并且相关模块利用状态机来控制整个时序的过程。另外,为了提高SDRAM的缓存速度,选择了SDRAM工作在页突发操作模式下,使SDRAM的读写速度有了大幅的提升。整个控制系统经过仿真和在线逻辑分析仪验证表明:控制器能准确地对SDRAM进行读写控制,稳定可靠,可应用于不同的高速缓存系统。 展开更多

关键词 SDRAM FPGA 模块化控制 状态机 页突发

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嵌入式系统中存储器性能研究 被引量：1

19

作者 石磊 袁杰 《现代电子技术》 2012年第2期13-16,共4页

动态随机存储器是嵌入式系统的一个重要组成部分,而动态随机存储器故障是嵌入式系统故障的一个主要原因之一。在此从动态随机存储器的结构和失效模型出发,有针对地提出了用于检测性能的数据和读写方式,实验证明通过提出的检测方法能够... 动态随机存储器是嵌入式系统的一个重要组成部分,而动态随机存储器故障是嵌入式系统故障的一个主要原因之一。在此从动态随机存储器的结构和失效模型出发,有针对地提出了用于检测性能的数据和读写方式,实验证明通过提出的检测方法能够有效地找出潜在的存储器故障,从而能够为嵌入式系统设计人员提供改善系统性能的方法和途径。 展开更多

关键词 嵌入式系统 动态随机存储器 故障检测 失效模型

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激光加工多自由度工作台控制系统 被引量：2

20

作者 张明勇 田明 刘思宇 《光电技术应用》 2014年第6期56-59,共4页

主要对激光加工多自由度工作台控制系统的硬件和软件进行了设计。系统选用多轴运动控制器(PMAC)作为核心控制器,实现对激光加工5个运动轴的控制。介绍了双端口RAM实现上位机与PMAC的通讯方法,这种方法可以大大提高系统的通信速度。设计... 主要对激光加工多自由度工作台控制系统的硬件和软件进行了设计。系统选用多轴运动控制器(PMAC)作为核心控制器,实现对激光加工5个运动轴的控制。介绍了双端口RAM实现上位机与PMAC的通讯方法,这种方法可以大大提高系统的通信速度。设计了可视化人机交互界面,为用户联系控制系统提供了一个友好的交互窗口。表述了PMAC运动程序及PLC程序的编写过程,为用户自主进行程序开发提供了指导。这些研究分析对硬件设计和软件开发都具有重要的参考意义。 展开更多

关键词 PMAC卡 双端口RAM PLC程序

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