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8B/10B编码器的设计及实现
被引量：
22
1
作者
李宥谋
《电讯技术》
2005年第6期26-32,共7页
本文介绍了8B/10B编码技术,提出了一种简单、实用的8B/10B编码器的实现方法,并且采用Verilog语言设计了一种通用的软核。通过在FPGA器件上进行测试,电路稳定、可靠,可直接嵌入到需要8B/10B编码功能的收发器电路中。
关键词
串行数据传输
8B/10B编码
极性偏差(
rd
)
VERILOG语言
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职称材料
题名
8B/10B编码器的设计及实现
被引量：
22
1
作者
李宥谋
机构
西安邮电学院专用集成电路设计中心
出处
《电讯技术》
2005年第6期26-32,共7页
基金
国家863计划项目(2003AA1Z1190)
国家自然科学基金资助项目(90207015)
文摘
本文介绍了8B/10B编码技术,提出了一种简单、实用的8B/10B编码器的实现方法,并且采用Verilog语言设计了一种通用的软核。通过在FPGA器件上进行测试,电路稳定、可靠,可直接嵌入到需要8B/10B编码功能的收发器电路中。
关键词
串行数据传输
8B/10B编码
极性偏差(
rd
)
VERILOG语言
Keywords
Serial data transmission
8 B/10B encoding
rrunning disparity （ rd ）
Verilog language
分类号
TN919.3 [电子电信—通信与信息系统]
TN762 [电子电信—电路与系统]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
8B/10B编码器的设计及实现
李宥谋
《电讯技术》
2005
22
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