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FPGA与DDR2 SDRAM互联的信号完整性分析
被引量：
6
1
作者
吴长瑞
岑凡
蔡惠智
《计算机工程与应用》
CSCD
北大核心
2011年第29期158-160,共3页
论述了Virtex-5和DDR2 SDRAM在互联中的信号完整性问题,利用前仿和后仿的措施分析和验证了它们在不同互联拓扑结构下的信号完整性。通过原型机的测试,验证了该理论在高速电路设计中的应用有效性。
关键词
信号完整性
输入输出缓冲器信息规范模型
高速印制电路板设计
HyperLynx仿真
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职称材料
一种高频时钟源的设计与实现
被引量：
1
2
作者
于波
韩月秋
《北京理工大学学报》
EI
CAS
CSCD
1999年第6期747-749,共3页
目的 研究一种用于高速数据采集的高频时钟源的设计与实现 .方法 在其物理实现中采用微带传输线的连接方式及多种抗干扰设计 ,进行了基于输入 /输出缓冲参数特性 ( IBIS)模型的信号完整性分析及软件仿真 .结果 给出了示波器实测的高...
目的 研究一种用于高速数据采集的高频时钟源的设计与实现 .方法 在其物理实现中采用微带传输线的连接方式及多种抗干扰设计 ,进行了基于输入 /输出缓冲参数特性 ( IBIS)模型的信号完整性分析及软件仿真 .结果 给出了示波器实测的高频时钟源输出结果 .该时钟源可输出 5 0 0 MHz或外接信号源频率的两路正交差分 ECL 时钟信号 .结论 系统工作稳定可靠 。
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关键词
高频时钟源
数据采集
设计
微带传输线
ibis
模型
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职称材料
题名
FPGA与DDR2 SDRAM互联的信号完整性分析
被引量：
6
1
作者
吴长瑞
岑凡
蔡惠智
机构
中国科学院声学研究所
出处
《计算机工程与应用》
CSCD
北大核心
2011年第29期158-160,共3页
文摘
论述了Virtex-5和DDR2 SDRAM在互联中的信号完整性问题,利用前仿和后仿的措施分析和验证了它们在不同互联拓扑结构下的信号完整性。通过原型机的测试,验证了该理论在高速电路设计中的应用有效性。
关键词
信号完整性
输入输出缓冲器信息规范模型
高速印制电路板设计
HyperLynx仿真
Keywords
signal integrity
input/output buffer information specification（ibis） model
high-speed Printed Circuit Board （PCB） design
HyperLynx simulation
分类号
TN702 [电子电信—电路与系统]
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职称材料
题名
一种高频时钟源的设计与实现
被引量：
1
2
作者
于波
韩月秋
机构
北京理工大学电子工程系
出处
《北京理工大学学报》
EI
CAS
CSCD
1999年第6期747-749,共3页
文摘
目的 研究一种用于高速数据采集的高频时钟源的设计与实现 .方法 在其物理实现中采用微带传输线的连接方式及多种抗干扰设计 ,进行了基于输入 /输出缓冲参数特性 ( IBIS)模型的信号完整性分析及软件仿真 .结果 给出了示波器实测的高频时钟源输出结果 .该时钟源可输出 5 0 0 MHz或外接信号源频率的两路正交差分 ECL 时钟信号 .结论 系统工作稳定可靠 。
关键词
高频时钟源
数据采集
设计
微带传输线
ibis
模型
Keywords
high frequency oscillator
microstrip transmission line
input
/output
buffer
information
specification
(
ibis
)
model
signal integrity analysis
分类号
TP274.2 [自动化与计算机技术—检测技术与自动化装置]
TN789.1 [电子电信—电路与系统]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
FPGA与DDR2 SDRAM互联的信号完整性分析
吴长瑞
岑凡
蔡惠智
《计算机工程与应用》
CSCD
北大核心
2011
6
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职称材料
2
一种高频时钟源的设计与实现
于波
韩月秋
《北京理工大学学报》
EI
CAS
CSCD
1999
1
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职称材料
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参考文献
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