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基于正规基的大规模S盒FPGA设计与实现
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作者 张磊 李国元 +2 位作者 洪睿鹏 王建新 肖超恩 《密码学报(中英文)》 北大核心 2025年第4期854-869,共16页
传统上的分组密码S盒硬件实现采用查表法,其实现效果受到芯片资源的限制.针对16-bit大规模S盒在FPGA硬件实现中资源消耗大的问题,本文提出了基于复合域中正规基的S盒构造方法,研究使用较少的硬件资源实现16-bit S盒.首先,设计了基于复... 传统上的分组密码S盒硬件实现采用查表法,其实现效果受到芯片资源的限制.针对16-bit大规模S盒在FPGA硬件实现中资源消耗大的问题,本文提出了基于复合域中正规基的S盒构造方法,研究使用较少的硬件资源实现16-bit S盒.首先,设计了基于复合域的16-bit S盒构造实现方案,构建了线性的同构映射矩阵及其逆矩阵.其次,通过映射矩阵使有限域GF(2^(16))的乘法逆转换到复合域GF((((2^(2))^(2))^(2))^(2))上,进而将非线性的高维乘法逆简化为低维子域运算.然后,通过分析各级复合域不同参数对S盒实现的影响,筛选最优参数.最后,结合所提出的16-bit S盒构造实现框架,本文利用Xilinx公司的Vivado开发工具,以MK-3算法的16-bit S盒为例进行了FPGA仿真验证与性能分析.结果表明,本文构造方法实现的MK-3算法S盒需要186个LUT,时钟频率为114.129 MHz,在时钟频率/LUT的性能指标下达到了0.61360.同目前已公开文献同类方法中的最优实现性能0.43538相比,性能提升了40.93%.本文的16-bit S盒实现方案能够在降低硬件资源消耗的同时保持密码算法较高的运行频率,对有基于有限域构造的S盒的高效软硬件实现具有一定的参考价值. 展开更多
关键词 大规模S盒 复合域 正规基 MK-3算法 fpga
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基于FPGA的SM4异构加速系统
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作者 张全新 李可 +1 位作者 邵雨洁 谭毓安 《信息网络安全》 北大核心 2025年第7期1021-1031,共11页
国密SM4算法是WAPI无线网络标准中广泛使用的加密算法。目前,针对SM4加解密的研究主要集中于硬件实现结构优化,以提高吞吐量和安全性。同时,大数据和5G通信技术的发展对数据加解密的带宽和实时性提出了更高的要求。基于此背景,文章提出... 国密SM4算法是WAPI无线网络标准中广泛使用的加密算法。目前,针对SM4加解密的研究主要集中于硬件实现结构优化,以提高吞吐量和安全性。同时,大数据和5G通信技术的发展对数据加解密的带宽和实时性提出了更高的要求。基于此背景,文章提出一种基于FPGA的SM4异构加速系统,使用硬件实现SM4算法,并优化加解密性能;采用流式高速数据传输架构,支持多个SM4核并行工作,充分利用系统带宽;设计可配置接口,连接SM4与传输架构,提供足够的灵活性。系统于Xilinx XCVU9P FPGA上实现,支持随时更改SM4的负载和模式。测试得到SM4的最大工作频率为462 MHz,系统吞吐量高达92 Gbit/s,延迟仅为266μs。实验结果表明,与其他现有工作相比,该系统能获得更高的SM4工作频率和系统吞吐量,满足高带宽和低延迟的SM4加速需求。 展开更多
关键词 国密SM4算法 fpga 硬件加速 传输架构
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基于FPGA的PCB缺陷检测系统设计与实现
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作者 任喜伟 刘嘉玥 +1 位作者 余杰 孙悦 《仪表技术与传感器》 北大核心 2025年第3期58-64,71,共8页
为应对传统印刷电路板(PCB)缺陷检测方法存在的检测速度慢、准确率低等问题,设计了基于FPGA的PCB缺陷检测系统。系统采用CMOS OV5640传感器采集PCB图像数据,并对采集的图像进行灰度化、滤波及边缘检测等图像预处理。提出了改进的灰度拉... 为应对传统印刷电路板(PCB)缺陷检测方法存在的检测速度慢、准确率低等问题,设计了基于FPGA的PCB缺陷检测系统。系统采用CMOS OV5640传感器采集PCB图像数据,并对采集的图像进行灰度化、滤波及边缘检测等图像预处理。提出了改进的灰度拉伸算法,通过整体线性拉伸灰度值,图像对比度显著增强;提出了改进的边缘检测算法,扩展传统Sobel边缘检测2算子至8算子边缘检测,提高图像边缘信息的清晰度,增强图像分析与识别的准确性。系统将预处理后的PCB图像和标准模板图像存储在SDRAM中,采用背景差分比算法进行缺陷检测,并选用EP4CE10F17C8N芯片实现系统各模块的FPGA设计。实验结果表明:改进的检测系统在检测精度方面较其他方法显著提升,且相比于PCB缺陷检测软件,FPGA硬件处理速度明显提高。 展开更多
关键词 图像处理 fpga 背景差分算法 缺陷检测
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基于FPGA的高速AES实现与列混合改进 被引量:1
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作者 申锦尚 张庆顺 宋铁锐 《计算机工程与科学》 北大核心 2025年第4期612-620,共9页
提出了一种基于FPGA的AES高速通信实现方案。通过将加密过程拆分为30级并行流水线结构,提高了通信速度和加密效率。同时,根据AES中列混合部分特殊的GF(28)有限域运算规则和FPGA并行运算的结构特点,设计了中间量交叉列混合结构。该结构... 提出了一种基于FPGA的AES高速通信实现方案。通过将加密过程拆分为30级并行流水线结构,提高了通信速度和加密效率。同时,根据AES中列混合部分特殊的GF(28)有限域运算规则和FPGA并行运算的结构特点,设计了中间量交叉列混合结构。该结构可以有效地减少列混合与逆列混合部分的运算延迟和使用面积,提高了加密效率。从逻辑代数的角度,分析了传统列混合结构、较新的列混合结构和中间量交叉计算结构之间计算资源使用量的不同。最终在Xilinx公司的XC5VSX240T芯片上进行了验证,验证结果表明,此方案实现了吞吐量为60.928 Gbps和加密效率为14.875 Mbps/LUT的性能。 展开更多
关键词 fpga AES加密算法 列混合 流水线
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轮内流水线型SM4算法的FPGA优化 被引量:1
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作者 郭宇 贾小云 +2 位作者 蒋建伟 杨振英 段克盼 《陕西科技大学学报》 北大核心 2025年第3期174-180,共7页
针对SM4算法在现场可编程门阵列(FPGA)实现过程中结构复杂、运算速度慢的问题,基于流水线思想对SM4算法的FPGA实现方式做了进一步优化.对SM4算法的多种FPGA实现策略进行了分析,寻找出每种实现策略的关键路径.对SM4算法S盒的FPGA实现策... 针对SM4算法在现场可编程门阵列(FPGA)实现过程中结构复杂、运算速度慢的问题,基于流水线思想对SM4算法的FPGA实现方式做了进一步优化.对SM4算法的多种FPGA实现策略进行了分析,寻找出每种实现策略的关键路径.对SM4算法S盒的FPGA实现策略进行了改进,将S盒运算拆分为查找表(LUT)级别的存储运算并基于LUT原语进行了实现,降低了S盒运算的复杂度.提出了改进的轮内流水线型SM4算法,将算法的关键路径缩短为单级LUT运算.基于ZYNQ-7020开发板对改进的算法进行了综合与实现,所实现方案的运行时钟频率为518 MHz,吞吐量为66.30 Gb/s,优于现有方案. 展开更多
关键词 SM4算法 fpga 流水线结构
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基于FPGA的多普勒频移提取方法 被引量:1
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作者 柴哲凡 王红亮 《仪表技术与传感器》 北大核心 2025年第5期66-70,80,共6页
多普勒频移提取是水域探测仪器的关键步骤,频移提取精度直接影响测量结果的精度。文中基于FPGA实现了以复相关算法为核心的多普勒频移提取方法,该方法具有灵活性强、可根据不同场景进行配置等特点。设计了基于双查找表的复相关计算方法... 多普勒频移提取是水域探测仪器的关键步骤,频移提取精度直接影响测量结果的精度。文中基于FPGA实现了以复相关算法为核心的多普勒频移提取方法,该方法具有灵活性强、可根据不同场景进行配置等特点。设计了基于双查找表的复相关计算方法,与使用CORDIC IP核计算反正切运算的方法相比,其计算速度更快,也能保证较高的计算精度;与传统的查找表法相比,该方法能够在占用少量FPGA内部存储资源的情况下极大提高反正切运算在[0,1)范围的计算精度。反正切运算在自变量为[0,1)的值域为[0,π/4),占自变量在[0,+∞)时对应值域的1/2,故保证其在定义域为[0,1)范围的计算精度对使用复相关算法提取多普勒频移非常重要。对双查找表中数据的截断误差进行了分析,在型号为XC7A35TFGG484-2的FPGA芯片上实现了该多普勒频移提取方法,对其频移提取功能进行了测试验证,证明了双查找表法的实用性以及该频移提取方法的有效性。 展开更多
关键词 频移提取 复相关算法 fpga 双查找表 反正切运算
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基于FPGA的YOLOv4-tiny硬件优化与实现
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作者 王凯 柏艳红 +1 位作者 李小松 李浩然 《组合机床与自动化加工技术》 北大核心 2025年第9期24-27,33,共5页
针对YOLOv4-tiny算法结构复杂、计算资源消耗大、参数众多,难以在FPGA上高效部署的问题,提出了一种软硬件结合的优化策略。将YOLOv4-tiny的骨干网络替换为Mobilenetv1网络,在加强特征提取网络中引入CBAM模块;对网络结构进行通道剪枝,对... 针对YOLOv4-tiny算法结构复杂、计算资源消耗大、参数众多,难以在FPGA上高效部署的问题,提出了一种软硬件结合的优化策略。将YOLOv4-tiny的骨干网络替换为Mobilenetv1网络,在加强特征提取网络中引入CBAM模块;对网络结构进行通道剪枝,对权重和偏置进行16位定点数量化。改进后的网络与原始YOLOv4-tiny相比参数量减少了40%,而识别准确率基本不变。使用高层次综合工具生成FPGA IP核,设计并行流水化的卷积结构并采用卷积层间分块操作,提高计算效率。将改进后算法在Zynq-7020FPGA芯片上实现,实验结果表明,改进后算法计算性能为43.4 GOP/s,是现有文献的1.6~4.1倍;能效比是现有的工作的4.8~10.7倍。所提策略能更高效地将算法部署在资源受限的FPGA平台上。 展开更多
关键词 YOLOv4-tiny 算法剪枝 算法量化 fpga 并行流水结构
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基于FPGA的串列加速器端电压稳压系统数字化应用
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作者 马妍瑞 安广朋 +1 位作者 崔保群 李爱玲 《核电子学与探测技术》 北大核心 2025年第3期364-370,共7页
粒子经串列加速器加速后,若要获得高品质的束流,需确保串列加速器端电压的稳定性。为了进一步提高1.7 MV串列加速器束流的品质,提出了基于FPGA的粒子加速器稳压实时控制系统的方法。利用GVM、CPO和狭缝测量束流能量的漂移信息,进而实现... 粒子经串列加速器加速后,若要获得高品质的束流,需确保串列加速器端电压的稳定性。为了进一步提高1.7 MV串列加速器束流的品质,提出了基于FPGA的粒子加速器稳压实时控制系统的方法。利用GVM、CPO和狭缝测量束流能量的漂移信息,进而实现对高压信号变化的采集,通过数模转换传输至FPGA实现稳压控制系统的增量式PID算法优化,反馈于电晕针对高压进行控制,缩短了电压调节时间。在实验仿真过程中,实时控制高压稳定度可以达到±0.039%,满足最终所需的稳压效果。 展开更多
关键词 串列加速器 稳压控制系统 fpga 增量式PID算法
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基于LED球幕显示的线性插值算法及FPGA硬件实现
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作者 温元毅 董家昌 +2 位作者 郑喜凤 范翊 曹慧 《液晶与显示》 北大核心 2025年第10期1458-1469,共12页
针对LED球幕显示屏在较高纬度区域因物理像素衰减导致的图像失真与分辨率失配问题,提出一种基于LED球幕显示的线性插值算法并在FPGA平台上进行硬件实现,旨在减少LED球幕显示中的图像失真与数据缺失。首先,构建了动态平面-球面像素插值模... 针对LED球幕显示屏在较高纬度区域因物理像素衰减导致的图像失真与分辨率失配问题,提出一种基于LED球幕显示的线性插值算法并在FPGA平台上进行硬件实现,旨在减少LED球幕显示中的图像失真与数据缺失。首先,构建了动态平面-球面像素插值模型,通过引入插值步长参数将浮点运算转化为定点整数运算。其次,提出基于立体角分析的动态步长调控机制,根据像素密度差异自适应调整插值精度。然后,设计全流水线硬件架构,将坐标变换、像素重采样及插值计算深度协同,通过FIFO数据重映射模块实现低处理延时。实验结果表明,与直接显示在球幕屏上的图像对比,经本算法处理后的球幕显示图像的平均峰值信噪提升10.41%,结构相似性值平均提高0.36%,图像信息熵平均增加1.60 bit。同时,算法在FPGA硬件平台上实现时,单帧数据处理时间低于0.19 ms。本文方法有效解决了球幕屏显示过程中的图像失真与分辨率失配问题,且算法复杂度低、硬件资源占用少,处理延时低,满足高帧率强交互场景的实时处理需求。 展开更多
关键词 LED球幕屏 线性插值算法 fpga 实时处理
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基于FPGA与MRFO算法的交通信号灯智能控制方法
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作者 杨楠 肖军 《现代电子技术》 北大核心 2025年第20期51-55,共5页
为依据交通流量实现交通灯自适应调整、最大化通行效率并提升交通智能化管理水平,提出一种基于FPGA与蝠鲼觅食优化(MRFO)算法的交通信号灯智能控制方法。分析交通信号灯智能控制实际需求,构建基于FPGA的交通信号灯智能控制框架。基于智... 为依据交通流量实现交通灯自适应调整、最大化通行效率并提升交通智能化管理水平,提出一种基于FPGA与蝠鲼觅食优化(MRFO)算法的交通信号灯智能控制方法。分析交通信号灯智能控制实际需求,构建基于FPGA的交通信号灯智能控制框架。基于智能控制框架,根据实际交通运行情况构建交通路口所有流向车辆延时最小目标函数及相关约束条件。通过MRFO算法,在满足约束条件情况下迭代寻优交通信号灯智能控制目标函数,得到最优控制策略以实现交通信号灯智能控制。实验验证表明,所提方法在训练样本较少的情况下仍能实现较低车辆延时,具有高效性;且能够依据交通路口车流量情况自适应调整信号灯时长,保证车辆通过率均在96%以上。该方法能够有效缓解路段拥堵、减少安全事故,提升交通安全水平,验证了其有效性。 展开更多
关键词 fpga MRFO算法 交通信号灯 智能控制 控制框架构建 目标函数 最优控制策略
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基于FPGA的改进SGM算法
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作者 班正将 周哲海 《电子测量技术》 北大核心 2025年第19期69-76,共8页
传统的双目SGM算法,计算复杂且对计算资源的需求较大,难以满足小型嵌入式系统的实时应用和低功耗需求。为此本文提出了一种基于FPGA架构的改进方案,旨在提升双目SGM算法的实时性、资源利用率,并减少资源开销。改进的SGM算法通过调整代... 传统的双目SGM算法,计算复杂且对计算资源的需求较大,难以满足小型嵌入式系统的实时应用和低功耗需求。为此本文提出了一种基于FPGA架构的改进方案,旨在提升双目SGM算法的实时性、资源利用率,并减少资源开销。改进的SGM算法通过调整代价集合的方向,使其与FPGA数据流方向一致,从而实现四路径并行计算;在视差计算阶段,引入基于二项式的亚像素插值技术,使得视差计算与优化过程能够同步进行,减少计算延迟,进一步降低资源消耗和系统功耗。实验结果表明,改进后的算法相比传统SGM算法,平均视差误差降低了32.4%,LUT资源的利用率提升了45%,资源消耗减少了25%,并且算法的匹配速率达到了65.3 fps,系统功耗仅为2.85 W,满足了小型实时嵌入式系统的要求。 展开更多
关键词 现场可编程门阵列(fpga) SGM算法 嵌入式系统 亚像素插值
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资源节约型的SM4算法FPGA设计与实现
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作者 张磊 张修政 洪睿鹏 《信息安全研究》 北大核心 2025年第6期490-499,共10页
在SM4算法的硬件实现中通常采用查找表方法实现S盒,该方式将占用大量的硬件资源.提出了一种基于多项式基的SM4算法实现方案,对SM4算法使用8×8 S盒实现了基于复合域GF((2^(4))^(2))和复合域GF(((2^(2))^(2))^(2))的2种构造方案,测... 在SM4算法的硬件实现中通常采用查找表方法实现S盒,该方式将占用大量的硬件资源.提出了一种基于多项式基的SM4算法实现方案,对SM4算法使用8×8 S盒实现了基于复合域GF((2^(4))^(2))和复合域GF(((2^(2))^(2))^(2))的2种构造方案,测试结果表明,基于多项式基的GF((2^(4))^(2))方案资源占用很少.在此基础上综合考虑资源占用和性能,设计了有限状态机和流水线2种SM4硬件实现结构.相比传统的查找表方式,有限状态机结构资源占用减少21.98%,运行主频提高14.40%;流水线结构资源占用减少54.23%. 展开更多
关键词 SM4算法 分组密码算法 多项式基 fpga 复合域
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基于国产FPGA与SM4算法的总线通信加解密IP核设计
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作者 李森 袁强 唐建 《兵工自动化》 北大核心 2025年第7期11-15,58,共6页
针对某终端设备之间总线通信的加密需求以及加密硬件程序便捷移植开发的需求,设计基于SM4加解密算法的IP核。采用轻量级单轮循环迭代结构,在满足吞吐率要求下降低对FPGA逻辑资源的消耗,其中查找表(look-up table,LUT)的消耗为2447个,触... 针对某终端设备之间总线通信的加密需求以及加密硬件程序便捷移植开发的需求,设计基于SM4加解密算法的IP核。采用轻量级单轮循环迭代结构,在满足吞吐率要求下降低对FPGA逻辑资源的消耗,其中查找表(look-up table,LUT)的消耗为2447个,触发器(flip-flop,FF)的消耗为2914个;采用加密、解密独立运行的方式使通信过程中的加密运算与解密运算可同时进行互不干扰;使用Vivado2022.2对IP核进行封装;采用一种“线性变换参数可控”的机制,使加密安全性由单一的密钥作为保证变为“密钥+线性变换参数”的双重保证,提高加密的安全性。测试结果表明:在满足吞吐率要求的条件下,该IP核可应用于UART(485/422/232)、CAN、1553B等总线的数据加密,且性能稳定。 展开更多
关键词 fpga SM4算法 IP核 线性变换参数可控
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基于FPGA的格基数字签名算法硬件优化
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作者 胡跃 赵旭阳 +3 位作者 王威 袁谦 郑婕妤 杨亚芳 《软件学报》 北大核心 2025年第10期4461-4482,共22页
数字签名算法对于网络安全基础设施有至关重要的作用,目前的数字签名方案大多是基于Rivest-Shamir-Adleman(RSA)和椭圆曲线密码学(ECC)实现的.随着量子计算技术的快速发展,基于传统的公钥密码体系的数字签名方案将面临安全性风险,研究... 数字签名算法对于网络安全基础设施有至关重要的作用,目前的数字签名方案大多是基于Rivest-Shamir-Adleman(RSA)和椭圆曲线密码学(ECC)实现的.随着量子计算技术的快速发展,基于传统的公钥密码体系的数字签名方案将面临安全性风险,研究和部署能够抵抗量子攻击的新型密码方案成为重要的研究方向.经过多轮评估分析,美国国家标准研究院(National Institute of Standards and Technology,NIST)于2024年8月公布了后量子数字签名标准方案ML-DSA,其核心算法是Dilithium.针对格基数字签名算法Dilithium高维多项式矩阵运算的特点,基于FPGA平台提出了多种优化实现方法,具体包括可配置参数的多功能脉动阵列运算单元、专用型多项式并行采样模块、针对多参数集的可重构存储单元设计、针对复杂多模块的高并行度时序状态机,旨在突破性能瓶颈以实现更高的签名运算效率,并最终实现了可同时支持3种安全等级的数字签名硬件架构.该设计方案在Xilinx Artix-7 FPGA平台上进行了实际的部署和运行,并且和已有的同类型工作进行了对比.结果表明,与最新的文献相比,该设计方案在3种安全等级下的签名运算效率分别提升了7.4、8.3和5.6倍,为抗量子安全的数字签名运算服务提供了性能基础,并且对于推进格密码方案的工程化和实用化进程提供了一定的借鉴意义和参考价值. 展开更多
关键词 后量子密码 格基密码 数字签名算法 fpga 硬件实现
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低FPGA硬件资源消耗的SC-FDE定时同步方案研究
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作者 胡海勤 韩文璇 张锐 《现代电子技术》 北大核心 2025年第19期77-83,共7页
随着SC-FDE通信系统的日益复杂化,通信系统的硬件实现方案与FPGA有限的硬件资源间的矛盾越发突出。文中提出一种去信号归一化短序列SC-FDE定时同步算法。该算法要求将SC-FDE信号的定时同步序列内容改造为连续三段相同的m序列,同时序列... 随着SC-FDE通信系统的日益复杂化,通信系统的硬件实现方案与FPGA有限的硬件资源间的矛盾越发突出。文中提出一种去信号归一化短序列SC-FDE定时同步算法。该算法要求将SC-FDE信号的定时同步序列内容改造为连续三段相同的m序列,同时序列总长度保持不变。该算法虽然相比传统互相关算法在低性噪比AWGN信道中有0.5 dB的性能损失,但基于该算法的FPGA实现方案对比基于传统互相关SC-FDE定时同步算法的FPGA实现方案,能够节约高达70.2%的查找表、60.4%的寄存器和全部的数字信号处理单元。所提算法与实现方案能够缓解一些SC-FDE通信系统正面临的FPGA硬件资源不足、硬件成本过高的困境。 展开更多
关键词 单载波频域均衡 定时同步算法 资源节省 fpga 互相关 定时度量函数
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应用FPGA和小波变换提取局部放电信号 被引量:6
16
作者 李新 胡伟宣 +1 位作者 张明霞 张从力 《高电压技术》 EI CAS CSCD 北大核心 2007年第8期5-9,21,共6页
小波变换是抑制局部放电中强干扰信号的有效工具,然而其巨大的计算量制约了它在局部放电在线监测中的现场应用。FPGA(Fielded Programmable Gate Array)器件兼具并行、串行的工作方式,有较高的并行计算能力,在现场数字信号处理领域具有... 小波变换是抑制局部放电中强干扰信号的有效工具,然而其巨大的计算量制约了它在局部放电在线监测中的现场应用。FPGA(Fielded Programmable Gate Array)器件兼具并行、串行的工作方式,有较高的并行计算能力,在现场数字信号处理领域具有较高的实时性。在分析了局部放电信号和白噪声的特点后,提出折衷小波包硬阈值变换算法。根据该算法,以DSP Builder为平台,模块化地设计出基于FPGA的流水线结构。从模拟现场信号中提取局部放电信号的实验结果表明系统可行。实际局部放电现场信号的处理结果表明,系统能较好的提取局部放电信号,同时满足了的实时性要求,在变压器的局部放电信号在线检测等领域具有一定的工程应用价值。 展开更多
关键词 局部放电 小波变换 fpga mallat算法 DSPBUILDER 流水线
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基于FPGA的暂态电能质量的检测方法 被引量:4
17
作者 房国志 王猛 王康 《电力系统保护与控制》 EI CSCD 北大核心 2012年第12期130-135,共6页
提出了基于FPGA实现小波变换算法的一种方法。该方法以硬逻辑方式,采用高通分解滤波器和低通分解滤波器来实现小波变换算法,解决了采用小波变换方法进行多分辨分析时由于计算量大限制了在实时监测系统中应用的实时性问题。以在检测信号... 提出了基于FPGA实现小波变换算法的一种方法。该方法以硬逻辑方式,采用高通分解滤波器和低通分解滤波器来实现小波变换算法,解决了采用小波变换方法进行多分辨分析时由于计算量大限制了在实时监测系统中应用的实时性问题。以在检测信号奇异点上有很好效果的DB5小波为基函数,对在暂态电能质量中电压暂升/暂降、电压中断、电压脉冲、振荡等信号建立模拟扰动信号源并进行了仿真,对比信号奇异点产生时间和仿真结果中奇异点产生时间,结果表明该方法的准确性和可行性。 展开更多
关键词 电能质量 fpga MAL lat算法 暂态扰动 DB5小波
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基于FPGA小波变换核的设计 被引量:3
18
作者 公茂法 王志文 +3 位作者 于江 李岚冰 安彬 刘涛 《电测与仪表》 北大核心 2014年第8期103-106,共4页
提出了一种基于FPGA的小波变换核的设计方案;介绍了小波变换的工作原理及其FPGA实现方式,利用FIR滤波器组实现了小波变换的Mallat算法,通过采用自顶向下的设计思想,使用Verilog语言进行了设计,在QuartusII及ModelSim下进行了编译和仿真... 提出了一种基于FPGA的小波变换核的设计方案;介绍了小波变换的工作原理及其FPGA实现方式,利用FIR滤波器组实现了小波变换的Mallat算法,通过采用自顶向下的设计思想,使用Verilog语言进行了设计,在QuartusII及ModelSim下进行了编译和仿真。并最终将设计进行参数化,实现IP核的参数化。经验证系统工作灵敏、可靠,完全满足实时性的要求。 展开更多
关键词 小波变换 mallat fpga FIR
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基于去降Mallat离散小波变换的彩色图像分割 被引量:6
19
作者 刘昌进 郭立 +1 位作者 朱俊株 徐雯 《计算机工程与应用》 CSCD 北大核心 2003年第11期93-95,102,共4页
该文针对Mallat快速离散小波变换,提出了一种利用变换平移不变性的离散小波变换的彩色图像分割方法。首先对原始图像进行平移不变性的小波变换,然后提取颜色和纹理特征,并采用k均值算法进行分割。实验表明该方法对纹理图像和彩色自然图... 该文针对Mallat快速离散小波变换,提出了一种利用变换平移不变性的离散小波变换的彩色图像分割方法。首先对原始图像进行平移不变性的小波变换,然后提取颜色和纹理特征,并采用k均值算法进行分割。实验表明该方法对纹理图像和彩色自然图像都具有较好的分割效果。 展开更多
关键词 mallat算法 小波变换 图像分割
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Mallat算法的光学实现 被引量:9
20
作者 韩亮 田逢春 +1 位作者 徐鑫 李立 《光学精密工程》 EI CAS CSCD 北大核心 2008年第8期1490-1499,共10页
提出了Mallat算法的光学实现方法。针对振幅型空间光调制器只能实现非负的实函数,且CCD只能记录光的强度,提出一种应用于光学4f系统的光学小波滤波器的设计方法。根据采样间距,基于张量积方法由一维小波滤波器系数构造二维小波滤波函数... 提出了Mallat算法的光学实现方法。针对振幅型空间光调制器只能实现非负的实函数,且CCD只能记录光的强度,提出一种应用于光学4f系统的光学小波滤波器的设计方法。根据采样间距,基于张量积方法由一维小波滤波器系数构造二维小波滤波函数。然后通过拆分、傅里叶变换与归一化,得到非负的实函数形式的频域小波滤波器。最后,给出相应的光学小波变换后处理方法。使用该种光学小波滤波器及其相应的后处理方法,利用光学4f系统实现Mallat算法的小波分解部分,并通过数值计算实现Mallat算法的小波重构部分。仿真实验结果表明,通过本文提出的方法在理论上能够高精度地重构输入图像;在引入光学器件量化误差的条件下,平均重构PSNR为54.27 dB。利用实际的光学4f系统进行光学实验,也能以良好的质量重构输入图像。仿真分析和光学实验结果验证了方法的正确性。 展开更多
关键词 信息光学 mallat算法 光学小波变换 光学4f系统
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