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USB2.0中CRC码的并行算法及硬件实现: 1; 作者陈静瑾邓雅诺 +1 位作者马文龙余宁梅《西安理工大学学报》 CAS 2004年第3期272-275,共4页; 基于CRC检错原理,针对USB2.0协议规定的要求,研究了一种通用的CRC16并行算法及硬件实现。该方法适用于不同的CRC生成多项式和不同的并行度,尤其对并行度大于8位的高速系统的CRC计算。与常用的串行算法及查表法相比,该方法使电路的硬件... 展开更多; 关键词 crc(循环冗余校验码) USB(通用串行总线) crc并行算法; 在线阅读下载PDF 职称材料

基于FPGA的CRC算法的串行和并行实现被引量：8: 2; 作者肖艳艳何晓雄《合肥工业大学学报（自然科学版）》 CAS CSCD 北大核心 2016年第10期1362-1366,共5页; 在数字数据通信系统中,由于信道传输特性不理想以及噪声等干扰,常常会出现一些异常情况。因此,通常在数据通信中添加循环冗余校验(cyclic redundancy check,CRC)码,可以大幅度提高通信的可靠性。文章在论述串行CRC实现的基础上,对电路... 展开更多; 关键词循环冗余校验码串行算法并行算法超高速集成电路硬件描述语言现场可编程逻辑门阵列; 在线阅读下载PDF 职称材料

HT总线的并行CRC-32计算原理及其实现: 3; 作者谭德立徐炜遐 +1 位作者屈婉霞刘涛《计算机工程与科学》 CSCD 2005年第7期101-102,共2页; 本文介绍了HT总线CRC32的计算原理,推导了8位HT链路的CRC32并行计算算法,用XilinxXC40005芯片实现并验证了该并行算法的正确性。; 关键词 HYPERTRANSPORT crc-32 并行算法; 在线阅读下载PDF 职称材料

基于FPGA的S模式并行数据编解码器设计被引量：2: 4; 作者李雷严玉国 +1 位作者杨宾峰张战斌《弹箭与制导学报》 CSCD 北大核心 2017年第5期127-130,135,共5页; 在分析二次雷达S模式信号格式以及CRC原理的基础上,针对传统串行编解码器存在效率低的问题,提出了一种改进型的并行编解码器。在MATLAB中完成编解码器输入与输出关系的计算,根据计算结果,使用Verilog HDL语言在FPGA平台上完成了编解码... 展开更多; 关键词二次雷达 S模式现场可编程逻辑门阵列循环冗余校验并行crc算法; 在线阅读下载PDF 职称材料

基于公式递推法的可变计算位宽的循环冗余校验设计与实现被引量：9: 5; 作者陈容陈岚 WAHLA Arfan Haider 《电子与信息学报》 EI CSCD 北大核心 2020年第5期1261-1267,共7页; 循环冗余校验(CRC)与信道编码的级联使用,可以有效改善译码的收敛特性。在新一代无线通信系统,如5G中,码长和码率都具有多样性。为了提高编译码分段长度可变的级联系统的译码效率,该文提出一种可变计算位宽的CRC并行算法。该算法在现有... 展开更多; 关键词循环冗余校验并行算法公式递推法; 在线阅读下载PDF 职称材料

USB 3.0设备中并行循环冗余校验的研究与实现被引量：1: 6; 作者滕立伟李小花《郑州轻工业学院学报（自然科学版）》 CAS 2012年第6期65-68,72,共5页; 针对串行循环冗余校验(CRC)算法不适于高速传输且不易于硬件实现的问题,结合USB 3.0设备中CRC的特点,推导出一种并行CRC算法,并用Verilog硬件编程语言加以实现.仿真试验表明,并行CRC校验算法具有更高的数据吞吐率,能降低时钟频率,易于... 展开更多; 关键词 USB 3.0设备循环冗余校验并行算法; 在线阅读下载PDF 职称材料

题名USB2.0中CRC码的并行算法及硬件实现: 1; 作者陈静瑾邓雅诺马文龙余宁梅; 机构西安理工大学自动化与信息工程学院; 出处《西安理工大学学报》 CAS 2004年第3期272-275,共4页; 文摘基于CRC检错原理,针对USB2.0协议规定的要求,研究了一种通用的CRC16并行算法及硬件实现。该方法适用于不同的CRC生成多项式和不同的并行度,尤其对并行度大于8位的高速系统的CRC计算。与常用的串行算法及查表法相比,该方法使电路的硬件实现比较容易,提高了电路对数据的处理能力,减小了时延,具有现实性及优越性。; 关键词 crc(循环冗余校验码) USB(通用串行总线) crc并行算法; Keywords cyclic redundancy check universal serial bus crc parallel algorithm; 分类号 TP302.7 [自动化与计算机技术—计算机系统结构]; 在线阅读下载PDF 职称材料

题名基于FPGA的CRC算法的串行和并行实现被引量：8: 2; 作者肖艳艳何晓雄; 机构合肥工业大学电子科学与应用物理学院; 出处《合肥工业大学学报（自然科学版）》 CAS CSCD 北大核心 2016年第10期1362-1366,共5页; 基金中科院重点实验室开放课题资助项目(IIMDKFJJ-13-06 IIMDKFJJ-14-04); 文摘在数字数据通信系统中,由于信道传输特性不理想以及噪声等干扰,常常会出现一些异常情况。因此,通常在数据通信中添加循环冗余校验(cyclic redundancy check,CRC)码,可以大幅度提高通信的可靠性。文章在论述串行CRC实现的基础上,对电路结构提出了改进的方案,实现了基于现场可编程逻辑门阵列(field programmable gate array,FPGA)的CRC的串行2、4、8位和并行算法,并用超高速集成电路硬件描述语言(very-high-speed integrated circuit hardware description language,VHDL)实现CRC校验,将实验结果下载到DE2,验证了方案的可行性。; 关键词循环冗余校验码串行算法并行算法超高速集成电路硬件描述语言现场可编程逻辑门阵列; Keywords cyclic redundancy check（crc） serial algorithm parallel algorithm very-high-speed inte-grated circuit hardware description language（VHDL） field programmable gate array（FPGA）; 分类号 TN919.1 [电子电信—通信与信息系统]; 在线阅读下载PDF 职称材料

题名HT总线的并行CRC-32计算原理及其实现: 3; 作者谭德立徐炜遐屈婉霞刘涛; 机构国防科技大学计算机学院; 出处《计算机工程与科学》 CSCD 2005年第7期101-102,共2页; 文摘本文介绍了HT总线CRC32的计算原理,推导了8位HT链路的CRC32并行计算算法,用XilinxXC40005芯片实现并验证了该并行算法的正确性。; 关键词 HYPERTRANSPORT crc-32 并行算法; Keywords HyperTransport crc-32 parallel algorithm; 分类号 TP303 [自动化与计算机技术—计算机系统结构]; 在线阅读下载PDF 职称材料

题名基于FPGA的S模式并行数据编解码器设计被引量：2: 4; 作者李雷严玉国杨宾峰张战斌; 机构空军工程大学信息与导航学院; 出处《弹箭与制导学报》 CSCD 北大核心 2017年第5期127-130,135,共5页; 基金国家自然科学基金(51377172) 陕西省自然科学基础研究计划(2015JM5147)资助; 文摘在分析二次雷达S模式信号格式以及CRC原理的基础上,针对传统串行编解码器存在效率低的问题,提出了一种改进型的并行编解码器。在MATLAB中完成编解码器输入与输出关系的计算,根据计算结果,使用Verilog HDL语言在FPGA平台上完成了编解码器的设计,并在Modelsim软件中进行仿真验证。仿真结果表明,在短格式信号的编解码中,并行结构可以在一个时钟周期内完成数据的编解码工作,与传统串行编解码器相比,效率提高了56倍。; 关键词二次雷达 S模式现场可编程逻辑门阵列循环冗余校验并行crc算法; Keywords secondary surveillance radar FPGA crc mode S parallel crc algorithm; 分类号 TN958.96 [电子电信—信号与信息处理]; 在线阅读下载PDF 职称材料

题名基于公式递推法的可变计算位宽的循环冗余校验设计与实现被引量：9: 5; 作者陈容陈岚 WAHLA Arfan Haider; 机构中国科学院微电子研究所中国科学院大学三维及纳米集成电路设计自动化技术北京市重点实验室; 出处《电子与信息学报》 EI CSCD 北大核心 2020年第5期1261-1267,共7页; 基金国家科技重大专项(2018ZX03001006-002)。; 文摘循环冗余校验(CRC)与信道编码的级联使用,可以有效改善译码的收敛特性。在新一代无线通信系统,如5G中,码长和码率都具有多样性。为了提高编译码分段长度可变的级联系统的译码效率,该文提出一种可变计算位宽的CRC并行算法。该算法在现有固定位宽并行算法的基础上,合并公式递推法中反馈数据与输入数据的并行计算,实现了一种高并行度的CRC校验架构,并且支持可变位宽的CRC计算。与现有的并行算法相比,合并算法节省了电路资源的开销,在位宽固定时,资源节约效果明显,同时在反馈时延上也有将近50%的优化;在位宽可变时,电路资源的使用情况也有相应的优化。; 关键词循环冗余校验并行算法公式递推法; Keywords Cyclic Redundancy Check(crc) parallel algorithm Formula recursion algorithm; 分类号 TN911.72 [电子电信—通信与信息系统]; 在线阅读下载PDF 职称材料

题名USB 3.0设备中并行循环冗余校验的研究与实现被引量：1: 6; 作者滕立伟李小花; 机构中国海洋大学信息科学与工程学院昆明理工大学信息工程与自动化学院; 出处《郑州轻工业学院学报（自然科学版）》 CAS 2012年第6期65-68,72,共5页; 文摘针对串行循环冗余校验(CRC)算法不适于高速传输且不易于硬件实现的问题,结合USB 3.0设备中CRC的特点,推导出一种并行CRC算法,并用Verilog硬件编程语言加以实现.仿真试验表明,并行CRC校验算法具有更高的数据吞吐率,能降低时钟频率,易于硬件实现.; 关键词 USB 3.0设备循环冗余校验并行算法; Keywords USB 3.0 device cyclic redundancy check （crc） parallel algorithm; 分类号 TN919 [电子电信—通信与信息系统]; 在线阅读下载PDF 职称材料

	题名	作者	出处	发文年	被引量	操作
1	USB2.0中CRC码的并行算法及硬件实现	陈静瑾邓雅诺马文龙余宁梅	《西安理工大学学报》 CAS	2004	0	在线阅读下载PDF 职称材料
2	基于FPGA的CRC算法的串行和并行实现	肖艳艳何晓雄	《合肥工业大学学报（自然科学版）》 CAS CSCD 北大核心	2016	8	在线阅读下载PDF 职称材料
3	HT总线的并行CRC-32计算原理及其实现	谭德立徐炜遐屈婉霞刘涛	《计算机工程与科学》 CSCD	2005	0	在线阅读下载PDF 职称材料
4	基于FPGA的S模式并行数据编解码器设计	李雷严玉国杨宾峰张战斌	《弹箭与制导学报》 CSCD 北大核心	2017	2	在线阅读下载PDF 职称材料
5	基于公式递推法的可变计算位宽的循环冗余校验设计与实现	陈容陈岚 WAHLA Arfan Haider	《电子与信息学报》 EI CSCD 北大核心	2020	9	在线阅读下载PDF 职称材料
6	USB 3.0设备中并行循环冗余校验的研究与实现	滕立伟李小花	《郑州轻工业学院学报（自然科学版）》 CAS	2012	1	在线阅读下载PDF 职称材料